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# Copyright 2012, Sinclair R.F., Inc.
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# Architecture test -- no memories
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ARCHITECTURE core/9x8 Verilog

INSTRUCTION     2048
RETURN_STACK    32
DATA_STACK      32

PORTCOMMENT simulation completed strobe
OUTPORT         strobe  o_done_strobe   O_DONE_STROBE

PERIPHERAL      trace

ASSEMBLY        arch-nomem.s