OpenCores
URL https://opencores.org/ocsvn/socgen/socgen/trunk

Subversion Repositories socgen

[/] [socgen/] [trunk/] [Projects/] [opencores.org/] [logic/] [ip/] [micro_bus/] [rtl/] [xml/] [micro_bus_def.xml] - Blame information for rev 131

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1 131 jt_eaton
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30
31
xmlns:spirit="http://www.spiritconsortium.org/XMLSchema/SPIRIT/1685-2009"
32
xmlns:socgen="http://opencores.org"
33
xmlns:xsi="http://www.w3.org/2001/XMLSchema-instance"
34
xsi:schemaLocation="http://www.spiritconsortium.org/XMLSchema/SPIRIT/1685-2009
35
http://www.spiritconsortium.org/XMLSchema/SPIRIT/1685-2009/index.xsd">
36
 
37
opencores.org
38
logic
39
micro_bus
40
def  default
41
 
42
 
43
 
44
45
 
46
 slave_clk
47
  
48
  
49
  
50
    
51
      
52
        clk
53
        clk
54
      
55
    
56
 
57
 
58
 
59
 slave_reset
60
  
61
  
62
  
63
    
64
      
65
        reset
66
        reset
67
      
68
    
69
 
70
 
71
 
72
 master_enable
73
  
74
  
75
  
76
    
77
      
78
        enable
79
        enable
80
      
81
    
82
 
83
 
84
 
85
 cpu
86
  
87
  
88
  
89
  
90
  
91
  
92
  
93
  
94
  
95
  
96
 
97
    
98
      
99
        addr
100
        addr_in
101
        150
102
        
103
      
104
      
105
        rdata
106
        rdata_out
107
        reg
108
        150
109
        
110
      
111
 
112
 
113
 
114
      
115
        wdata
116
        wdata_in
117
        70
118
        
119
      
120
 
121
 
122
      
123
        wr
124
        wr_in
125
        
126
      
127
 
128
 
129
      
130
        rd
131
        rd_in
132
        
133
      
134
 
135
 
136
 
137
    
138
 
139
 
140
 
141
 
142
 mem
143
  
144
  
145
   
146
 
147
 
148
    
149
 
150
      
151
        addr
152
        mem_addr
153
        150
154
        
155
      
156
 
157
      
158
        cs
159
        mem_cs
160
        reg
161
        
162
      
163
 
164
      
165
        wdata
166
        mem_wdata
167
        150
168
        
169
      
170
 
171
      
172
        rdata
173
        mem_rdata
174
        150
175
        
176
      
177
 
178
 
179
      
180
        wait
181
        mem_wait
182
        10
183
        
184
      
185
 
186
 
187
      
188
        rd
189
        mem_rd
190
        
191
      
192
 
193
      
194
        wr
195
        mem_wr
196
        
197
      
198
 
199
    
200
 
201
 
202
 
203
 
204
 
205
 
206
 data
207
  
208
  
209
 
210
           
211
 
212
    
213
 
214
      
215
        addr
216
        data_addr
217
        111
218
        
219
      
220
 
221
      
222
        cs
223
        data_cs
224
        reg
225
        
226
      
227
 
228
      
229
        wdata
230
        data_wdata
231
        150
232
        
233
      
234
 
235
      
236
        rdata
237
        data_rdata
238
        150
239
        
240
      
241
 
242
 
243
      
244
        be
245
        data_be
246
        10
247
        
248
      
249
 
250
 
251
      
252
        rd
253
        data_rd
254
        
255
      
256
 
257
      
258
        wr
259
        data_wr
260
        
261
      
262
 
263
    
264
 
265
 
266
 
267
 
268
 
269
 io_reg
270
  
271
  
272
 
273
           
274
 
275
    
276
 
277
      
278
        addr
279
        io_reg_addr
280
        110
281
        
282
      
283
 
284
      
285
        cs
286
        io_reg_cs
287
        reg
288
        
289
      
290
 
291
      
292
        wdata
293
        io_reg_wdata
294
        70
295
        
296
      
297
 
298
      
299
        rdata
300
        io_reg_rdata
301
        150
302
        
303
      
304
 
305
 
306
      
307
        wait
308
        io_reg_wait
309
        
310
      
311
 
312
 
313
      
314
        rd
315
        io_reg_rd
316
        
317
      
318
 
319
      
320
        wr
321
        io_reg_wr
322
        
323
      
324
 
325
    
326
 
327
 
328
 
329
 
330
 
331
 ext_mem
332
  
333
  
334
 
335
           
336
 
337
 
338
    
339
 
340
      
341
        addr
342
        ext_mem_addr
343
        130
344
        
345
      
346
 
347
      
348
        cs
349
        ext_mem_cs
350
        reg
351
        
352
      
353
 
354
      
355
        wdata
356
        ext_mem_wdata
357
        150
358
        
359
      
360
 
361
      
362
        rdata
363
        ext_mem_rdata
364
        150
365
        
366
      
367
 
368
 
369
      
370
        wait
371
        ext_mem_wait
372
        
373
      
374
 
375
 
376
      
377
        rd
378
        ext_mem_rd
379
        
380
      
381
 
382
      
383
        wr
384
        ext_mem_wr
385
        
386
      
387
 
388
    
389
 
390
 
391
 
392
 
393
 
394
 
395
 
396
 prog_rom_mem
397
  
398
  
399
 
400
 
401
  
402
    
403
 
404
      
405
        addr
406
        prog_rom_mem_addr
407
        110
408
        
409
      
410
 
411
      
412
        cs
413
        prog_rom_mem_cs
414
        reg
415
        
416
      
417
 
418
      
419
        wdata
420
        prog_rom_mem_wdata
421
        150
422
        
423
      
424
 
425
      
426
        rdata
427
        prog_rom_mem_rdata
428
        150
429
        
430
      
431
 
432
 
433
      
434
        rd
435
        prog_rom_mem_rd
436
        
437
      
438
 
439
      
440
        wr
441
        prog_rom_mem_wr
442
        
443
      
444
 
445
    
446
 
447
 
448
 
449
 
450
 
451
 
452
 sh_prog_rom_mem
453
  
454
  
455
  
456
    
457
 
458
      
459
        addr
460
        sh_prog_rom_mem_addr
461
        110
462
        
463
      
464
 
465
      
466
        cs
467
        sh_prog_rom_mem_cs
468
        reg
469
        
470
      
471
 
472
      
473
        wdata
474
        sh_prog_rom_mem_wdata
475
        150
476
        
477
      
478
 
479
      
480
        rdata
481
        sh_prog_rom_mem_rdata
482
        150
483
        
484
      
485
 
486
 
487
      
488
        rd
489
        sh_prog_rom_mem_rd
490
        
491
      
492
 
493
      
494
        wr
495
        sh_prog_rom_mem_wr
496
        
497
      
498
 
499
    
500
 
501
 
502
 
503
 
504
 
505
506
 
507
 
508
 
509
510
 
511
 
512
 
513
 
514
515
  gen_verilog
516
  104.0
517
  none
518
  common
519
  ./tools/verilog/gen_verilog
520
    
521
    
522
      destination
523
      top
524
    
525
    
526
      dest_dir
527
      ../verilog
528
    
529
  
530
531
 
532
 
533
534
 
535
 
536
  
537
 
538
    
539
      fs-common
540
 
541
      
542
        
543
        ../verilog/top.body
544
        verilogSourcefragment
545
      
546
 
547
    
548
 
549
 
550
    
551
      fs-sim
552
 
553
      
554
        
555
        ../verilog/copyright.v
556
        verilogSourceinclude
557
      
558
 
559
      
560
        
561
        ../verilog/common/top
562
        verilogSourcemodule
563
      
564
 
565
 
566
    
567
 
568
 
569
    
570
      fs-syn
571
 
572
      
573
        
574
        ../verilog/copyright.v
575
        verilogSourceinclude
576
      
577
 
578
      
579
        
580
        ../verilog/common/top
581
        verilogSourcemodule
582
      
583
 
584
 
585
    
586
 
587
 
588
 
589
 
590
 
591
 
592
 
593
  
594
 
595
 
596
 
597
 
598
599
 
600
      
601
 
602
 
603
              
604
              verilog
605
              
606
              
607
                                   spirit:library="Testbench"
608
                                   spirit:name="toolflow"
609
                                   spirit:version="verilog"/>
610
              
611
              
612
 
613
 
614
 
615
 
616
 
617
 
618
              
619
              commoncommon
620
 
621
              Verilog
622
              
623
                     
624
                            fs-common
625
                     
626
              
627
 
628
 
629
              
630
              sim:*Simulation:*
631
 
632
              Verilog
633
              
634
                     
635
                            fs-sim
636
                     
637
              
638
 
639
              
640
              syn:*Synthesis:*
641
 
642
              Verilog
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                            fs-syn
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              doc
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653
              
654
                                   spirit:library="Testbench"
655
                                   spirit:name="toolflow"
656
                                   spirit:version="documentation"/>
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              :*Documentation:*
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              Verilog
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680
 
681
682
 
683
 
684
 
685
  cpu
686
 
687
   
688
     io_reg
689
     0x8000
690
   
691
 
692
 
693
   
694
     data
695
     0x1000
696
   
697
 
698
   
699
     ext_mem
700
     0x4000
701
   
702
 
703
 
704
   
705
     prog_rom_mem
706
     0xc000
707
   
708
 
709
 
710
   
711
     sh_prog_rom_mem
712
     0xf000
713
   
714
 
715
 
716
 
717
 
718
719
 
720
 
721
 
722
 
723
 
724
725
 
726
  
727
    io_reg
728
    0x8000
729
    8
730
  
731
 
732
 
733
  
734
    data
735
    0x1000
736
    8
737
  
738
 
739
 
740
 
741
  
742
    mem
743
    0x0000
744
    8
745
  
746
 
747
 
748
 
749
 
750
  
751
    ext_mem
752
    0x4000
753
    8
754
  
755
 
756
 
757
  
758
    prog_rom_mem
759
    0xff00
760
    8
761
  
762
 
763
 
764
  
765
    sh_prog_rom_mem
766
    0xc000
767
    8
768
  
769
 
770
 
771
 
772
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