OpenCores
URL https://opencores.org/ocsvn/an-fpga-implementation-of-low-latency-noc-based-mpsoc/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk

Subversion Repositories an-fpga-implementation-of-low-latency-noc-based-mpsoc

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/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/sdram_core.v
14,6 → 14,7
parameter NIC_CONNECT_PORT = 0, // 0:Local 1:East, 2:North, 3:West, 4:South
parameter SDRAM_ADDR_WIDTH = 25,
parameter CAND_VC_SEL_MODE = 0,
parameter CONGESTION_WIDTH = 8,
parameter VC_ID_WIDTH = VC_NUM_PER_PORT,
parameter FLIT_WIDTH = PYLD_WIDTH+FLIT_TYPE_WIDTH+VC_ID_WIDTH,
parameter CORE_NUMBER = `CORE_NUM(SW_X_ADDR,SW_Y_ADDR)
26,7 → 27,8
output [FLIT_WIDTH-1 :0] flit_out,
output flit_out_wr,
input [VC_NUM_PER_PORT-1 :0] credit_in,
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [FLIT_WIDTH-1 :0] flit_in,
input flit_in_wr,
output [VC_NUM_PER_PORT-1 :0] credit_out,
112,7 → 114,7
.flit_out (flit_out),
.flit_out_wr (flit_out_wr),
.credit_in (credit_in),
.congestion_cmp_i (congestion_cmp_i),
.flit_in (flit_in),
.flit_in_wr (flit_in_wr),
.credit_out (credit_out),
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/router.v
47,7 → 47,9
parameter FLIT_WIDTH = PYLD_WIDTH+ FLIT_TYPE_WIDTH+VC_ID_WIDTH,
parameter FLIT_ARRAY_WIDTH = FLIT_WIDTH * PORT_NUM,
parameter CREDIT_ARRAY_WIDTH = VC_NUM_PER_PORT * PORT_NUM,
parameter VC_FULL_WIDTH = VC_NUM_PER_PORT * 2
parameter VC_FULL_WIDTH = VC_NUM_PER_PORT * 2,
parameter CONGESTION_WIDTH = 8
 
)
(
57,6 → 59,8
output[PORT_NUM-1 : 0] wr_out_en_array,
output[FLIT_ARRAY_WIDTH-1 : 0] flit_out_array,
input [CREDIT_ARRAY_WIDTH-1 : 0] credit_in_array,
output[CONGESTION_WIDTH-1 : 0] congestion_cmp_o,
input [CONGESTION_WIDTH-1 : 0] congestion_cmp_i,
input clk,
input reset
);
95,6 → 99,7
wire [PORT_NUM-1 :0] sw_any_vc_granted;
wire [X_NODE_NUM_WIDTH-1 :0] sw_dest_x_addr [PORT_NUM-1 : 0];
wire [Y_NODE_NUM_WIDTH-1 :0] sw_dest_y_addr [PORT_NUM-1 : 0];
wire [PORT_NUM_BCD_WIDTH-1 :0] sw_in_port_num [PORT_NUM-1 : 0];
wire [FLIT_WIDTH-1 :0] sw_flit_in [PORT_NUM-1 : 0];
wire [VC_NUM_PER_PORT-1 :0] sw_credit_out [PORT_NUM-1 : 0];
wire [FLIT_WIDTH-1 :0] sw_flit_out [PORT_NUM-1 : 0];
119,10 → 124,12
wire [STATUS_WIDTH_PER_SW-1 :0] sw_assigned_ovcs_status [PORT_NUM-1 : 0];
wire [PORT_SEL_WIDTH-1 :0] sw_granted_port [PORT_NUM-1 : 0];
wire [PORT_SEL_WIDTH-1 :0] sw_ovc_alloc_in_port [PORT_NUM-1 : 0];
 
wire [X_NODE_NUM_WIDTH-1 :0] lk_dest_x_addr [PORT_NUM-1 : 0];
wire [Y_NODE_NUM_WIDTH-1 :0] lk_dest_y_addr [PORT_NUM-1 : 0];
wire [PORT_NUM_BCD_WIDTH-1 :0] lk_port_sel_out [PORT_NUM-1 : 0];
wire [CONGESTION_WIDTH-1 :0] lk_congestion_cmp [PORT_NUM-1 : 0];
wire [PORT_NUM_BCD_WIDTH-1 :0] lk_in_port_num [PORT_NUM-1 : 0];
wire [FLIT_WIDTH-1 :0] ou_flit_in [PORT_NUM-1 : 0];
wire [FLIT_WIDTH-1 :0] ou_flit_out [PORT_NUM-1 : 0];
149,6 → 156,7
wire [OVC_WR_ARRAY_WIDTH-1 :0] st_ovc_write_array;
wire [OVC_ALLOC_ARRAY_WIDTH-1 :0] st_vc_alloc_array;
wire [PORT_SEL_ARRAY_WIDTH-1 :0] st_ovc_alloc_in_port_array;
wire [3 :0] st_congestion_cmp;
wire [LOOK_AHEAD_ARRAY_WIDTH-1 :0] cr_look_ahead_port_sel_array;
wire [PORT_SEL_ARRAY_WIDTH-1 :0] cr_port_sel_array;
199,6 → 207,7
.candidate_bcd_ovc_array (st_candidate_bcd_ovc_array),
.ovc_available_array (st_ovc_available_array),
.ovc_alloc_in_port_array (st_ovc_alloc_in_port_array),
.congestion_cmp (st_congestion_cmp),
.clk (clk),
.reset (reset)
);
242,6 → 251,8
assign lk_dest_x_addr[i] = sw_dest_x_addr[i];
assign lk_dest_y_addr[i] = sw_dest_y_addr[i];
assign lk_congestion_cmp[i] = congestion_cmp_i;
assign lk_in_port_num[i] = sw_in_port_num[i];
assign ou_flit_in[i] = cr_flit_out_array [(i+1)*FLIT_WIDTH-1 : i*FLIT_WIDTH];
assign credit_out_array [(i+1)*VC_NUM_PER_PORT-1 : i*VC_NUM_PER_PORT ] = sw_credit_out [i];
314,6 → 325,7
//interface to look over head routing module
.dest_x_addr (sw_dest_x_addr[i]),
.dest_y_addr (sw_dest_y_addr[i]),
.in_port_num (sw_in_port_num[i]),
.look_ahead_port_sel_in (sw_look_ahead_port_sel_in[i]),
//global
336,8 → 348,10
)
the_look_ahead_routing
(
.congestion_cmp_i (lk_congestion_cmp[i]),
.dest_x_node_in (lk_dest_x_addr[i]),
.dest_y_node_in (lk_dest_y_addr[i]),
.in_port_num_i (lk_in_port_num[i]),
.port_num_out (lk_port_sel_out[i]),
.clk (clk),
.reset (reset)
370,10 → 384,22
.bcd_code (sw_ovc_bcd[i]),
.one_hot_code (sw_ovc[i])
);
 
localparam W_VS_S = 3;
localparam W_VS_N = 2;
localparam E_VS_N = 1;
localparam E_VS_S = 0;
assign congestion_cmp_o = {st_congestion_cmp[W_VS_N],st_congestion_cmp[E_VS_N], //to the S
st_congestion_cmp[E_VS_N],st_congestion_cmp[E_VS_S], //to the W
st_congestion_cmp[W_VS_S],st_congestion_cmp[E_VS_S], //to the N
st_congestion_cmp[W_VS_N],st_congestion_cmp[W_VS_S] //to the E
};
for(j=0;j<PORT_NUM;j=j+1)begin : port_loop2
if(i>j)begin
// assign sw_candidate_ovcs [i][(j+1)*VC_NUM_PER_PORT-1 : j*VC_NUM_PER_PORT] = st_candidate_ovc_array [(j+1)*VC_NUM_PER_PORT-1 : j*VC_NUM_PER_PORT ];
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/switch_in.v
96,6 → 96,7
//interface to look over head routing module
output [X_NODE_NUM_WIDTH-1 :0] dest_x_addr,
output [Y_NODE_NUM_WIDTH-1 :0] dest_y_addr,
output [PORT_NUM_BCD_WIDTH-1 :0] in_port_num,
input [PORT_NUM_BCD_WIDTH-1 :0] look_ahead_port_sel_in,
//global
151,7 → 152,7
wire [CANDIDATE_OVCS_WIDTH-1 :0] candidate_ovc_released,candidate_ovc_alloc_granted;
wire [ALL_LK_PORT_NUM_WIDTH-1 :0] look_ahead_mux_in;
//wire [CANDIDATE_OVCS_WIDTH-1 :0] vc_alloc_req_array;
wire [PORT_NUM_BCD_WIDTH-1 :0] in_port_num;
//wire [OVCS_WIDTH-1 :0] all_ovcs;
wire [OVCS_BCD_WIDTH-1 :0] all_ovcs_bcd;
wire [VC_NUM_PER_PORT-1 :0] tail_fifo_wr;
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/ext_ram_nic.v
38,6 → 38,7
parameter NIC_CONNECT_PORT = 0, // 0:Local 1:East, 2:North, 3:West, 4:South
parameter RAM_ADDR_WIDTH = 25,
parameter CAND_VC_SEL_MODE = 0, // 0: use arbieration between not full vcs, 1: select the vc with the most availble free space
parameter CONGESTION_WIDTH = 8,
parameter VC_ID_WIDTH = VC_NUM_PER_PORT,
parameter FLIT_WIDTH = PYLD_WIDTH+FLIT_TYPE_WIDTH+VC_ID_WIDTH,
parameter CORE_NUMBER = `CORE_NUM(SW_X_ADDR,SW_Y_ADDR)
51,7 → 52,7
output [FLIT_WIDTH-1 :0] flit_out,
output flit_out_wr,
input [VC_NUM_PER_PORT-1 :0] credit_in,
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [FLIT_WIDTH-1 :0] flit_in,
input flit_in_wr,
output [VC_NUM_PER_PORT-1 :0] credit_out,
214,7 → 215,6
 
 
route_compute #(
.ROUTE_TYPE ("NORMAL"),
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
225,8 → 225,10
)
the_normal_routting
(
.congestion_cmp_i (congestion_cmp_i),
.dest_x_node_in (dest_x_addr),
.dest_y_node_in (dest_y_addr),
.in_port_num_i ({PORT_NUM_BCD_WIDTH{1'b0}}), //conventional routing
.port_num_out (port_num_next)
);
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/ovc_status.v
1,5 → 1,5
/**********************************************************************
File: sw_alloc_first_arbiter.v
File: ovc_status.v
Copyright (C) 2013 Alireza Monemi
 
64,6 → 64,7
output [CANDIDATE_OVCS_BCD_WIDTH-1: 0] candidate_bcd_ovc_array,
output reg [PORT_NUM-1 : 0] ovc_available_array,
input [PORT_SEL_ARRAY_WIDTH-1 : 0] ovc_alloc_in_port_array,
output [3 : 0] congestion_cmp,
input clk,
input reset
);
72,6 → 73,16
//check if assigned ovc is full or not
localparam MUX_IN_WIDTH = VC_NUM_PER_PORT *PORT_SEL_WIDTH;
localparam ACCUM_WIDTH = log2(VC_NUM_PER_PORT+1);
localparam W_VS_S = 3;
localparam W_VS_N = 2;
localparam E_VS_N = 1;
localparam E_VS_S = 0;
wire [PORT_SEL_BCD_WIDTH-1 : 0] port_sel_bcd [TOTAL_VC_NUM-1 :0];
//wire [VC_NUM_PER_PORT-1 : 0] vc_sel [TOTAL_VC_NUM-1 :0];
wire [VC_NUM_BCD_WIDTH-1 : 0] vc_sel_bcd [TOTAL_VC_NUM-1 :0];
302,6 → 313,8
assign port_has_no_avb_vc[i] = number_of_avb_vc[i] == 0;
assign port_has_one_avb_vc[i] = number_of_avb_vc[i] == 1;
always @(*)begin
available_vcs_per_port[i] =1'b1;
if(port_has_no_avb_vc[i]) available_vcs_per_port[i]= 1'b0;
310,11 → 323,17
end
endgenerate
assign congestion_cmp[W_VS_S] = number_of_avb_vc[`WEST_PORT] >= number_of_avb_vc[`SOUTH_PORT];
assign congestion_cmp[W_VS_N] = number_of_avb_vc[`WEST_PORT] >= number_of_avb_vc[`NORTH_PORT];
assign congestion_cmp[E_VS_N] = number_of_avb_vc[`EAST_PORT] >= number_of_avb_vc[`NORTH_PORT];
assign congestion_cmp[E_VS_S] = number_of_avb_vc[`EAST_PORT] >= number_of_avb_vc[`SOUTH_PORT];
wide_or #(
.IN_ARRAY_WIDTH (OVC_RLS_ARRAY_WIDTH),
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/route_compute.v
1,14 → 1,56
/**********************************************************************
File: route_compute.v
Copyright (C) 2013 Alireza Monemi
 
This program is free software: you can redistribute it and/or modify
it under the terms of the GNU General Public License as published by
the Free Software Foundation, either version 3 of the License, or
(at your option) any later version.
 
This program is distributed in the hope that it will be useful,
but WITHOUT ANY WARRANTY; without even the implied warranty of
MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
GNU General Public License for more details.
 
You should have received a copy of the GNU General Public License
along with this program. If not, see <http://www.gnu.org/licenses/>.
Purpose:
 
The conventional and look ahead NoC routing computation modules
based on mesh and torus topology. support 3 algorithm:
XY_CLASSIC: The classic xy routing. The packet first forwarded to the
x dimension until reach to the same destination column then
forwarded to the y direction to reach the destination.
BALANCE_DOR: The packet always move to the dimension with higher
differences value.
SUDO_XY : its an adaptive version of classic xy. First one dimension in x
and another in y with less number of nodes is selected then the
packet is forwarded to the dimension with less congestion.
Info: monemi@fkegraduate.utm.my
*********************************************************************/
 
`timescale 1ns/1ps
`include "../define.v"
 
module look_ahead_routing_sync #(
parameter TOPOLOGY = "TORUS", // "MESH" or "TORUS"
parameter ROUTE_ALGRMT = "XY", //"XY" or "MINIMAL"
parameter ROUTE_ALGRMT = "XY_CLASSIC", //"XY_CLASSIC" or "BALANCE_DOR" or "SUDO_XY"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 3,
parameter SW_X_ADDR = 2,
parameter SW_Y_ADDR = 1,
parameter CONGESTION_WIDTH = 8,
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM)
18,6 → 60,8
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
input [Y_NODE_NUM_WIDTH-1 :0] dest_y_node_in,
output[PORT_NUM_BCD_WIDTH-1 :0] port_num_out,// one extra bit will be removed by switch_in latter
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [PORT_NUM_BCD_WIDTH-1 :0] in_port_num_i,
input clk,
input reset
 
26,12 → 70,12
reg [X_NODE_NUM_WIDTH-1 :0] dest_x_node;
reg [Y_NODE_NUM_WIDTH-1 :0] dest_y_node;
reg [PORT_NUM_BCD_WIDTH-1 :0] in_port_num_registerted;
// routing algorithm
route_compute #(
.ROUTE_TYPE ("LOOK_AHEAD"),
.TOPOLOGY (TOPOLOGY),
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
42,8 → 86,10
)
routing
(
.congestion_cmp_i (congestion_cmp_i),
.dest_x_node_in (dest_x_node),
.dest_y_node_in (dest_y_node),
.in_port_num_i (in_port_num_registerted),
.port_num_out (port_num_out)
);
54,104 → 100,37
if(reset)begin
dest_x_node <= {X_NODE_NUM_WIDTH{1'b0}};
dest_y_node <= {Y_NODE_NUM_WIDTH{1'b0}};
in_port_num_registerted <= {PORT_NUM_BCD_WIDTH{1'b0}};
end else begin
dest_x_node <= dest_x_node_in;
dest_y_node <= dest_y_node_in;
in_port_num_registerted <= in_port_num_i;
end//else reset
end//always
endmodule
 
/******************************************************
 
route_compute
 
******************************************************/
 
 
 
module route_compute #(
parameter ROUTE_TYPE = "NORMAL", // "NORMAL" or "LOOK_AHEAD"
parameter TOPOLOGY = "TORUS", // "MESH" or "TORUS"
parameter ROUTE_ALGRMT = "MINIMAL",//"XY" or "MINIMAL"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 4,
parameter SW_X_ADDR = 2,
parameter SW_Y_ADDR = 1,
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM)
)
(
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
input [Y_NODE_NUM_WIDTH-1 :0] dest_y_node_in,
output [PORT_NUM_BCD_WIDTH-1 :0] port_num_out// one extra bit will be removed by cross bar switch later
);
`LOG2
// just to get rid of Warning (10230): truncated value with size 32 to match size of target (2)
localparam [X_NODE_NUM_WIDTH-1 : 0] CURRENT_X_ADDR =SW_X_ADDR [X_NODE_NUM_WIDTH-1 : 0];
localparam [Y_NODE_NUM_WIDTH-1 : 0] CURRENT_Y_ADDR =SW_Y_ADDR [Y_NODE_NUM_WIDTH-1 : 0];
generate
if(ROUTE_TYPE == "NORMAL") begin :normal
normal_routing #(
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM),
.SW_X_ADDR (SW_X_ADDR),
.SW_Y_ADDR (SW_Y_ADDR)
) normal_routing
(
.current_router_x_addr (CURRENT_X_ADDR),
.current_router_y_addr (CURRENT_Y_ADDR),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end else if(ROUTE_TYPE == "LOOK_AHEAD") begin :look_ahead
look_ahead_routing #(
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM),
.SW_X_ADDR (SW_X_ADDR),
.SW_Y_ADDR (SW_Y_ADDR)
) normal_routing
(
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end
endgenerate
 
endmodule
 
 
 
 
/***************************************************
normal routing
***************************************************/
module normal_routing #(
module conventional_routing #(
parameter TOPOLOGY = "TORUS", // "MESH" or "TORUS"
parameter ROUTE_ALGRMT = "MINIMAL",//"XY" or "MINIMAL"
parameter ROUTE_ALGRMT = "BALANCE_DOR",//"XY_CLASSIC" or "BALANCE_DOR" or "SUDO_XY"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 4,
parameter SW_X_ADDR = 2,
parameter SW_Y_ADDR = 1,
parameter CONGESTION_WIDTH = 4,
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM)
158,6 → 137,7
)
(
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [X_NODE_NUM_WIDTH-1 :0] current_router_x_addr,
input [Y_NODE_NUM_WIDTH-1 :0] current_router_y_addr,
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
168,7 → 148,7
`LOG2
 
generate
if(ROUTE_ALGRMT == "XY") begin : xy_routing_blk
if(ROUTE_ALGRMT == "XY_CLASSIC") begin : xy_routing_blk
xy_routing #(
.TOPOLOGY (TOPOLOGY),
.PORT_NUM (PORT_NUM),
182,13 → 162,13
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end else if(ROUTE_ALGRMT == "MINIMAL") begin : minimal_routing_blk
minimal_routing #(
end else if(ROUTE_ALGRMT == "BALANCE_DOR") begin : minimal_routing_blk
bdor_routing #(
.TOPOLOGY (TOPOLOGY),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
) minimal
) bdor
(
.current_router_x_addr (current_router_x_addr),
.current_router_y_addr (current_router_y_addr),
196,9 → 176,22
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end else if (ROUTE_ALGRMT == "SUDO_XY") begin : sudo_routing_blk
sudo_xy_routing #(
.TOPOLOGY (TOPOLOGY),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
) sudo_xy
(
.congestion_cmp_i (congestion_cmp_i),
.current_router_x_addr (current_router_x_addr),
.current_router_y_addr (current_router_y_addr),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end
endgenerate
 
207,20 → 200,23
 
 
 
/***************************************************
look-ahead routing
call the normal routing twice in cascade mode
***************************************************/
/******************************************************
 
route_compute
 
module look_ahead_routing #(
******************************************************/
 
 
 
module route_compute #(
parameter TOPOLOGY = "TORUS", // "MESH" or "TORUS"
parameter ROUTE_ALGRMT = "MINIMAL",//"XY" or "MINIMAL"
parameter ROUTE_ALGRMT = "BALANCE_DOR",//"XY_CLASSIC" or "BALANCE_DOR" or "SUDO_XY"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 4,
parameter SW_X_ADDR = 2,
parameter SW_Y_ADDR = 1,
parameter CONGESTION_WIDTH = 8,
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM)
227,13 → 223,15
)
(
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
input [Y_NODE_NUM_WIDTH-1 :0] dest_y_node_in,
input [PORT_NUM_BCD_WIDTH-1 :0] in_port_num_i,// if local thr routing is normal otherwise its look ahead
output [PORT_NUM_BCD_WIDTH-1 :0] port_num_out// one extra bit will be removed by cross bar switch later
);
 
`LOG2
wire [PORT_NUM_BCD_WIDTH-1 :0] port_num_out_first;
reg [X_NODE_NUM_WIDTH-1 :0] next_router_x_addr;
reg [Y_NODE_NUM_WIDTH-1 :0] next_router_y_addr;
243,72 → 241,88
localparam WEST = 3'd3;
localparam SOUTH = 3'd4;
localparam DST_CONGESTION_WIDTH = 4;
reg [DST_CONGESTION_WIDTH-1 : 0] dst_congestion;
// just to get rid of Warning (10230): Verilog HDL assignment warning at look_ahead.v(71): truncated value with size 32 to match size of target (2)
localparam [X_NODE_NUM_WIDTH-1 : 0] CURRENT_X_ADDR =SW_X_ADDR [X_NODE_NUM_WIDTH-1 : 0];
localparam [Y_NODE_NUM_WIDTH-1 : 0] CURRENT_Y_ADDR =SW_Y_ADDR [Y_NODE_NUM_WIDTH-1 : 0];
localparam [X_NODE_NUM_WIDTH-1 : 0] LAST_X_ADDR =X_NODE_NUM[X_NODE_NUM_WIDTH-1 : 0]-1'b1;
localparam [Y_NODE_NUM_WIDTH-1 : 0] LAST_Y_ADDR =Y_NODE_NUM[Y_NODE_NUM_WIDTH-1 : 0]-1'b1;
localparam W_VS_S = 3;
localparam W_VS_N = 2;
localparam E_VS_N = 1;
localparam E_VS_S = 0;
localparam EAST_PORT_W_VS_S = 0;
localparam EAST_PORT_W_VS_N = 1;
localparam NORTH_PORT_E_VS_S = 2;
localparam NORTH_PORT_W_VS_S = 3;
localparam WEST_PORT_E_VS_S = 4;
localparam WEST_PORT_E_VS_N = 5;
localparam SOUTH_PORT_E_VS_N = 6;
localparam SOUTH_PORT_W_VS_N = 7;
normal_routing #(
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)first_level
(
.current_router_x_addr (CURRENT_X_ADDR),
.current_router_y_addr (CURRENT_Y_ADDR),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out_first)// one extra bit will be removed by switch_in latter
);
normal_routing #(
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)second_level
(
.current_router_x_addr (next_router_x_addr),
.current_router_y_addr (next_router_y_addr),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
//get next router address
always @(*) begin
case(port_num_out_first)
case(in_port_num_i)
LOCAL :begin
next_router_x_addr= CURRENT_X_ADDR;
next_router_y_addr= CURRENT_Y_ADDR;
dst_congestion = {congestion_cmp_i[EAST_PORT_W_VS_S],congestion_cmp_i[EAST_PORT_W_VS_N ],congestion_cmp_i[WEST_PORT_E_VS_N ],congestion_cmp_i[NORTH_PORT_E_VS_S]};
end
EAST: begin
next_router_x_addr= (SW_X_ADDR==LAST_X_ADDR ) ? {X_NODE_NUM_WIDTH{1'b0}} : CURRENT_X_ADDR+1'b1;
next_router_y_addr= CURRENT_Y_ADDR;
dst_congestion = {congestion_cmp_i[EAST_PORT_W_VS_S],congestion_cmp_i[EAST_PORT_W_VS_N],2'b00};
end
NORTH: begin
next_router_x_addr= CURRENT_X_ADDR;
next_router_y_addr= (SW_Y_ADDR==0)? LAST_Y_ADDR : CURRENT_Y_ADDR-1'b1;
dst_congestion = {congestion_cmp_i[NORTH_PORT_W_VS_S],2'b00,congestion_cmp_i[NORTH_PORT_E_VS_S]};
end
WEST: begin
next_router_x_addr= (SW_X_ADDR==0) ? LAST_X_ADDR : CURRENT_X_ADDR-1'b1;
next_router_y_addr= CURRENT_Y_ADDR;
dst_congestion = {2'b00,congestion_cmp_i[WEST_PORT_E_VS_N],congestion_cmp_i[WEST_PORT_E_VS_S]};
end
SOUTH: begin
next_router_x_addr= CURRENT_X_ADDR;
next_router_y_addr= (SW_Y_ADDR== LAST_Y_ADDR ) ? {Y_NODE_NUM_WIDTH{1'b0}}: CURRENT_Y_ADDR+1'b1;
dst_congestion = {1'b0,congestion_cmp_i[SOUTH_PORT_W_VS_N],congestion_cmp_i[SOUTH_PORT_E_VS_N],1'b0};
end
default begin
next_router_x_addr= {X_NODE_NUM_WIDTH{1'bX}};
next_router_y_addr= {Y_NODE_NUM_WIDTH{1'bX}};
dst_congestion = {congestion_cmp_i[EAST_PORT_W_VS_S],congestion_cmp_i[EAST_PORT_W_VS_N ],congestion_cmp_i[WEST_PORT_E_VS_N ],congestion_cmp_i[NORTH_PORT_E_VS_S]};
end
endcase
end//always
conventional_routing #(
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)conventional_routing
(
.congestion_cmp_i (dst_congestion),
.current_router_x_addr (next_router_x_addr),
.current_router_y_addr (next_router_y_addr),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
endmodule
 
 
521,12 → 535,13
/*****************************************************
 
minimal_mesh_routing
bdor_mesh_routing
balanced dimension-order routing
 
*****************************************************/
 
 
module minimal_mesh_routing #(
module bdor_mesh_routing #(
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 3,
588,12 → 603,12
 
/*************************************************
 
minimal _torus_routing
 
bdor _torus_routing
balanced dimension-order routing
************************************************/
 
 
module minimal_torus_routing #(
module bdor_torus_routing #(
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 3,
666,12 → 681,13
/*************************************************
 
minimal_routing
bdor_routing
balanced dimension-order routing
 
************************************************/
 
 
module minimal_routing #(
module bdor_routing #(
parameter TOPOLOGY = "MESH",//"TORUS"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
692,11 → 708,11
`LOG2
generate
if(TOPOLOGY == "MESH") begin
minimal_mesh_routing #(
bdor_mesh_routing #(
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)second_level
)bdor_mesh
(
.current_router_x_addr (current_router_x_addr),
.current_router_y_addr (current_router_y_addr),
706,11 → 722,11
);
end else if(TOPOLOGY == "TORUS") begin
minimal_torus_routing #(
bdor_torus_routing #(
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)second_level
)bdor
(
.current_router_x_addr (current_router_x_addr),
.current_router_y_addr (current_router_y_addr),
725,5 → 741,264
endgenerate
endmodule
/********************************
sudo_xy
********************************/
module sudo_xy_routing #(
parameter TOPOLOGY = "MESH",//"TORUS"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 3,
parameter CONGESTION_WIDTH = 4,
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM),
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter PORT_SEL_WIDTH = PORT_NUM-1//assum that no port whants to send a packet to itself!
)
(
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [X_NODE_NUM_WIDTH-1 :0] current_router_x_addr,
input [Y_NODE_NUM_WIDTH-1 :0] current_router_y_addr,
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
input [Y_NODE_NUM_WIDTH-1 :0] dest_y_node_in,
output [PORT_NUM_BCD_WIDTH-1 :0] port_num_out// one extra bit will be removed by switch_in latter
);
`LOG2
generate
if(TOPOLOGY == "MESH") begin
sudo_xy_mesh_routing #(
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)sudo_xy_mesh
(
.congestion_cmp_i (congestion_cmp_i),
.current_router_x_addr (current_router_x_addr),
.current_router_y_addr (current_router_y_addr),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end else if(TOPOLOGY == "TORUS") begin
sudo_xy_torus_routing #(
.PORT_NUM (PORT_NUM),
.X_NODE_NUM (X_NODE_NUM),
.Y_NODE_NUM (Y_NODE_NUM)
)sudo_xy_mesh
(
.congestion_cmp_i (congestion_cmp_i),
.current_router_x_addr (current_router_x_addr),
.current_router_y_addr (current_router_y_addr),
.dest_x_node_in (dest_x_node_in),
.dest_y_node_in (dest_y_node_in),
.port_num_out (port_num_out)// one extra bit will be removed by switch_in latter
);
end
endgenerate
endmodule
/********************************
sudo_xy_mesh_routing
********************************/
module sudo_xy_mesh_routing #(
parameter TOPOLOGY = "TORUS", // "MESH" or "TORUS"
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 4,
parameter SW_X_ADDR = 2,
parameter SW_Y_ADDR = 1,
parameter CONGESTION_WIDTH = 4,
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM)
)
(
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [X_NODE_NUM_WIDTH-1 :0] current_router_x_addr,
input [Y_NODE_NUM_WIDTH-1 :0] current_router_y_addr,
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
input [Y_NODE_NUM_WIDTH-1 :0] dest_y_node_in,
output [PORT_NUM_BCD_WIDTH-1 :0] port_num_out// one extra bit will be removed by cross bar switch later
);
 
`LOG2
localparam LOCAL = 3'd0;
localparam EAST = 3'd1;
localparam NORTH = 3'd2;
localparam WEST = 3'd3;
localparam SOUTH = 3'd4;
localparam W_VS_S = 3;
localparam W_VS_N = 2;
localparam E_VS_N = 1;
localparam E_VS_S = 0;
reg [PORT_NUM_BCD_WIDTH-1 :0] port_num_next;
wire signed [X_NODE_NUM_WIDTH :0] xc;//current
wire signed [X_NODE_NUM_WIDTH :0] xd;//destination
wire signed [Y_NODE_NUM_WIDTH :0] yc;//current
wire signed [Y_NODE_NUM_WIDTH :0] yd;//destination
wire signed [X_NODE_NUM_WIDTH :0] xdiff;
wire signed [Y_NODE_NUM_WIDTH :0] ydiff;
assign xc ={1'b0, current_router_x_addr [X_NODE_NUM_WIDTH-1 :0]};
assign yc ={1'b0, current_router_y_addr [Y_NODE_NUM_WIDTH-1 :0]};
assign xd ={1'b0, dest_x_node_in};
assign yd ={1'b0, dest_y_node_in};
assign xdiff = xd-xc;
assign ydiff = yd-yc;
assign port_num_out= port_num_next;
always@(*) begin
port_num_next = LOCAL;
if (xdiff > 0) begin
if(ydiff > 0) begin // E_S
if( congestion_cmp_i[E_VS_S]) port_num_next = EAST;
else port_num_next = SOUTH;
end
else if(ydiff < 0) begin // E_N
if( congestion_cmp_i[E_VS_N]) port_num_next = EAST;
else port_num_next = NORTH;
end
else port_num_next = EAST; //ydiff ==0
end
else if (xdiff < 0) begin
if( ydiff > 0) begin // W_S
if( congestion_cmp_i [W_VS_S]) port_num_next = WEST;
else port_num_next = SOUTH;
end
else if(ydiff < 0) begin // W_N
if( congestion_cmp_i[W_VS_N]) port_num_next = WEST;
else port_num_next = NORTH;
end
else port_num_next = WEST; //ydiff ==0
end
else begin //xdiff==0
if (ydiff <0) port_num_next = SOUTH;
else if(ydiff >0) port_num_next = NORTH;
else port_num_next = LOCAL;
end
end
endmodule
 
/**********************************
sudo_xy_torus_routing
***********************************/
module sudo_xy_torus_routing #(
parameter PORT_NUM = 5,
parameter X_NODE_NUM = 4,
parameter Y_NODE_NUM = 3,
parameter CONGESTION_WIDTH = 4,
parameter X_NODE_NUM_WIDTH = log2(X_NODE_NUM),
parameter Y_NODE_NUM_WIDTH = log2(Y_NODE_NUM),
parameter PORT_NUM_BCD_WIDTH = log2(PORT_NUM),
parameter PORT_SEL_WIDTH = PORT_NUM-1//assum that no port whants to send a packet to itself!
)
(
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [X_NODE_NUM_WIDTH-1 :0] current_router_x_addr,
input [Y_NODE_NUM_WIDTH-1 :0] current_router_y_addr,
input [X_NODE_NUM_WIDTH-1 :0] dest_x_node_in,
input [Y_NODE_NUM_WIDTH-1 :0] dest_y_node_in,
output [PORT_NUM_BCD_WIDTH-1 :0] port_num_out// one extra bit will be removed by switch_in latter
);
`LOG2
localparam LOCAL = 3'd0;
localparam EAST = 3'd1;
localparam NORTH = 3'd2;
localparam WEST = 3'd3;
localparam SOUTH = 3'd4;
localparam W_VS_S = 3;
localparam W_VS_N = 2;
localparam E_VS_N = 1;
localparam E_VS_S = 0;
reg [PORT_NUM_BCD_WIDTH-1 :0] port_num_next,E_W_sel,N_S_sel;
wire [X_NODE_NUM_WIDTH-1 :0] x_addr_low,x_addr_high,x_addr_diff_f,x_addr_diff_b;
wire x_des_bigger;
wire [Y_NODE_NUM_WIDTH-1 :0] y_addr_low,y_addr_high,y_addr_diff_f,y_addr_diff_b;
wire y_des_bigger;
assign x_des_bigger =(dest_x_node_in > current_router_x_addr);
assign x_addr_low =(x_des_bigger)? current_router_x_addr : dest_x_node_in;
assign x_addr_high =(x_des_bigger)? dest_x_node_in : current_router_x_addr;
assign x_addr_diff_f = x_addr_high - x_addr_low;
assign x_addr_diff_b = x_addr_low + X_NODE_NUM[X_NODE_NUM_WIDTH-1 :0] - x_addr_high;
assign y_des_bigger =(dest_y_node_in > current_router_y_addr);
assign y_addr_low =(y_des_bigger)? current_router_y_addr : dest_y_node_in ;
assign y_addr_high =(y_des_bigger)? dest_y_node_in : current_router_y_addr;
assign y_addr_diff_f = y_addr_high - y_addr_low;
assign y_addr_diff_b = y_addr_low + Y_NODE_NUM[Y_NODE_NUM_WIDTH-1 :0] - y_addr_high;
assign port_num_out= port_num_next;
always@(*)begin
E_W_sel = LOCAL;
N_S_sel = LOCAL;
if (x_addr_diff_f > 0 ) begin
if (x_addr_diff_f <= x_addr_diff_b ) E_W_sel = (x_des_bigger)? EAST: WEST;
else E_W_sel = (x_des_bigger)? WEST: EAST;
end
if (y_addr_diff_f > 0 ) begin
if (y_addr_diff_f <= y_addr_diff_b ) N_S_sel = (y_des_bigger)? SOUTH: NORTH;
else N_S_sel = (y_des_bigger)? NORTH: SOUTH;
end
end
always@(*)begin
port_num_next = LOCAL;
if (E_W_sel == EAST && N_S_sel == SOUTH) port_num_next =(congestion_cmp_i[E_VS_S])? EAST : SOUTH;
else if(E_W_sel == EAST && N_S_sel == NORTH) port_num_next =(congestion_cmp_i[E_VS_N])? EAST : NORTH;
else if(E_W_sel == WEST && N_S_sel == SOUTH) port_num_next =(congestion_cmp_i[W_VS_S])? WEST : SOUTH;
else if(E_W_sel == WEST && N_S_sel == NORTH) port_num_next =(congestion_cmp_i[W_VS_N])? WEST : NORTH;
else if(E_W_sel == LOCAL) port_num_next = N_S_sel;
else if(N_S_sel == LOCAL) port_num_next = E_W_sel;
end
endmodule
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/NoC/ni.v
56,8 → 56,8
parameter VC_ID_WIDTH = VC_NUM_PER_PORT,
parameter FLIT_WIDTH = PYLD_WIDTH+FLIT_TYPE_WIDTH+VC_ID_WIDTH,
parameter CAND_VC_SEL_MODE = 0, // 0: use arbieration between not full vcs, 1: select the vc with moast availble free space
parameter CONGESTION_WIDTH = 8,
//wishbone port parameters
parameter RAM_WIDTH_IN_WORD = 13,
parameter W_DATA_WIDTH = 32,
66,6 → 66,7
parameter W_CTI_WIDTH = 3,
parameter SEL_WIDTH = 4
)
(
81,8 → 82,8
input [FLIT_WIDTH-1 :0] flit_in,
input flit_in_wr,
output reg [VC_NUM_PER_PORT-1 :0] credit_out,
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
 
 
//wishbone slave interface signals
input [W_DATA_WIDTH-1 : 0] s_dat_i,
input [WS_ADDR_WIDTH-1 : 0] s_addr_i,
592,7 → 593,6
 
 
route_compute #(
.ROUTE_TYPE ("NORMAL"),
.TOPOLOGY (TOPOLOGY),
.ROUTE_ALGRMT (ROUTE_ALGRMT),
.PORT_NUM (PORT_NUM),
603,8 → 603,10
)
the_normal_routting
(
.congestion_cmp_i (congestion_cmp_i),
.dest_x_node_in (dest_x_addr),
.dest_y_node_in (dest_y_addr),
.in_port_num_i ({PORT_NUM_BCD_WIDTH{1'b0}}), //conventional routing
.port_num_out (port_num)
);
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/IP_core/aeMB_IP.v
95,6 → 95,7
parameter FLIT_TYPE_WIDTH = 2,
parameter VC_ID_WIDTH = VC_NUM_PER_PORT,
parameter FLIT_WIDTH = PYLD_WIDTH+FLIT_TYPE_WIDTH+VC_ID_WIDTH,
parameter CONGESTION_WIDTH = 8,
//aeMB parameters
parameter AEMB_IWB = 32, ///< INST bus width
122,6 → 123,7
output [FLIT_WIDTH-1 :0] flit_out,
output flit_out_wr,
input [VC_NUM_PER_PORT-1 :0] credit_in,
input [CONGESTION_WIDTH-1 :0] congestion_cmp_i,
input [FLIT_WIDTH-1 :0] flit_in, // Data in
input flit_in_wr, // Write enable
434,6 → 436,7
.flit_out (flit_out) ,
.flit_out_wr (flit_out_wr) ,
.credit_in (credit_in) ,
.congestion_cmp_i (congestion_cmp_i),
.flit_in (flit_in) ,
.flit_in_wr (flit_in_wr) ,
.credit_out (credit_out) ,
518,6 → 521,8
assign timer_irq = 1'b0;
end
assign int_ctrl_in = {ext_int_irq,timer_irq,ni_irq};
if(INT_CTRL_EN) begin : int_ctrl_gen
int_ctrl #(
.NOC_EN (NOC_EN),
542,7 → 547,7
.int_i (int_ctrl_in),
.int_o (sys_int_i)
);
assign int_ctrl_in = {ext_int_irq,timer_irq,ni_irq};
end //INT_CTRL_EN
else begin
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/IP_core/int_ctrl.v
41,8 → 41,8
wire [INT_NUM-1:0] sa_dat_i_masked, int_i_masked;
assign sa_dat_i_masked = sa_dat_i & DATA_BUS_MASK;
assign int_i_masked = int_i & DATA_BUS_MASK;
assign sa_dat_i_masked = sa_dat_i & DATA_BUS_MASK [INT_NUM-1:0];
assign int_i_masked = int_i & DATA_BUS_MASK [INT_NUM-1:0];
always@(*) begin
mer_next = mer;
ier_next = ier;
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/IP_core/aeMB_mpsoc.v
190,6 → 190,7
`define ADD_FUNCTION 1
`include "../my_functions.v"
 
localparam CONGESTION_WIDTH = 8;
 
wire [TOTAL_O_WIDTH-1 : 0] gpio_o_array [TOTAL_ROUTERS_NUM-1 :0];
199,6 → 200,8
wire [PORT_NUM-1 : 0] router_wr_out_en_array [TOTAL_ROUTERS_NUM-1 :0];
wire [FLIT_ARRAY_WIDTH-1 : 0] router_flit_out_array [TOTAL_ROUTERS_NUM-1 :0];
wire [CREDIT_ARRAY_WIDTH-1 : 0] router_credit_in_array [TOTAL_ROUTERS_NUM-1 :0];
wire [CONGESTION_WIDTH+1 : 2] router_congestion_cmp_i [TOTAL_ROUTERS_NUM-1 :0];
wire [CONGESTION_WIDTH+1 : 2] router_congestion_cmp_o [TOTAL_ROUTERS_NUM-1 :0];
 
 
wire [FLIT_WIDTH-1 : 0] ni_flit_out [TOTAL_ROUTERS_NUM-1 :0];
206,7 → 209,8
wire [VC_NUM_PER_PORT-1 : 0] ni_credit_in [TOTAL_ROUTERS_NUM-1 :0];
wire [FLIT_WIDTH-1 : 0] ni_flit_in [TOTAL_ROUTERS_NUM-1 :0];
wire [TOTAL_ROUTERS_NUM-1 : 0] ni_flit_in_wr;
wire [VC_NUM_PER_PORT-1 : 0] ni_credit_out [TOTAL_ROUTERS_NUM-1 :0];
wire [VC_NUM_PER_PORT-1 : 0] ni_credit_out [TOTAL_ROUTERS_NUM-1 :0];
wire [CONGESTION_WIDTH-1 : 0] ni_congestion_cmp_i [TOTAL_ROUTERS_NUM-1 :0];
 
 
//synthesis translate_off
278,6 → 282,7
.flit_out (ni_flit_out [IP_NUM]),
.flit_out_wr (ni_flit_out_wr [IP_NUM]),
.credit_in (ni_credit_in [IP_NUM]),
.congestion_cmp_i (ni_congestion_cmp_i [IP_NUM]),
.flit_in (ni_flit_in [IP_NUM]),
.flit_in_wr (ni_flit_in_wr [IP_NUM]),
354,7 → 359,8
.flit_in (ni_flit_in [IP_NUM]),
.flit_in_wr (ni_flit_in_wr [IP_NUM]),
.credit_out (ni_credit_out [IP_NUM])
.credit_out (ni_credit_out [IP_NUM]),
.congestion_cmp_i (ni_congestion_cmp_i [IP_NUM])
//synthesis translate_off
,
.cpu_dat_i (cpu_dat_i [IP_NUM]),
400,6 → 406,8
.wr_out_en_array (router_wr_out_en_array [IP_NUM]),
.flit_out_array (router_flit_out_array [IP_NUM]),
.credit_in_array (router_credit_in_array [IP_NUM]),
.congestion_cmp_o (router_congestion_cmp_o [IP_NUM]),
.congestion_cmp_i (router_congestion_cmp_i [IP_NUM]),
.clk (clk),
.reset (reset)
);
418,15 → 426,18
assign router_flit_in_array [`SELECT_WIRE(x,y,1,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE((x+1),y,3,FLIT_WIDTH)];
assign router_credit_in_array [`SELECT_WIRE(x,y,1,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE((x+1),y,3,VC_NUM_PER_PORT)];
assign router_wr_in_en_array [IP_NUM][1] = router_wr_out_en_array [`CORE_NUM((x+1),y)][3];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,1,2)] = router_congestion_cmp_o [`SELECT_WIRE((x+1),y,3,2)];
end else begin
if(TOPOLOGY == "MESH") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,1,FLIT_WIDTH)] = {FLIT_WIDTH{1'b0}};
assign router_credit_in_array [`SELECT_WIRE(x,y,1,VC_NUM_PER_PORT)] = {VC_NUM_PER_PORT{1'b0}};
assign router_wr_in_en_array [IP_NUM][1] = 1'b0;
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,1,2)] = 2'b0;
end else if(TOPOLOGY == "TORUS") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,1,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE(0,y,3,FLIT_WIDTH)];
assign router_credit_in_array [`SELECT_WIRE(x,y,1,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE(0,y,3,VC_NUM_PER_PORT)];
assign router_wr_in_en_array [IP_NUM][1] = router_wr_out_en_array [`CORE_NUM(0,y)][3];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,1,2)] = router_congestion_cmp_o [`SELECT_WIRE(0,y,3,2)];
end //topology
end
434,16 → 445,19
if(y>0) begin
assign router_flit_in_array [`SELECT_WIRE(x,y,2,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE(x,(y-1),4,FLIT_WIDTH)];
assign router_credit_in_array [`SELECT_WIRE(x,y,2,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE(x,(y-1),4,VC_NUM_PER_PORT)];
assign router_wr_in_en_array [IP_NUM][2] = router_wr_out_en_array [`CORE_NUM(x,(y-1))][4];
assign router_wr_in_en_array [IP_NUM][2] = router_wr_out_en_array [`CORE_NUM(x,(y-1))][4];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,2,2)] = router_congestion_cmp_o [`SELECT_WIRE(x,(y-1),4,2)];
end else begin
if(TOPOLOGY == "MESH") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,2,FLIT_WIDTH)] = {FLIT_WIDTH{1'b0}};
assign router_credit_in_array [`SELECT_WIRE(x,y,2,VC_NUM_PER_PORT)] = {VC_NUM_PER_PORT{1'b0}};
assign router_wr_in_en_array [IP_NUM][2] = 1'b0;
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,2,2)] = 2'b00;
end else if(TOPOLOGY == "TORUS") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,2,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE(x,(Y_NODE_NUM-1),4,FLIT_WIDTH)];
assign router_credit_in_array [`SELECT_WIRE(x,y,2,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE(x,(Y_NODE_NUM-1),4,VC_NUM_PER_PORT)];
assign router_wr_in_en_array [IP_NUM][2] = router_wr_out_en_array [`CORE_NUM(x,(Y_NODE_NUM-1))][4];
assign router_wr_in_en_array [IP_NUM][2] = router_wr_out_en_array [`CORE_NUM(x,(Y_NODE_NUM-1))][4];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,2,2)] = router_congestion_cmp_o [`SELECT_WIRE(x,(Y_NODE_NUM-1),4,2)];
end//topology
end//y>0
451,16 → 465,19
if(x>0)begin
assign router_flit_in_array [`SELECT_WIRE(x,y,3,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE((x-1),y,1,FLIT_WIDTH)] ;
assign router_credit_in_array [`SELECT_WIRE(x,y,3,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE((x-1),y,1,VC_NUM_PER_PORT)] ;
assign router_wr_in_en_array [IP_NUM][3] = router_wr_out_en_array [`CORE_NUM((x-1),y)][1];
assign router_wr_in_en_array [IP_NUM][3] = router_wr_out_en_array [`CORE_NUM((x-1),y)][1];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,3,2)] = router_congestion_cmp_o [`SELECT_WIRE((x-1),y,1,2)];
end else begin
if(TOPOLOGY == "MESH") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,3,FLIT_WIDTH)] = {FLIT_WIDTH{1'b0}};
assign router_credit_in_array [`SELECT_WIRE(x,y,3,VC_NUM_PER_PORT)] = {VC_NUM_PER_PORT{1'b0}};
assign router_wr_in_en_array [IP_NUM][3] = 1'b0;
assign router_wr_in_en_array [IP_NUM][3] = 1'b0;
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,3,2)] = 2'b00;
end else if(TOPOLOGY == "TORUS") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,3,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE((X_NODE_NUM-1),y,1,FLIT_WIDTH)] ;
assign router_credit_in_array [`SELECT_WIRE(x,y,3,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE((X_NODE_NUM-1),y,1,VC_NUM_PER_PORT)] ;
assign router_wr_in_en_array [IP_NUM][3] = router_wr_out_en_array [`CORE_NUM((X_NODE_NUM-1),y)][1];
assign router_wr_in_en_array [IP_NUM][3] = router_wr_out_en_array [`CORE_NUM((X_NODE_NUM-1),y)][1];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,3,2)] = router_congestion_cmp_o [`SELECT_WIRE((X_NODE_NUM-1),y,1,2)];
end//topology
end
467,17 → 484,19
if(y < Y_NODE_NUM-1)begin
assign router_flit_in_array [`SELECT_WIRE(x,y,4,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE(x,(y+1),2,FLIT_WIDTH)];
assign router_credit_in_array [`SELECT_WIRE(x,y,4,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE(x,(y+1),2,VC_NUM_PER_PORT)];
assign router_wr_in_en_array [IP_NUM][4] = router_wr_out_en_array [`CORE_NUM(x,(y+1))][2];
assign router_wr_in_en_array [IP_NUM][4] = router_wr_out_en_array [`CORE_NUM(x,(y+1))][2];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,4,2)] = router_congestion_cmp_o [`SELECT_WIRE(x,(y+1),2,2)];
end else begin
if(TOPOLOGY == "MESH") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,4,FLIT_WIDTH)] = {FLIT_WIDTH{1'b0}};
assign router_credit_in_array [`SELECT_WIRE(x,y,4,VC_NUM_PER_PORT)] = {VC_NUM_PER_PORT{1'b0}};
assign router_wr_in_en_array [IP_NUM][4] = 1'b0;
assign router_wr_in_en_array [IP_NUM][4] = 1'b0;
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,4,2)] = 2'b00;
end else if(TOPOLOGY == "TORUS") begin
assign router_flit_in_array [`SELECT_WIRE(x,y,4,FLIT_WIDTH)] = router_flit_out_array [`SELECT_WIRE(x,0,2,FLIT_WIDTH)];
assign router_credit_in_array [`SELECT_WIRE(x,y,4,VC_NUM_PER_PORT)] = router_credit_out_array [`SELECT_WIRE(x,0,2,VC_NUM_PER_PORT)];
assign router_wr_in_en_array [IP_NUM][4] = router_wr_out_en_array [`CORE_NUM(x,0)][2];
assign router_wr_in_en_array [IP_NUM][4] = router_wr_out_en_array [`CORE_NUM(x,0)][2];
assign router_congestion_cmp_i [`SELECT_WIRE(x,y,4,2)] = router_congestion_cmp_o [`SELECT_WIRE(x,0,2,2)];
end//topology
end
490,7 → 509,7
assign ni_flit_in [IP_NUM] = router_flit_out_array [`SELECT_WIRE(x,y,0,FLIT_WIDTH)];
assign ni_flit_in_wr [IP_NUM] = router_wr_out_en_array [IP_NUM][0];
assign ni_credit_in [IP_NUM] = router_credit_out_array [`SELECT_WIRE(x,y,0,VC_NUM_PER_PORT)];
assign ni_congestion_cmp_i [IP_NUM] = router_congestion_cmp_o [IP_NUM]; //local congestion
 
 
498,7 → 517,7
assign cpu_adr_i [IP_NUM] = cpu_adr_i_array [(IP_NUM+1)*(CPU_ADR_WIDTH)-1 : IP_NUM*CPU_ADR_WIDTH];
assign cpu_dat_i [IP_NUM] = cpu_dat_i_array [(IP_NUM+1)*32-1 : IP_NUM*32 ];
assign cpu_sel_i [IP_NUM] = cpu_sel_i_array [(IP_NUM+1)*4-1 : IP_NUM*4 ];
assign cpu_sel_i [IP_NUM] = cpu_sel_i_array [(IP_NUM+1)*4-1 : IP_NUM*4 ];
assign cpu_dat_o_array [(IP_NUM+1)*32-1 : IP_NUM*32] = cpu_dat_o [IP_NUM];
//synthesis translate_on
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/MPSoC_top.v
39,7 → 39,7
NI pins are written in tasks.V file */
//noc parameter
parameter TOPOLOGY = `TOPOLOGY_DEF,
parameter ROUTE_ALGRMT = `ROUTE_ALGRMT_DEF, //"XY" or "MINIMAL"
parameter ROUTE_ALGRMT = `ROUTE_ALGRMT_DEF, //"XY_CLASSIC" or "BALANCE_DOR" or "SUDO_XY"
parameter VC_NUM_PER_PORT = `VC_NUM_PER_PORT_DEF ,
parameter PYLD_WIDTH = `PYLD_WIDTH_DEF,
parameter BUFFER_NUM_PER_VC = `BUFFER_NUM_PER_VC_DEF,
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/src/define.v
37,8 → 37,8
********************************************************************/
//define the topology: "MESH" or "TORUS"
`define TOPOLOGY_DEF "MESH"
//define the routing algorithm : "XY" or "MINIMAL"
`define ROUTE_ALGRMT_DEF "XY"
//define the routing algorithm : "XY_CLASSIC" or "BALANCE_DOR" or "SUDO_XY"
`define ROUTE_ALGRMT_DEF "XY_CLASSIC"
// The number of virtual channel (VC) for each individual physical channel. this value must be power of 2. The typical value is two and four.
`define VC_NUM_PER_PORT_DEF 2
 
133,6 → 133,13
Do not change the rest of definition, otherwise u need to adjast the other verilog codes
to work with new values.
************************************************************/
`define LOCAL_PORT 0
`define EAST_PORT 1
`define NORTH_PORT 2
`define WEST_PORT 3
`define SOUTH_PORT 4
`define X_Y_ADDR_WIDTH_IN_HDR 4
`define X_ADDR_END (32-(PORT_NUM_BCD_WIDTH+(`X_Y_ADDR_WIDTH_IN_HDR-X_NODE_NUM_WIDTH)))
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/sw/ram/cpu00_00.mif
8,24 → 8,24
CONTENT BEGIN
00000000 : B8080050;
00000001 : 00000000;
00000002 : B8080320;
00000002 : B808049C;
00000003 : 00000000;
00000004 : B8080190;
00000004 : B8080214;
[00000005..00000007] : 00000000;
00000008 : B8080328;
00000008 : B80804A4;
[00000009..00000013] : 00000000;
00000014 : 31A00688;
00000015 : 30400590;
00000016 : 30200E80;
00000014 : 31A00808;
00000015 : 30400710;
00000016 : 30201080;
00000017 : B9F40014;
00000018 : 80000000;
00000019 : B9F402DC;
00000019 : B9F40458;
0000001A : 30A30000;
0000001B : B8000000;
0000001C : 2021FFEC;
0000001D : F9E10000;
0000001E : 20C00688;
0000001F : 20E00688;
0000001E : 20C00808;
0000001F : 20E00808;
00000020 : 06463800;
00000021 : BC720014;
00000022 : F8060000;
32,8 → 32,8
00000023 : 20C60004;
00000024 : 06463800;
00000025 : BC92FFF4;
00000026 : 20C00688;
00000027 : 20E0068C;
00000026 : 20C00808;
00000027 : 20E0088C;
00000028 : 06463800;
00000029 : BC720014;
0000002A : F8060000;
40,318 → 40,414
0000002B : 20C60004;
0000002C : 06463800;
0000002D : BC92FFF4;
0000002E : B9F40280;
0000002E : B9F403FC;
0000002F : 80000000;
00000030 : 20C00000;
00000031 : 20E00000;
00000032 : B9F401A8;
00000032 : B9F40248;
00000033 : 20A00000;
00000034 : 32630000;
00000035 : B9F4025C;
00000035 : B9F403D8;
00000036 : 80000000;
00000037 : C9E10000;
00000038 : 30730000;
00000039 : B60F0008;
0000003A : 20210014;
0000003B : 94608001;
0000003C : A0630002;
0000003D : 9403C001;
0000003E : B60F0008;
0000003F : 80000000;
00000040 : B0004300;
00000041 : 30600000;
00000042 : E8800688;
00000043 : E8A30000;
00000044 : 30840001;
00000045 : F8800688;
00000046 : F8A30000;
00000047 : B60F0008;
00000048 : 80000000;
00000049 : B0004400;
0000004A : E860000C;
0000004B : A4630001;
0000004C : BC030010;
0000004D : B000DEAD;
0000004E : 3060BEAF;
0000004F : F8600688;
00000050 : B0004400;
00000051 : E860000C;
00000052 : A4630002;
00000053 : BC030010;
00000054 : B0001234;
00000055 : 30605678;
00000056 : F8600688;
00000057 : B0004400;
00000058 : E860000C;
00000059 : A4630004;
0000005A : BC030010;
0000005B : B000AAAA;
0000005C : 3060AAAA;
0000005D : F8600688;
0000005E : B0004200;
0000005F : E860000C;
00000060 : B0004200;
00000061 : F860000C;
00000062 : B60F0008;
00000063 : 80000000;
00000064 : 3021FFB0;
00000065 : F9E10000;
00000066 : F8610020;
00000067 : F8810024;
00000068 : F8A10028;
00000069 : F8C1002C;
0000006A : F8E10030;
0000006B : F9010034;
0000006C : F9210038;
0000006D : F941003C;
0000006E : F9610040;
0000006F : F9810044;
00000070 : FA210048;
00000071 : 95608001;
00000072 : FA41004C;
00000073 : F961001C;
00000074 : B0004400;
00000075 : E860000C;
00000076 : A4630008;
00000077 : BC230070;
00000078 : B0004400;
00000079 : E860000C;
0000007A : A4630007;
0000007B : BC03000C;
0000007C : B9F4FF34;
0000007D : 80000000;
0000007E : B0004400;
0000007F : E860000C;
00000080 : B0004400;
00000081 : F8600008;
00000082 : E9E10000;
00000083 : E961001C;
00000084 : E8610020;
00000085 : E8810024;
00000086 : 940BC001;
00000087 : E8A10028;
00000088 : E8C1002C;
00000089 : E8E10030;
0000008A : E9010034;
0000008B : E9210038;
0000008C : E941003C;
0000008D : E9610040;
0000008E : E9810044;
0000008F : EA210048;
00000090 : EA41004C;
00000091 : B62E0000;
00000092 : 30210050;
00000093 : B9F4FEB4;
00000094 : 80000000;
00000095 : B800FF8C;
00000096 : B8000008;
00000097 : 80000000;
00000098 : BE25FFFC;
00000099 : 30A5FFFF;
0000009A : B60F0008;
0000009B : 30A50001;
0000009C : 3021FFE4;
0000009D : F9E10000;
0000009E : 30800007;
0000009F : B00002FA;
000000A0 : 3060F080;
000000A1 : B0004200;
000000A2 : F8800004;
000000A3 : 30A00003;
000000A4 : B0004200;
000000A5 : F8A00000;
000000A6 : B0004300;
000000A7 : F8600008;
000000A8 : B0004300;
000000A9 : F8800000;
000000AA : 3060000F;
000000AB : B0004400;
000000AC : F8600004;
000000AD : B0004400;
000000AE : F8A00000;
000000AF : F8000688;
000000B0 : B9F4FE2C;
000000B1 : 80000000;
000000B2 : 10E00000;
000000B3 : 10C70000;
000000B4 : B0004100;
000000B5 : 30A02004;
000000B6 : E8600688;
000000B7 : 30E70001;
000000B8 : 44633000;
000000B9 : A463000F;
000000BA : 64630402;
000000BB : E8830548;
000000BC : 30C60004;
000000BD : A884FFFF;
000000BE : F8850000;
000000BF : AA470008;
000000C0 : BE32FFD8;
000000C1 : 30A50080;
000000C2 : B0000000;
000000C3 : 30A0C350;
000000C4 : B9F4FF48;
000000C5 : 80000000;
000000C6 : B810FFB4;
000000C7 : 10E00000;
000000C8 : B6110000;
000000C9 : 80000000;
000000CA : B6910000;
000000CB : 80000000;
000000CC : B60F0008;
000000CD : 80000000;
000000CE : B60F0008;
000000CF : 80000000;
000000D0 : 3021FFE0;
000000D1 : 10C00000;
000000D2 : FA61001C;
000000D3 : F9E10000;
000000D4 : B9F40024;
000000D5 : 12650000;
000000D6 : E8A00588;
000000D7 : E8650028;
000000D8 : BC03000C;
000000D9 : 99FC1800;
000000DA : 80000000;
000000DB : B9F4FD00;
000000DC : 10B30000;
000000DD : E8600588;
000000DE : 3021FFC8;
000000DF : FB410030;
000000E0 : FB610034;
000000E1 : F9E10000;
000000E2 : FA61001C;
000000E3 : FAC10020;
000000E4 : FAE10024;
000000E5 : FB010028;
000000E6 : FB21002C;
000000E7 : EB030048;
000000E8 : 13650000;
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8,24 → 8,24
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8,24 → 8,24
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0000004F : 80000000;
00000050 : 3021FFDC;
00000051 : FA61001C;
00000052 : B0004100;
00000053 : 32602004;
00000054 : FAC10020;
00000055 : F9E10000;
00000056 : 32C00001;
00000057 : B0000000;
00000058 : 30A0C350;
00000059 : FAD30000;
0000005A : B9F4FFC0;
0000005B : 80000000;
0000005C : B0000000;
0000005D : 30A0C350;
0000005E : F8130000;
0000005F : B9F4FFAC;
00000060 : 80000000;
00000061 : B800FFD8;
00000062 : 30E70001;
00000063 : B0000440;
00000064 : 30600003;
00000065 : 64E70413;
00000066 : F8C50004;
00000067 : F8650000;
00000068 : 10E72800;
00000069 : 3021FFF0;
0000006A : B0004000;
0000006B : F8E00004;
0000006C : B0004000;
0000006D : E8600008;
0000006E : A4630001;
0000006F : BC03FFF4;
00000070 : B0004000;
00000071 : E8600008;
00000072 : A4630010;
00000073 : BC03FFF4;
00000074 : B0000018;
00000075 : 30610004;
00000076 : B0004000;
00000077 : F8600000;
00000078 : B0004000;
00000079 : E8600008;
0000007A : A4630002;
0000007B : BC03FFF4;
0000007C : B60F0008;
0000007D : 30210010;
0000007E : B0000440;
0000007F : 30600000;
00000080 : F8C50004;
00000081 : F8E50008;
00000082 : F8650000;
00000083 : B0000010;
00000084 : 30850000;
00000085 : B0004000;
00000086 : F8800004;
00000087 : B0004000;
00000088 : E8600008;
00000089 : A4630001;
0000008A : BC03FFF4;
0000008B : B0004000;
0000008C : E8600008;
0000008D : A4630010;
0000008E : BE03FFF4;
0000008F : 30670001;
00000090 : 64630413;
00000091 : 10651800;
00000092 : B0004000;
00000093 : F8600000;
00000094 : B0004000;
00000095 : E8600008;
00000096 : A4630002;
00000097 : BC03FFF4;
00000098 : B60F0008;
00000099 : 80000000;
0000009A : B6110000;
0000009B : 80000000;
0000009C : B6910000;
0000009D : 80000000;
0000009E : B62E0000;
0000009F : 80000000;
000000A0 : B60F0008;
000000A1 : 80000000;
000000A2 : B60F0008;
000000A3 : 80000000;
000000A4 : 3021FFE0;
000000A5 : 10C00000;
000000A6 : FA61001C;
000000A7 : F9E10000;
000000A8 : B9F40024;
000000A9 : 12650000;
000000AA : E8A00498;
000000AB : E8650028;
000000AC : BC03000C;
000000AD : 99FC1800;
000000AE : 80000000;
000000AF : B9F4FDB0;
000000B0 : 10B30000;
000000B1 : E8600498;
000000B2 : 3021FFC8;
000000B3 : FB410030;
000000B4 : FB610034;
000000B5 : F9E10000;
000000B6 : FA61001C;
000000B7 : FAC10020;
000000B8 : FAE10024;
000000B9 : FB010028;
000000BA : FB21002C;
000000BB : EB030048;
000000BC : 13650000;
000000BD : BE180050;
000000BE : 13460000;
000000BF : E8780004;
000000C0 : E8F60000;
000000C1 : 3063FFFF;
000000C2 : 16439800;
000000C3 : BC120054;
000000C4 : F8160000;
000000C5 : BC07FF00;
000000C6 : BC190038;
000000C7 : 30800001;
000000C8 : E8790100;
000000C9 : 44849C00;
000000CA : 84641800;
000000CB : BC030024;
000000CC : E8790104;
000000CD : 84641800;
000000CE : BC230030;
000000CF : E8D70000;
000000D0 : 99FC3800;
000000D1 : 10BB0000;
000000D2 : B810FED0;
000000D3 : 3273FFFF;
000000D4 : 99FC3800;
000000D5 : 3273FFFF;
000000D6 : B810FEC4;
000000D7 : 32F7FFFC;
000000D8 : FA780004;
000000D9 : B800FFB0;
000000DA : E8B70000;
000000DB : 99FC3800;
000000DC : 3273FFFF;
000000DD : B810FEA8;
000000DE : 32F7FFFC;
000000DF : 0000038C;
000000E0 : 43000000;
000000E1 : 00000000;
000000E2 : 0000038C;
[000000E3..000000EA] : 00000000;
000000EB : 00000380;
[000000EC..00000FFF] : 00000000;
000000C0 : EB380088;
000000C1 : 3263FFFF;
000000C2 : BC53003C;
000000C3 : 64930402;
000000C4 : 30640008;
000000C5 : 12D81800;
000000C6 : BE060074;
000000C7 : 12F92000;
000000C8 : BC1900C0;
000000C9 : E8770080;
000000CA : 1643D000;
000000CB : BC1200EC;
000000CC : 3273FFFF;
000000CD : 32F7FFFC;
000000CE : AA53FFFF;
000000CF : BE32FFE8;
000000D0 : 32D6FFFC;
000000D1 : E9E10000;
000000D2 : EA61001C;
000000D3 : EAC10020;
000000D4 : EAE10024;
000000D5 : EB010028;
000000D6 : EB21002C;
000000D7 : EB410030;
000000D8 : EB610034;
000000D9 : B60F0008;
000000DA : 30210038;
000000DB : E8B70000;
000000DC : 99FC3800;
000000DD : 80000000;
000000DE : 3273FFFF;
000000DF : 32F7FFFC;
000000E0 : AA53FFFF;
000000E1 : BE12FFC0;
000000E2 : 32D6FFFC;
000000E3 : E8780004;
000000E4 : E8F60000;
000000E5 : 3063FFFF;
000000E6 : 16439800;
000000E7 : BC120074;
000000E8 : F8160000;
000000E9 : BC07FFD4;
000000EA : BE190058;
000000EB : 30800001;
000000EC : E8790100;
000000ED : 44849C00;
000000EE : 84641800;
000000EF : BC030044;
000000F0 : E8790104;
000000F1 : 84641800;
000000F2 : BC23FFA4;
000000F3 : E8D70000;
000000F4 : 99FC3800;
000000F5 : 10BB0000;
000000F6 : B810FFA4;
000000F7 : 3273FFFF;
000000F8 : 3273FFFF;
000000F9 : AA53FFFF;
000000FA : BE12FF5C;
000000FB : 3273FFFF;
000000FC : AA53FFFF;
000000FD : BE32FFF0;
000000FE : 3273FFFF;
000000FF : B800FF48;
00000100 : 99FC3800;
00000101 : 3273FFFF;
00000102 : B810FF78;
00000103 : 32F7FFFC;
00000104 : FA780004;
00000105 : B800FF90;
00000106 : E8780004;
00000107 : E8F60000;
00000108 : 3063FFFF;
00000109 : 16439800;
0000010A : BC120054;
0000010B : F8160000;
0000010C : BC07FF00;
0000010D : BC190038;
0000010E : 30800001;
0000010F : E8790100;
00000110 : 44849C00;
00000111 : 84641800;
00000112 : BC030024;
00000113 : E8790104;
00000114 : 84641800;
00000115 : BC230030;
00000116 : E8D70000;
00000117 : 99FC3800;
00000118 : 10BB0000;
00000119 : B810FED0;
0000011A : 3273FFFF;
0000011B : 99FC3800;
0000011C : 3273FFFF;
0000011D : B810FEC4;
0000011E : 32F7FFFC;
0000011F : FA780004;
00000120 : B800FFB0;
00000121 : E8B70000;
00000122 : 99FC3800;
00000123 : 3273FFFF;
00000124 : B810FEA8;
00000125 : 32F7FFFC;
00000126 : 000004A4;
00000127 : 43000000;
00000128 : 000004A4;
[00000129..00000130] : 00000000;
00000131 : 0000049C;
[00000132..00000FFF] : 00000000;
END;
/an-fpga-implementation-of-low-latency-noc-based-mpsoc/trunk/noc_based_mpsoc/sw/soc_code/soc.c
4,20 → 4,18
#include "system.h"
 
 
#define EXT_INT_EN 1
#define TIMER_EN 1
#define EXT_INT_NUM 3
 
#define TIMER_INT (1<<(EXT_INT_NUM*EXT_INT_EN))
 
#define EXT_INT_1 (1<<0)
#define EXT_INT_2 (1<<1)
#define EXT_INT_3 (1<<2)
 
#define EXT_INT_ALL (EXT_INT_1 | EXT_INT_2 | EXT_INT_3) // ((1<<EXT_INT_NUM)-1)
 
 
const unsigned int seven_seg_tab [16] = {0x3F,0x06,0x5B,0x4F,0x66,0x6D,0x7D,0x07,0x7F,0x6F,0x77,0x7C,0x39,0x5E, 0x79,0x71};
 
void delay(unsigned int);
void ni_ISR ( void );
void timer_ISR( void );
void ext_int_ISR( void );
 
43,8 → 41,9
 
void myISR( void )
{
if( INTC_IPR & NI_INT ) ni_ISR();
if( INTC_IPR & TIMER_INT ) timer_ISR();
if( INTC_IPR & EXT_INT_ALL ) ext_int_ISR();
if( INTC_IPR & EXT_INT) ext_int_ISR();
INTC_IAR = INTC_IPR; // Acknowledge Interrupts
}
 
62,15 → 61,24
void ext_int_ISR( void )
{
// Do Stuff Here
if(INTC_IPR & EXT_INT_1) i=0xDEADBEAF;
if(INTC_IPR & EXT_INT_2) i=0x12345678;
if(INTC_IPR & EXT_INT_3) i=0xAAAAAAAA;
if(EXT_INT_ISR & EXT_INT_1) i=0xDEADBEAF;
if(EXT_INT_ISR & EXT_INT_2) i=0x12345678;
if(EXT_INT_ISR & EXT_INT_3) i=0xAAAAAAAA;
EXT_INT_ISR = EXT_INT_ISR;
// Clear any pending button interrupts
}
 
unsigned int ni_buffer [32];
 
void ni_ISR( void )
{
// Do Stuff Here
save_pck (ni_buffer, 32);
NIC_ST = NIC_ST;
// Clear any pending button interrupts
}
 
 
int main()
{
unsigned int j,hex_val;
79,14 → 87,14
EXT_INT_IER_RISE=EXT_INT_ALL;
EXT_INT_GER =0x3;
EXT_INT_IER_RISE=EXT_INT_1 | EXT_INT_2 | EXT_INT_3;
EXT_INT_GER = 0x3;
 
TCMP0 = 50000000;
TCSR0 = ( TIMER_EN | TIMER_INT_EN | TIMER_RST_ON_CMP);
 
INTC_IER=EXT_INT_ALL|TIMER_INT;
INTC_MER=0x3;
INTC_IER= EXT_INT | TIMER_INT;
INTC_MER= 0x3;
 

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