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Esta placa es la interfaz que permite la comunicación entre una computadora y la placa PHR. Su característica modular, o de circuito separado de la placa PHR principal, hace que su utilización no quede restringida a la FPGA y posibilita la interacción con los multiples dispositivos que soportan JTAG.
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Esta placa es la interfaz que permite la comunicación entre una computadora y la placa PHR. Su característica modular, o de circuito separado de la placa PHR principal, hace que su utilización no quede restringida a la FPGA y posibilita la interacción con los multiples dispositivos que soportan JTAG.
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La idea original de esta placa es parte de los pensamientos de Joern Kaipf quien publica su diseño en su sitio web\footnote{Diríjase a \texttt{http://www.oocdlink.com/}.}.
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La idea original de esta placa es parte de los pensamientos de Joern Kaipf quien publica su diseño en su sitio web\footnote{Diríjase a \texttt{http://www.oocdlink.com/}.}.
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La placa OOCDLink se muestra en la Fig. \ref{oocdlink:componentes} donde también identifican los elementos principales que la constituyen. Un esquemático mas detallado se muestra en el Apéndice \ref{appendix:sche}.
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La placa OOCDLink se muestra en la Fig. \ref{oocdlink:componentes}
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donde también se identifican los elementos principales que la constituyen. Un esquemático más detallado se muestra en el Apéndice \ref{appendix:sche}.
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\begin{figure}[h]
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\begin{figure}[h]
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\begin{center}
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\begin{center}
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\includegraphics{./img/oocdlink/oocdlink_top.pdf}
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\includegraphics{./img/oocdlink/oocdlink_top.pdf}
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\end{center}
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\end{center}
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\caption[Componentes de la placa OOCDLink]{Componentes de la placa OOCDLink.
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\caption[Componentes de la placa OOCDLink]{Componentes de la placa OOCDLink.
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1) Conector UART,
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1) Conector UART,
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2) LED RX (UART),
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2) LED RX (UART),
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3) LED TX (UART),
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3) LED TX (UART),
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4) Conector JTAG,
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4) Conector JTAG,
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5) LED FT\_OK,
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5) FT2232D,
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6) Conector USB 2.0,
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6) LED FT\_OK,
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7) EEPROM,
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7) EEPROM,
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8) FT2232D,
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8) Oscilador de 6 MHz,
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9) LED Alimentación,
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9) LED Alimentación,
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10) Oscilador de 6 MHz.
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10) Conector USB 2.0.
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}
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\label{oocdlink:componentes}
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\label{oocdlink:componentes}
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\end{figure}
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\end{figure}
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El dispositivo que cumple la función primordial dentro de la placa OOCDLink es el chip FT2232D. Este es un conversor de USB a UART u otras interfaces seriales que dispone de dos canales de comunicación (\emph{conversor dual}).
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El dispositivo que cumple la función primordial dentro de la placa OOCDLink es el chip FT2232D. Este es un conversor de USB a UART u otras interfaces seriales que dispone de dos canales de comunicación (\emph{conversor dual}).
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%\end{center}
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%\end{center}
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%\caption[Adaptador entre PHR y OOCDLink]{Conector adaptador entre placas PHR y OOCDLink.}
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%\caption[Adaptador entre PHR y OOCDLink]{Conector adaptador entre placas PHR y OOCDLink.}
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%\label{oocdlink:adaptador}
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%\label{oocdlink:adaptador}
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%\end{figure}
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%\end{figure}
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La placa OOCDLink tiene varios LEDs indicadores. El LED numerado con 9 en la Fig. \ref{oocdlink:componentes} se ilumina cuando la placa está encendida. Aquellos demarcados con los números 2 y 3 (RX y TX) encienden cuando el chip tiene flujos de datos en la UART. El LED indicado con 5 (FT\_OK) señala si hay un dispositivo JTAG activo y conectado a la placa OOCDLink.
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La placa OOCDLink tiene varios LEDs indicadores. El LED numerado con 9 en la Fig. \ref{oocdlink:componentes} se ilumina cuando la placa está encendida. Aquellos demarcados con los números 2 y 3 (RX y TX) encienden cuando el chip tiene flujos de datos en la UART. El LED indicado con 6 (FT\_OK) señala si hay un dispositivo JTAG activo y conectado a la placa OOCDLink.
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%NEW SECTION NEW SECTION NEW SECTION NEW SECTION NEW SECTION%
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Algunas características del FT2232D que se pueden destacar son:
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Algunas características del FT2232D que se pueden destacar son:
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\begin{itemize}
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\begin{itemize}
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\item Cumple con las especificaciones de USB 2.0 Full Speed (12 Mbits/sec).
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\item Cumple con las especificaciones de USB 2.0 Full Speed (12 Mbits/sec).
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\item Simplifica la comunicación de USB con los protocolos de comunicaciones seriales JTAG, I2C y SPI.
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\item Simplifica la comunicación de USB con los protocolos de comunicaciones seriales JTAG, I2C y SPI.
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\item Tiene una tasa de transferencia de entre 300 y 3 MBaud.
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\item Tiene una tasa de transferencia de entre 300 y 3 MBaud.
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\item Desde el sistema operativo, la interfaz puede verse como un \emph{puerto serie virtual} (necesita el driver que provee el fabricante sin costo adicional).
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\item Desde el sistema operativo, la interfaz puede verse como un \emph{puerto serie virtual} (necesita el controlador que provee el fabricante sin costo adicional).
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\item También están disponibles librerías para facilitar el uso de JTAG, I2C y SPI (compatible con sistemas Windows y Linux).
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\item También están disponibles librerías para facilitar el uso de JTAG, I2C y SPI (compatible con sistemas Windows y Linux).
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\end{itemize}
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\end{itemize}
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La Fig. \ref{oocdlink:ftblock} muestra de manera esquemática el funcionamiento del chip aplicado a la placa OOCDLink.
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La Fig. \ref{oocdlink:ftblock} muestra de manera esquemática el funcionamiento del chip aplicado a la placa OOCDLink.
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\label{oocdlink:ftblock}
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\label{oocdlink:ftblock}
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\end{figure}
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\end{figure}
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El chip necesita que por fuera se provean una memoria EEPROM (para almacenar los datos de configuración) y una señal de reloj de 6 MHz.
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El chip necesita que por fuera se provean una memoria EEPROM (para almacenar los datos de configuración) y una señal de reloj de 6 MHz.
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El flujo de datos (descripto desde la computadora del usuario) comienza por el bus de comunicaciones USB (función en la que interviene el \emph{transceptor USB}), luego sigue a través del \emph{Motor serial} (que podría considerarse el núcleo del sistema) y continua por alguno de los dos controladores capaces de manejar protocolos seriales.
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El flujo de datos (descripto desde la computadora del usuario)
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comienza por el bus de comunicaciones USB (función en la que
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interviene el \emph{transceptor USB}), luego sigue a través del
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\emph{Motor serial} (que podría considerarse el núcleo del sistema) y
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continua por alguno de los dos controladores capaces de manejar protocolos seriales.
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El canal A es el que efectivamente permite implementar una interfaz JTAG cuando trabaja en el modo denominado \emph{MPSSE} (\textsl{Multi-Protocol Synchronous Serial Engine}). El canal B tiene posibilidades de funcionamiento mas acotadas por lo que se usa como UART.
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El canal A es el que efectivamente permite implementar una interfaz JTAG cuando trabaja en el modo denominado \emph{MPSSE} (\textsl{Multi-Protocol Synchronous Serial Engine}). El canal B tiene posibilidades de funcionamiento más acotadas por lo que se usa como UART.
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Para usar apropiadamente las interfaces se pueden usar los controladores de sistema operativo que el fabricante pone a disposición de los usuarios de Windows y Linux.
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Para usar apropiadamente las interfaces se pueden usar los controladores de sistema operativo que el fabricante pone a disposición de los usuarios de Windows y Linux.
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