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Line 42... |
module crc_128_init (
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module crc_128_init (
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//----------------------------------
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//----------------------------------
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//----SYSTEM INTERFACE
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//----SYSTEM INTERFACE
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//----------------------------------
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//----------------------------------
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input wire clk ,
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input wire clk ,
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`ifdef RESET_ALL
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input wire res_n ,
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input wire res_n ,
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`endif
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//----------------------------------
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//----------------------------------
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//----Input
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//----Input
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//----------------------------------
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//----------------------------------
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input wire [127:0] inData ,
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input wire [127:0] inData ,
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Line 61... |
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`ifdef ASYNC_RES
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`ifdef ASYNC_RES
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always @(posedge clk or negedge res_n) `else
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always @(posedge clk or negedge res_n) `else
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always @(posedge clk) `endif
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always @(posedge clk) `endif
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begin
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begin
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`ifdef RESET_ALL
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if (!res_n) begin
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if (!res_n) begin
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crc <= 32'h0;
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crc <= 32'h0;
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end
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end else
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else begin
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`endif
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|
begin
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