Subversion Repositories an-fpga-implementation-of-low-latency-noc-based-mpsoc

 
/**********************************************************************
**	File:  ni_crc32.v 
**	Date:2017-06-14  
**    
**	Copyright (C) 2014-2017  Alireza Monemi
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**
**
**	Description: CRC32 generator 
**	
**
*******************************************************************/
 
 
 
 
 
// synthesis translate_off
`timescale 1ns / 1ps
// synthesis translate_on
 
 
 
module crc_32_multi_chanel #(
    parameter chanel=4
 
)(
    reset,
    clk,
    chanel_in,
    crc_reset,
    crc_enable,
    data_in,
    crc_out 
 
 );
 
   function integer log2;
      input integer number; begin   
         log2=(number <=1) ? 1: 0;    
         while(2**log2<number) begin    
            log2=log2+1;    
         end       
      end   
    endfunction // log2 
 
 localparam CHw=log2(chanel);
 
    input  reset, clk, crc_reset, crc_enable;
    input  [CHw-1   :   0] chanel_in;
    input  [31  :   0] data_in;
    output [31  :   0] crc_out;
 
 
    wire [31:0] crc_in,crc_reg_next;
    assign crc_out = crc_in;
 
 
 
 
 
 
 
 
    crc_32_combinational crc_32_comb(
    	.data_in(data_in),
    	.crc_out(crc_reg_next),
    	.crc_in(crc_in)
    );
 
    reg [31 :   0]  crc_chanel_reg [chanel-1  :   0];
 
 
    assign crc_in = crc_chanel_reg[chanel_in];
 
    genvar i;
    generate
    for (i=0;i<chanel; i=i+1)begin :lp
`ifdef SYNC_RESET_MODE 
    always @ (posedge clk )begin 
`else 
    always @ (posedge clk or posedge reset)begin 
`endif   
        if (reset ) begin 
            crc_chanel_reg[i]<=0;
        end else begin 
            if(chanel_in == i)begin 
                if(crc_reset)  crc_chanel_reg[i]<=0;
                else if(crc_enable   )  crc_chanel_reg[i]<=crc_reg_next;
            end
        end
 
    end
    end
    endgenerate
 
endmodule
 
 
 
 
//-----------------------------------------------------------------------------
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// OR IMPLIED WARRANTIES, INCLUDING, WITHOUT LIMITATION, THE IMPLIED    
// WARRANTIES OF MERCHANTIBILITY AND FITNESS FOR A PARTICULAR PURPOSE. 
//-----------------------------------------------------------------------------
// CRC module for data[31:0] ,   crc[31:0]=1+x^1+x^2+x^4+x^5+x^7+x^8+x^10+x^11+x^12+x^16+x^22+x^23+x^26+x^32;
//-----------------------------------------------------------------------------
module crc_32_combinational(
    data_in,
    crc_out, 
    crc_in 
 );
 
    input [31:0] data_in;
    output reg [31:0] crc_out; 
    input [31:0] crc_in;
 
 
  always @(*) begin
    crc_out[0] = crc_in[0] ^ crc_in[6] ^ crc_in[9] ^ crc_in[10] ^ crc_in[12] ^ crc_in[16] ^ crc_in[24] ^ crc_in[25] ^ crc_in[26] ^ crc_in[28] ^ crc_in[29] ^ crc_in[30] ^ crc_in[31] ^ data_in[0] ^ data_in[6] ^ data_in[9] ^ data_in[10] ^ data_in[12] ^ data_in[16] ^ data_in[24] ^ data_in[25] ^ data_in[26] ^ data_in[28] ^ data_in[29] ^ data_in[30] ^ data_in[31];
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