Subversion Repositories phr

 
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\chapter{La placa OOCDLink}\label{oocd:chapter}
 
Esta placa es la interfaz que permite la comunicación entre una computadora y la placa PHR. Su característica modular, o de circuito separado de la placa PHR principal, hace que su utilización no quede restringida a la FPGA y posibilita la interacción con los multiples dispositivos que soportan JTAG. 
 
La idea original de esta placa es parte de los pensamientos de Joern Kaipf quien publica su diseño en  su sitio web\footnote{Diríjase a \texttt{http://www.oocdlink.com/}.}.
 
La placa OOCDLink se muestra en la Fig. \ref{oocdlink:componentes}
donde también se identifican los elementos principales que la constituyen. Un esquemático más detallado se muestra en el Apéndice \ref{appendix:sche}.
 
\begin{figure}[h]
\begin{center}
  \includegraphics{./img/oocdlink/oocdlink_top.pdf}
\end{center}
\caption[Componentes de la placa OOCDLink]{Componentes de la placa OOCDLink. 
1) Conector UART, 
2) LED RX (UART),
3) LED TX (UART),
4) Conector JTAG,
5) FT2232D,
6) LED FT\_OK,
7) EEPROM,
8) Oscilador de 6 MHz,
9) LED Alimentación,
10) Conector USB 2.0.
}
\label{oocdlink:componentes}
\end{figure}
 
El dispositivo que cumple la función primordial dentro de la placa OOCDLink es el chip FT2232D. Este es un conversor de USB a UART u otras interfaces seriales que dispone de dos canales de comunicación (\emph{conversor dual}). 
 
Si bien para el fin de configurar la FPGA es suficiente solo uno de los canales (configurado en modo JTAG), en la placa además se encuentra habilitado el segundo canal (configurado como UART) para que se use con propósitos generales. Los conectores para los canales JTAG y UART se indican en la Fig. \ref{oocdlink:componentes} con los números 4 y 1 respectivamente. 
 
El conector JTAG es el que debe usarse para el acoplamiento con la placa PHR mediante un adaptador que cambia la disposición mecánica de los pines. 
%El \textsl{layout} de una placa adaptadora se muestra en la Fig. \ref{oocdlink:adaptador}. Tiene como agregado un indicador LED para el voltaje de alimentación y un capacitor de filtro.
 
%\begin{figure}[h]
%\begin{center}
%  \includegraphics{./img/oocdlink/adaptador.pdf}
%\end{center}
%\caption[Adaptador entre PHR y OOCDLink]{Conector adaptador entre placas PHR y OOCDLink.}
%\label{oocdlink:adaptador}
%\end{figure}
 
La placa OOCDLink tiene varios LEDs indicadores. El LED numerado con 9 en la Fig. \ref{oocdlink:componentes} se ilumina cuando la  placa está encendida. Aquellos demarcados con los números 2 y 3 (RX y TX) encienden cuando el chip tiene flujos de datos en la UART. El LED indicado con 6 (FT\_OK) señala si hay un dispositivo JTAG activo y conectado a la placa OOCDLink.
 
 
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\section{El chip FT2232D}
 
Algunas características del FT2232D que se pueden destacar son:
\begin{itemize}
\item Cumple con las especificaciones de USB 2.0 Full Speed (12 Mbits/sec).
\item Simplifica la comunicación de USB con los protocolos de comunicaciones seriales JTAG, I2C y SPI.
\item Tiene una tasa de transferencia de entre 300 y 3 MBaud.
\item Desde el sistema operativo, la interfaz puede verse como un \emph{puerto serie virtual} (necesita el controlador que provee el fabricante sin costo adicional).
\item También están disponibles librerías para facilitar el uso de JTAG, I2C y SPI (compatible con sistemas Windows y Linux).
\end{itemize}
 
La Fig. \ref{oocdlink:ftblock} muestra de manera esquemática el funcionamiento del chip aplicado a la placa OOCDLink. 
 
\begin{figure}[h]
\begin{center}
  \includegraphics{./img/oocdlink/FTblock.pdf}
\end{center}
\caption[Diagrama de bloques del chip FT2232D]{Empleo del chip FT2232D.}
\label{oocdlink:ftblock}
\end{figure}
 
El chip necesita que por fuera se provean una memoria EEPROM (para almacenar los datos de configuración) y una señal de reloj de 6 MHz. 
 
El flujo de datos (descripto desde la computadora del usuario)
comienza  por el bus de comunicaciones USB (función en la que
interviene el \emph{transceptor USB}), luego sigue a través del
\emph{Motor serial} (que podría considerarse el núcleo del sistema) y
continua por alguno de los dos controladores capaces de manejar protocolos seriales. 
 
El canal A es el que efectivamente permite implementar una interfaz JTAG cuando trabaja en el modo denominado \emph{MPSSE}  (\textsl{Multi-Protocol Synchronous Serial Engine}). El canal B tiene posibilidades de funcionamiento más acotadas por lo que se usa como UART.
 
Para usar apropiadamente las interfaces se pueden usar los controladores de sistema operativo que el fabricante pone a disposición de los usuarios de Windows y Linux.