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----------------------------------------------------------------------- -- File: PCK_CRC32_D32.vhd -- Date: Tue Mar 4 19:11:40 2008 -- -- Copyright (C) 1999-2003 Easics NV. -- This source file may be used and distributed without restriction -- provided that this copyright statement is not removed from the file -- and that any derivative work contains the original copyright notice -- and the associated disclaimer. -- -- THIS SOURCE FILE IS PROVIDED "AS IS" AND WITHOUT ANY EXPRESS -- OR IMPLIED WARRANTIES, INCLUDING, WITHOUT LIMITATION, THE IMPLIED -- WARRANTIES OF MERCHANTIBILITY AND FITNESS FOR A PARTICULAR PURPOSE. -- -- Purpose: VHDL package containing a synthesizable CRC function -- * polynomial: (0 1 2 4 5 7 8 10 11 12 16 22 23 26 32) -- * data width: 32 -- -- Info: tools@easics.be -- http://www.easics.com ----------------------------------------------------------------------- library IEEE; use IEEE.std_logic_1164.all; package PCK_CRC32_D32 is -- polynomial: (0 1 2 4 5 7 8 10 11 12 16 22 23 26 32) -- data width: 32 -- convention: the first serial data bit is D(31) function nextCRC32_D32 ( Data: std_logic_vector(31 downto 0); CRC: std_logic_vector(31 downto 0) ) return std_logic_vector; end PCK_CRC32_D32; library IEEE; use IEEE.std_logic_1164.all; package body PCK_CRC32_D32 is -- polynomial: (0 1 2 4 5 7 8 10 11 12 16 22 23 26 32) -- data width: 32 -- convention: the first serial data bit is D(31) function nextCRC32_D32 ( Data: std_logic_vector(31 downto 0); CRC: std_logic_vector(31 downto 0) ) return std_logic_vector is variable D: std_logic_vector(31 downto 0); variable C: std_logic_vector(31 downto 0); variable NewCRC: std_logic_vector(31 downto 0); begin D := Data; C := CRC; NewCRC(0) := D(31) xor D(30) xor D(29) xor D(28) xor D(26) xor D(25) xor D(24) xor D(16) xor D(12) xor D(10) xor D(9) xor D(6) xor D(0) xor C(0) xor C(6) xor C(9) xor C(10) xor C(12) xor C(16) xor C(24) xor C(25) xor C(26) xor C(28) xor C(29) xor C(30) xor C(31); NewCRC(1) := D(28) xor D(27) xor D(24) xor D(17) xor D(16) xor D(13) xor D(12) xor D(11) xor D(9) xor D(7) xor D(6) xor D(1) xor D(0) xor C(0) xor C(1) xor C(6) xor C(7) xor C(9) xor C(11) xor C(12) xor C(13) xor C(16) xor C(17) xor C(24) xor C(27) xor C(28); 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