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1	2	tak.sugawa	`Release 7.1i - par H.38`
2			`Copyright (c) 1995-2005 Xilinx, Inc. All rights reserved.`
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206			`\|M14 \| \|DIFFS \|IO_L19N_3 \|UNUSED \| \|3 \| \| \| \| \| \| \| \| \| \|`
207			`\|M15 \|MemoryWData<22> \|IOB \|IO_L20P_3 \|OUTPUT \|LVCMOS25 \|3 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
208			`\|M16 \|MemoryWData<16> \|IOB \|IO_L20N_3 \|OUTPUT \|LVCMOS25 \|3 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
209			`\|N1 \| \|DIFFM \|IO_L17P_6/VREF_6 \|UNUSED \| \|6 \| \| \| \| \| \| \| \| \| \|`
210			`\|N2 \| \|DIFFS \|IO_L17N_6 \|UNUSED \| \|6 \| \| \| \| \| \| \| \| \| \|`
211			`\|N3 \| \|DIFFM \|IO_L16P_6 \|UNUSED \| \|6 \| \| \| \| \| \| \| \| \| \|`
212			`\|N4 \| \| \|VCCINT \| \| \| \| \| \| \| \|1.2 \| \| \| \| \|`
213			`\|N5 \|MemoryWData<11> \|IOB \|IO \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
214			`\|N6 \|MemoryWData<10> \|IOB \|IO_L28N_5/D6 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
215			`\|N7 \|data_port_address<2> \|IOB \|IO_L30N_5 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
216			`\|N8 \|MemoryWData<5> \|IOB \|IO_L32P_5/GCLK2 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
217			`\|N9 \|MemoryWData<19> \|IOB \|IO_L31N_4/INIT_B \|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
218			`\|N10 \| \|DIFFM \|IO_L29P_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
219			`\|N11 \| \|DIFFM \|IO_L27P_4/D1 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
220			`\|N12 \|MemoryWData<18> \|IOB \|IO/VREF_4 \|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
221			`\|N13 \| \| \|VCCINT \| \| \| \| \| \| \| \|1.2 \| \| \| \| \|`
222			`\|N14 \|TXD \|IOB \|IO_L19P_3 \|OUTPUT \|LVCMOS25 \|3 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
223			`\|N15 \|MemoryWData<7> \|IOB \|IO_L17P_3/VREF_3 \|OUTPUT \|LVCMOS25 \|3 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
224			`\|N16 \| \|DIFFS \|IO_L17N_3 \|UNUSED \| \|3 \| \| \| \| \| \| \| \| \| \|`
225			`\|P1 \| \|DIFFM \|IO_L01P_6/VRN_6 \|UNUSED \| \|6 \| \| \| \| \| \| \| \| \| \|`
226			`\|P2 \| \|DIFFS \|IO_L16N_6 \|UNUSED \| \|6 \| \| \| \| \| \| \| \| \| \|`
227			`\|P3 \| \| \|M0 \| \| \| \| \| \| \| \| \| \| \| \| \|`
228			`\|P4 \| \| \|M2 \| \| \| \| \| \| \| \| \| \| \| \| \|`
229			`\|P5 \| \|DIFFM \|IO_L27P_5 \|UNUSED \| \|5 \| \| \| \| \| \| \| \| \| \|`
230			`\|P6 \|data_port_address<10>\|IOB \|IO_L29P_5/VREF_5 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
231			`\|P7 \|data_port_address<8> \|IOB \|IO \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
232			`\|P8 \|MemoryWData<4> \|IOB \|IO_L32N_5/GCLK3 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
233			`\|P9 \|MemoryWData<6> \|IOB \|IO_L31P_4/DOUT/BUSY\|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
234			`\|P10 \|MemoryWData<2> \|IOB \|IO_L30N_4/D2 \|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
235			`\|P11 \| \|DIFFS \|IO_L28N_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
236			`\|P12 \| \|DIFFS \|IO_L25N_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
237			`\|P13 \| \|IOB \|IO/VREF_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
238			`\|P14 \| \|DIFFM \|IO_L16P_3 \|UNUSED \| \|3 \| \| \| \| \| \| \| \| \| \|`
239			`\|P15 \| \|DIFFS \|IO_L16N_3 \|UNUSED \| \|3 \| \| \| \| \| \| \| \| \| \|`
240			`\|P16 \| \|DIFFS \|IO_L01N_3/VRP_3 \|UNUSED \| \|3 \| \| \| \| \| \| \| \| \| \|`
241			`\|R1 \| \|DIFFS \|IO_L01N_6/VRP_6 \|UNUSED \| \|6 \| \| \| \| \| \| \| \| \| \|`
242			`\|R2 \| \| \|GND \| \| \| \| \| \| \| \| \| \| \| \| \|`
243			`\|R3 \| \|DIFFM \|IO_L01P_5/CS_B \|UNUSED \| \|5 \| \| \| \| \| \| \| \| \| \|`
244			`\|R4 \| \|DIFFM \|IO_L10P_5/VRN_5 \|UNUSED \| \|5 \| \| \| \| \| \| \| \| \| \|`
245			`\|R5 \|data_port_address<3> \|IOB \|IO_L27N_5/VREF_5 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
246			`\|R6 \|data_port_address<13>\|IOB \|IO_L29N_5 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
247			`\|R7 \|data_port_address<9> \|IOB \|IO_L31P_5/D5 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
248			`\|R8 \| \| \|GND \| \| \| \| \| \| \| \| \| \| \| \| \|`
249			`\|R9 \|MemoryWData<0> \|IOB \|IO_L32N_4/GCLK1 \|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
250			`\|R10 \|MemoryWData<3> \|IOB \|IO_L30P_4/D3 \|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
251			`\|R11 \| \|DIFFM \|IO_L28P_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
252			`\|R12 \| \|DIFFM \|IO_L25P_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
253			`\|R13 \| \|DIFFS \|IO_L01N_4/VRP_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
254			`\|R14 \| \| \|DONE \| \| \| \| \| \| \| \| \| \| \| \| \|`
255			`\|R15 \| \| \|GND \| \| \| \| \| \| \| \| \| \| \| \| \|`
256			`\|R16 \| \|DIFFM \|IO_L01P_3/VRN_3 \|UNUSED \| \|3 \| \| \| \| \| \| \| \| \| \|`
257			`\|T1 \| \| \|GND \| \| \| \| \| \| \| \| \| \| \| \| \|`
258			`\|T2 \| \| \|M1 \| \| \| \| \| \| \| \| \| \| \| \| \|`
259			`\|T3 \| \|DIFFS \|IO_L01N_5/RDWR_B \|UNUSED \| \|5 \| \| \| \| \| \| \| \| \| \|`
260			`\|T4 \| \|DIFFS \|IO_L10N_5/VRP_5 \|UNUSED \| \|5 \| \| \| \| \| \| \| \| \| \|`
261			`\|T5 \|data_port_address<0> \|IOB \|IO \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
262			`\|T6 \| \| \|VCCAUX \| \| \| \| \| \| \| \|2.5 \| \| \| \| \|`
263			`\|T7 \|data_port_address<11>\|IOB \|IO_L31N_5/D4 \|OUTPUT \|LVCMOS25 \|5 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
264			`\|T8 \| \|IOB \|IO/VREF_5 \|UNUSED \| \|5 \| \| \| \| \| \| \| \| \| \|`
265			`\|T9 \|clock \|IOB \|IO_L32P_4/GCLK0 \|INPUT \|LVCMOS25 \|4 \| \| \| \|NONE \| \| \| \|NO \|NONE \|`
266			`\|T10 \|MemoryWData<1> \|IOB \|IO/VREF_4 \|OUTPUT \|LVCMOS25 \|4 \|12 \|SLOW \|NONE** \| \| \| \| \|NO \|NONE \|`
267			`\|T11 \| \| \|VCCAUX \| \| \| \| \| \| \| \|2.5 \| \| \| \| \|`
268			`\|T12 \| \|IOB \|IO \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
269			`\|T13 \| \|DIFFM \|IO_L01P_4/VRN_4 \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
270			`\|T14 \| \|DIFFS \|IO \|UNUSED \| \|4 \| \| \| \| \| \| \| \| \| \|`
271			`\|T15 \| \| \|CCLK \| \| \| \| \| \| \| \| \| \| \| \| \|`
272			`\|T16 \| \| \|GND \| \| \| \| \| \| \| \| \| \| \| \| \|`
273			`+----------+---------------------+---------+-------------------+---------+-----------+--------------+----------+---------+-----------+---------+---------+----------+---------+-----------+----------------+`
274
275			`* Default value.`
276			`** This default Pullup/Pulldown value can be overridden in Bitgen.`
277			`****** This value can be any of the allowed voltages`
278			`(1.2v,1.5v,1.8v,2.5v,3.3v) or VCCAUX`
279
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