OpenCores
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[/] [socgen/] [trunk/] [Projects/] [opencores.org/] [logic/] [ip/] [uart/] [rtl/] [xml/] [uart_def.design.xml] - Blame information for rev 135

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Line No. Rev Author Line
1 131 jt_eaton
2
30 135 jt_eaton
31 
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opencores.org
38 
logic
39 
uart
40 
def.design
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43 
 
44 
 
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47 
 
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baud_clk
50 
wire
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wire
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90 
wire
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cde_buffer_empty
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wire
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98
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101 
 
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xmit_start
103 
reg
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xmit_enable
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wire
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115 
 wire
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119
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 rxd_pad_synced
121 
 wire
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123 
 
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128 
 
129 
 
130 
 
131 
 
132 
 
133 
 
134 135 jt_eaton
135 131 jt_eaton 
 
136 135 jt_eaton
137 
      clk
138
139
140
141
142
143
144
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146 
 
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148 
      reset
149
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153
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158 
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159
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164 
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165
166
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169 
 
170 
 
171 
 
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173
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176 
 
177 
 
178 
 
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180
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183 
 
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189 
 
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192 
      baud_clk_div
193
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196 
 
197 135 jt_eaton
198 
      parity_enable
199
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202 
 
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204 
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205
206
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208 
 
209 135 jt_eaton
210 
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211
212
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214 
 
215 
 
216 
 
217 135 jt_eaton
218 
      rxd_pad_in
219
220
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222 
 
223 
 
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225 
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226
227
228
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230 
 
231 
 
232 
 
233 
 
234 
 
235 
 
236 135 jt_eaton
237 
      rxd_data_avail_stb
238
239
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241 
 
242 135 jt_eaton
243 
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244
245
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247 
 
248 135 jt_eaton
249 
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250
251
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253 
 
254 135 jt_eaton
255 
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256
257
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259 
 
260 135 jt_eaton
261 
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262
263
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265 
 
266 135 jt_eaton
267 
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269
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271 
 
272 135 jt_eaton
273 
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278 
 
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280 
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282
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284 
 
285 
 
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287 
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294 
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301 
 
302 
 
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305
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313 135 jt_eaton
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315
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318 135 jt_eaton
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323 
 
324 
 
325 
 
326 135 jt_eaton
327
328
329 131 jt_eaton 
 
330 
 
331 135 jt_eaton
332 131 jt_eaton 
 
333 135 jt_eaton
334
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336 
 
337 
 
338 135 jt_eaton
339 131 jt_eaton 
 
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341 135 jt_eaton
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345
346
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351
352
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355 
 
356 135 jt_eaton
357 
divider
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359
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362
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369 
 4
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371
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373 
 
374 
 
375 
 
376 
 
377 135 jt_eaton
378 
filter
379
380
381 131 jt_eaton 
 
382 
 
383 135 jt_eaton
384 131 jt_eaton 
 
385 
 
386 
 
387 
 
388 
 
389 
 
390 
 
391 135 jt_eaton

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