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images_informe_adec Property changes : Added: svn:special ## -0,0 +1 ## +* \ No newline at end of property Index: schedule.pdf =================================================================== Cannot display: file marked as a binary type. svn:mime-type = application/octet-stream Index: schedule.aux =================================================================== --- schedule.aux (revision 90) +++ schedule.aux (revision 125) @@ -3,8 +3,7 @@ \catcode`<\active \catcode`>\active \@nameuse{es@quoting} -\bibcite{2012-SSE-FIUBA-NT01-00}{1} -\bibcite{openocd-manual-autoprobing}{2} +\citation{schedule_2012-08-24} \reset@newl@bel \select@language{spanish} \@writefile{toc}{\select@language{spanish}} @@ -11,11 +10,38 @@ \@writefile{lof}{\select@language{spanish}} \@writefile{lot}{\select@language{spanish}} \@writefile{toc}{\contentsline {section}{\numberline {1}Introducci\IeC {\'o}n}{1}} +\@writefile{toc}{\contentsline {section}{\numberline {2}Armado}{1}} +\newlabel{sec:armado}{{2}{1}} +\undonewlabel{acro:SMD} +\newlabel{acro:SMD}{{2}{1}} +\acronymused{SMD} +\acronymused{SMD} +\@writefile{toc}{\contentsline {section}{\numberline {3}Placas}{1}} +\newlabel{sec:placas}{{3}{1}} +\bibcite{schedule_2012-08-24}{1} +\bibcite{openocd-manual-autoprobing}{2} +\@writefile{toc}{\contentsline {subsection}{\numberline {3.1}OOCDLinks}{2}} +\newlabel{sec:oocdlinks}{{3.1}{2}} +\@writefile{lof}{\contentsline {figure}{\numberline {1}{\ignorespaces Distribuci\IeC {\'o}n de los componentes en la placa \emph {OOCDLink}.\relax }}{2}} +\providecommand*\caption@xref[2]{\@setref\relax\@undefined{#1}} +\newlabel{fig:oocdlik-pcb-layers}{{1}{2}} \undonewlabel{acro:openocd} -\newlabel{acro:openocd}{{2}{1}} +\newlabel{acro:openocd}{{2}{2}} \acronymused{openocd} \acronymused{openocd} -\@writefile{toc}{\contentsline {section}{\numberline {A}Acr\IeC {\'o}nimos}{2}} +\newlabel{fig:oocdlink-pcb-3d-1}{{2a}{3}} +\newlabel{sub@fig:oocdlink-pcb-3d-1}{{a}{3}} +\newlabel{fig:oocdlink-pcb-3d-2}{{2b}{3}} +\newlabel{sub@fig:oocdlink-pcb-3d-2}{{b}{3}} +\@writefile{lof}{\contentsline {figure}{\numberline {2}{\ignorespaces Modelo en 3D de la placa \emph {OOCDLink}.\relax }}{3}} +\newlabel{fig:oocdlink-pcb-3d}{{2}{3}} +\newlabel{fig:oocdlink-foto-1}{{3a}{3}} +\newlabel{sub@fig:oocdlink-foto-1}{{a}{3}} +\newlabel{fig:oocdlink-foto-2}{{3b}{3}} +\newlabel{sub@fig:oocdlink-foto-2}{{b}{3}} +\@writefile{lof}{\contentsline {figure}{\numberline {3}{\ignorespaces Fotograf\IeC {\'\i }as de la placa \emph {OOCDLink}.\relax }}{3}} +\newlabel{fig:oocdlink-foto}{{3}{3}} +\@writefile{toc}{\contentsline {section}{\numberline {A}Acr\IeC {\'o}nimos}{4}} \newacro{PHR}[\AC@hyperlink{PHR}{PHR}]{Plataforma de Hardware Reconfigurable} \newacro{openocd}[\AC@hyperlink{openocd}{OpenOCD}]{\textsl {Open On-Chip Debugger}} \newacro{jtag}[\AC@hyperlink{jtag}{JTAG}]{\textsl {Joint Test Action Group}} @@ -27,4 +53,5 @@ \newacro{SO}[\AC@hyperlink{SO}{SO}]{sistema operativo} \newacro{GPL}[\AC@hyperlink{GPL}{GPL}]{\textsl {General Public License}} \newacro{UTN-FRC}[\AC@hyperlink{UTN-FRC}{UTN-FRC}]{Universidad Tecnol\IeC {\'o}gica Nacional -- Facultad Regional C\IeC {\'o}rdoba} -\@writefile{toc}{\contentsline {section}{\numberline {B}Repositorio de proyecto}{2}} +\newacro{SMD}[\AC@hyperlink{SMD}{SMD}]{\textsl {Surface Mount Soldering}} +\@writefile{toc}{\contentsline {section}{\numberline {B}Repositorio de proyecto}{4}} Index: schedule.tex =================================================================== --- schedule.tex (revision 90) +++ schedule.tex (revision 125) @@ -15,7 +15,7 @@ \usepackage{caption} \usepackage{subcaption} \usepackage{amssymb} -\title{Plataforma de hardware recofigurable \\ \small{Armado - Testeo y Documentación de las placas de finales}} +\title{Plataforma de hardware reconfigurable \\ \small{Armado, Testeo y Documentación de las placas (primeras versiones)}} \author{Luis A. Guanuco} \date{Agosto 2013} \pagestyle{fancy} @@ -35,16 +35,89 @@ \section{Introducción} -La documentación que se presenta en éste reporte describe los pasos a seguir para el \emph{armado, testéo y depuración} de las distintas placas que conformarán la \emph{Plataforma de Hardware Reconfigurable -- PHR}. -Se presenta un esquema general de tres etapas, sin embargo, cada una de ellas presenta una complejidad diferente. +Luego de la etapa de prototipado se ha logrado las primeras versiones de las diferentes placas. Junto a la documentación generada en anteriores reportes se completa el ciclo de desarrollo del proyecto. En el presente reporte se describirá tan solo la etapa final que hace referencia al subtítulo del informe \emph{Armado, Testeo y Documentación de las placas}. +\section{Armado} +\label{sec:armado} + +En anteriores reportes se han realizado el proceso de armado de las placas, en aquellas oportunidades se trabajó con versiones prototipos. Para evitar repetir los procesos la presentación de los procesos llevados adelante en estas versiones de las placas será como sigue, + +\begin{itemize} +\item Identificación de los componentes. +\item Instalación y reconocimiento de las herramientas necesarias para el proceso de soldadura \ac{SMD}. +\item Testeo visual (utilización de cámaras con zoom) y eléctrico sobre los pines de alimentación de los dispositivos \ac{SMD}, especialmente los dispositivos semiconductores. +\end{itemize} + +\section{Placas} +\label{sec:placas} + +Las placas que se han armado son, + +\begin{itemize} +\item OOCDLinks +\item S3Power +\item PHRBoard +\end{itemize} + +Las primeras dos placas ya fueron testeadas anteriormente pero en estas versiones se presentan cambios que no son significativos. La última placa es la continuación del desarrollo llevado anteriormente con la placa FPGA (PHR version BETA)\cite{schedule_2012-08-24}. Se anexará al final del reporte las observaciones sobre las potenciales modificaciones que han sido resultado del testeo que se describirán en las secciones siguientes. + +\subsection{OOCDLinks} +\label{sec:oocdlinks} + +En la Figura \ref{fig:oocdlink-sch} se puede ver el circuito esquemático de la placa OOCDLinks, se aclara que con esta figura se distingan los componentes, pues esto se presenta en la sección de Anexos. En esta versión se ha modificado la posición del conector USB, en relación con la primera versión armada. Además se agregó cuatro agujeros que permitirán sujetar la placa en algún gabinete o soporte de base. En la Figura \ref{fig:oocdlik-pcb-layers} se muestra el PCB con la distribución de los componentes. En las Figuras \ref{fig:oocdlink-pcb-3d-1} y \ref{fig:oocdlink-pcb-3d-2} se tienen los modelos en 3D de la placa. La versión final de la placa, con los componentes montados, se puede ver en las Figuras \ref{fig:oocdlink-foto-1} y \ref{fig:oocdlink-foto-2}. + +\begin{figure}[ht] + \centering + \includegraphics[width=8cm]{images_informe_adec/OOCDLink-pcb-layers} + \caption{Distribución de los componentes en la placa \emph{OOCDLink}.} + \label{fig:oocdlik-pcb-layers} +\end{figure} + +\begin{figure}[hb] + \begin{subfigure}{0.5\textwidth} + \centering + \includegraphics[width=\textwidth]{images_informe_adec/OOCDLinks-pcb-3d-1} + \caption{Perspectiva 1.} + \label{fig:oocdlink-pcb-3d-1} + \end{subfigure} + % -- + \begin{subfigure}{0.5\textwidth} + \centering + \includegraphics[width=\textwidth]{images_informe_adec/OOCDLinks-pcb-3d-2} + \caption{Perspectiva 2.} + \label{fig:oocdlink-pcb-3d-2} + \end{subfigure} + \caption{Modelo en 3D de la placa \emph{OOCDLink}.} + \label{fig:oocdlink-pcb-3d} +\end{figure} + +\begin{figure}[h] + \begin{subfigure}{0.5\textwidth} + \centering + \includegraphics[width=\textwidth]{images_informe_adec/OOCD_placa-foto-1} + \caption{Perspectiva 1.} + \label{fig:oocdlink-foto-1} + \end{subfigure} + % -- + \begin{subfigure}{0.5\textwidth} + \centering + \includegraphics[width=\textwidth]{images_informe_adec/OOCD_placa-foto-2} + \caption{Perspectiva 2.} + \label{fig:oocdlink-foto-2} + \end{subfigure} + \caption{Fotografías de la placa \emph{OOCDLink}.} + \label{fig:oocdlink-foto} +\end{figure} + + + \begin{thebibliography}{} - \bibitem{2012-SSE-FIUBA-NT01-00} Sebastián García, ``Entorno de desarrollo de firmware sobre arquitectura ARM Cortex-M3, basado en herramientas libres'', 31 de Julio del 2013, Versión 0 + \bibitem{schedule_2012-08-24} Luis A. Guanuco, ``Plataforma de hardware reconfigurable (Armado - Testeo y Documentación de las placas de prototipaje)'', Agosto 2012, 2.3.4.~FPGA (PHR version BETA), 8~p. \bibitem{openocd-manual-autoprobing} \ac{openocd}, ``\ac{openocd} User's Guide'', 25 de Noviembre del 2012, 10.7~Autoprobing, 58~p., Versión 0.7.0-dev \end{thebibliography} \newpage{} - +\clearpage{} \appendix{} \section{Acrónimos} @@ -60,6 +133,7 @@ \acro{SO}[SO]{sistema operativo} \acro{GPL}[GPL]{\textsl{General Public License}} \acro{UTN-FRC}{Universidad Tecnológica Nacional -- Facultad Regional Córdoba} + \acro{SMD}{\textsl{Surface Mount Soldering}} \end{acronym} \section{Repositorio de proyecto}

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