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| Rev 24 |
Rev 33 |
# sh testcase for mulr
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# sh testcase for mulr
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# mach: all
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# mach: all
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# as(sh): -defsym sim_cpu=0
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# as(sh): -defsym sim_cpu=0
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# as(shdsp): -defsym sim_cpu=1 -dsp
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# as(shdsp): -defsym sim_cpu=1 -dsp
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.include "testutils.inc"
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.include "testutils.inc"
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start
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start
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mulr_1: ! multiply by one
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mulr_1: ! multiply by one
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set_grs_a5a5
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set_grs_a5a5
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mov #1, r0
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mov #1, r0
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mulr r0, r1
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mulr r0, r1
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assertreg0 1
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assertreg0 1
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test_gr_a5a5 r1
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test_gr_a5a5 r1
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test_gr_a5a5 r2
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test_gr_a5a5 r2
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test_gr_a5a5 r3
|
test_gr_a5a5 r3
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test_gr_a5a5 r4
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test_gr_a5a5 r4
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test_gr_a5a5 r5
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test_gr_a5a5 r5
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test_gr_a5a5 r6
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test_gr_a5a5 r6
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test_gr_a5a5 r7
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test_gr_a5a5 r7
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test_gr_a5a5 r8
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test_gr_a5a5 r8
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test_gr_a5a5 r9
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test_gr_a5a5 r9
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test_gr_a5a5 r10
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test_gr_a5a5 r10
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test_gr_a5a5 r11
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test_gr_a5a5 r11
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test_gr_a5a5 r12
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test_gr_a5a5 r12
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test_gr_a5a5 r13
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test_gr_a5a5 r13
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test_gr_a5a5 r14
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test_gr_a5a5 r14
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mulr_2: ! multiply by two
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mulr_2: ! multiply by two
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set_grs_a5a5
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set_grs_a5a5
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mov #2, r0
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mov #2, r0
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mov #12, r1
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mov #12, r1
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mulr r0, r1
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mulr r0, r1
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assertreg0 2
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assertreg0 2
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assertreg 24, r1
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assertreg 24, r1
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test_gr_a5a5 r2
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test_gr_a5a5 r2
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test_gr_a5a5 r3
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test_gr_a5a5 r3
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test_gr_a5a5 r4
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test_gr_a5a5 r4
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test_gr_a5a5 r5
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test_gr_a5a5 r5
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test_gr_a5a5 r6
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test_gr_a5a5 r6
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test_gr_a5a5 r7
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test_gr_a5a5 r7
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test_gr_a5a5 r8
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test_gr_a5a5 r8
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test_gr_a5a5 r9
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test_gr_a5a5 r9
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test_gr_a5a5 r10
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test_gr_a5a5 r10
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test_gr_a5a5 r11
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test_gr_a5a5 r11
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test_gr_a5a5 r12
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test_gr_a5a5 r12
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test_gr_a5a5 r13
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test_gr_a5a5 r13
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test_gr_a5a5 r14
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test_gr_a5a5 r14
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mulr_3: ! multiply five by five
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mulr_3: ! multiply five by five
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set_grs_a5a5
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set_grs_a5a5
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mov #5, r0
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mov #5, r0
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mov #5, r1
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mov #5, r1
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mulr r0, r1
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mulr r0, r1
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assertreg0 5
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assertreg0 5
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assertreg 25, r1
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assertreg 25, r1
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test_gr_a5a5 r2
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test_gr_a5a5 r2
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test_gr_a5a5 r3
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test_gr_a5a5 r3
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test_gr_a5a5 r4
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test_gr_a5a5 r4
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test_gr_a5a5 r5
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test_gr_a5a5 r5
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test_gr_a5a5 r6
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test_gr_a5a5 r6
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test_gr_a5a5 r7
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test_gr_a5a5 r7
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test_gr_a5a5 r8
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test_gr_a5a5 r8
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test_gr_a5a5 r9
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test_gr_a5a5 r9
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test_gr_a5a5 r10
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test_gr_a5a5 r10
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test_gr_a5a5 r11
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test_gr_a5a5 r11
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test_gr_a5a5 r12
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test_gr_a5a5 r12
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test_gr_a5a5 r13
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test_gr_a5a5 r13
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test_gr_a5a5 r14
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test_gr_a5a5 r14
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mulr_4: ! multiply 127 by 127
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mulr_4: ! multiply 127 by 127
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set_grs_a5a5
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set_grs_a5a5
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mov #127, r0
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mov #127, r0
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mov #127, r1
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mov #127, r1
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mulr r0, r1
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mulr r0, r1
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assertreg0 127
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assertreg0 127
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assertreg 0x3f01, r1
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assertreg 0x3f01, r1
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test_gr_a5a5 r2
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test_gr_a5a5 r2
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test_gr_a5a5 r3
|
test_gr_a5a5 r3
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test_gr_a5a5 r4
|
test_gr_a5a5 r4
|
test_gr_a5a5 r5
|
test_gr_a5a5 r5
|
test_gr_a5a5 r6
|
test_gr_a5a5 r6
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test_gr_a5a5 r7
|
test_gr_a5a5 r7
|
test_gr_a5a5 r8
|
test_gr_a5a5 r8
|
test_gr_a5a5 r9
|
test_gr_a5a5 r9
|
test_gr_a5a5 r10
|
test_gr_a5a5 r10
|
test_gr_a5a5 r11
|
test_gr_a5a5 r11
|
test_gr_a5a5 r12
|
test_gr_a5a5 r12
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test_gr_a5a5 r13
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test_gr_a5a5 r13
|
test_gr_a5a5 r14
|
test_gr_a5a5 r14
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mulr_5: ! multiply -1 by -1
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mulr_5: ! multiply -1 by -1
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set_grs_a5a5
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set_grs_a5a5
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mov #-1, r0
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mov #-1, r0
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mov #-1, r1
|
mov #-1, r1
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mulr r0, r1
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mulr r0, r1
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assertreg0 -1
|
assertreg0 -1
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assertreg 1, r1
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assertreg 1, r1
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test_gr_a5a5 r2
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test_gr_a5a5 r2
|
test_gr_a5a5 r3
|
test_gr_a5a5 r3
|
test_gr_a5a5 r4
|
test_gr_a5a5 r4
|
test_gr_a5a5 r5
|
test_gr_a5a5 r5
|
test_gr_a5a5 r6
|
test_gr_a5a5 r6
|
test_gr_a5a5 r7
|
test_gr_a5a5 r7
|
test_gr_a5a5 r8
|
test_gr_a5a5 r8
|
test_gr_a5a5 r9
|
test_gr_a5a5 r9
|
test_gr_a5a5 r10
|
test_gr_a5a5 r10
|
test_gr_a5a5 r11
|
test_gr_a5a5 r11
|
test_gr_a5a5 r12
|
test_gr_a5a5 r12
|
test_gr_a5a5 r13
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test_gr_a5a5 r13
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test_gr_a5a5 r14
|
test_gr_a5a5 r14
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mulr_6: ! multiply 46340 by 46340
|
mulr_6: ! multiply 46340 by 46340
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set_grs_a5a5
|
set_grs_a5a5
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movi20 #46340, r0
|
movi20 #46340, r0
|
movi20 #46340, r1
|
movi20 #46340, r1
|
mulr r0, r1
|
mulr r0, r1
|
assertreg0 46340
|
assertreg0 46340
|
assertreg 0x7ffea810, r1
|
assertreg 0x7ffea810, r1
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test_gr_a5a5 r2
|
test_gr_a5a5 r2
|
test_gr_a5a5 r3
|
test_gr_a5a5 r3
|
test_gr_a5a5 r4
|
test_gr_a5a5 r4
|
test_gr_a5a5 r5
|
test_gr_a5a5 r5
|
test_gr_a5a5 r6
|
test_gr_a5a5 r6
|
test_gr_a5a5 r7
|
test_gr_a5a5 r7
|
test_gr_a5a5 r8
|
test_gr_a5a5 r8
|
test_gr_a5a5 r9
|
test_gr_a5a5 r9
|
test_gr_a5a5 r10
|
test_gr_a5a5 r10
|
test_gr_a5a5 r11
|
test_gr_a5a5 r11
|
test_gr_a5a5 r12
|
test_gr_a5a5 r12
|
test_gr_a5a5 r13
|
test_gr_a5a5 r13
|
test_gr_a5a5 r14
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test_gr_a5a5 r14
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mulr_7: ! multiply 7ffff by 7ffff (overflow)
|
mulr_7: ! multiply 7ffff by 7ffff (overflow)
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set_grs_a5a5
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set_grs_a5a5
|
movi20 #0x7ffff, r0
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movi20 #0x7ffff, r0
|
movi20 #0x7ffff, r1
|
movi20 #0x7ffff, r1
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mulr r0, r1
|
mulr r0, r1
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assertreg0 0x7ffff
|
assertreg0 0x7ffff
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assertreg 0xfff00001, r1
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assertreg 0xfff00001, r1
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test_gr_a5a5 r2
|
test_gr_a5a5 r2
|
test_gr_a5a5 r3
|
test_gr_a5a5 r3
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test_gr_a5a5 r4
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test_gr_a5a5 r4
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test_gr_a5a5 r5
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test_gr_a5a5 r5
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test_gr_a5a5 r6
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test_gr_a5a5 r6
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test_gr_a5a5 r7
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test_gr_a5a5 r7
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test_gr_a5a5 r8
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test_gr_a5a5 r8
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test_gr_a5a5 r9
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test_gr_a5a5 r9
|
test_gr_a5a5 r10
|
test_gr_a5a5 r10
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test_gr_a5a5 r11
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test_gr_a5a5 r11
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test_gr_a5a5 r12
|
test_gr_a5a5 r12
|
test_gr_a5a5 r13
|
test_gr_a5a5 r13
|
test_gr_a5a5 r14
|
test_gr_a5a5 r14
|
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|
pass
|
pass
|
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exit 0
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exit 0
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