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\usepackage{caption}
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\usepackage{caption}
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\usepackage{subcaption}
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\usepackage{subcaption}
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\usepackage{amssymb}
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\usepackage{amssymb}
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\title{Plataforma de hardware reconfigurable \\ \small{Armado, Testeo y Documentación de las placas (primeras versiones)}}
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\title{Plataforma de hardware reconfigurable \\ \small{Armado, Testeo y Documentación de las placas (primeras versiones)}}
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\author{Luis A. Guanuco}
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\author{Luis A. Guanuco}
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\date{Agosto 2013\\\scriptsize{$LastChangedRevision: 239 $}}
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\date{Agosto 2013\\\scriptsize{$LastChangedRevision: 240 $}}
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\pagestyle{fancy}
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\paragraph{Usar el FT232H (simple canal)}
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\paragraph{Usar el FT232H (simple canal)}
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El FT2232D dispone de dos canales independientes. Uno se utiliza para acceder a un puerto JTAG y el otro como una UART. Si bien la prestación de tener acceso a un puerto serial desde USB resulta muy beneficioso, no lo es así en el costo del programador JTAG. El FT232H cuenta con un solo canal que implementa la tecnología MPSSE (\textsl{Multi-Protocol Synchronous Serial Engine}). De esta forma se tendría un diseño más reducido y de menor costo.
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El FT2232D dispone de dos canales independientes. Uno se utiliza para acceder a un puerto JTAG y el otro como una UART. Si bien la prestación de tener acceso a un puerto serial desde USB resulta muy beneficioso, no lo es así en el costo del programador JTAG. El FT232H cuenta con un solo canal que implementa la tecnología MPSSE (\textsl{Multi-Protocol Synchronous Serial Engine}). De esta forma se tendría un diseño más reducido y de menor costo.
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\paragraph{Conector micro-USB}
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Se podría utilizar un conector micro-USB en vez del mini-USB.
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\paragraph{Utilizar menos indicadores LED}
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La actual placa tiene muchos indicadores LED.
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\paragraph{Selección automática del modo de configuración de la FPGA}
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El modo de configuración de la FPGA actualmente es manual. A través del \textsl{jumper} $K1$ el usuario elije el modo de configuración. Se podría utilizar el canal libre del FT2232D (actualmente UART) para configurar la señales del modo de la FPGA.
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\clearpage{}
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\subsection{S3Power}
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\subsection{S3Power}
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\label{sec:s3power}
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\label{sec:s3power}
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\caption{Perspectiva 1.}
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\caption{Perspectiva 1.}
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\label{fig:s3power-pcb-3d-1}
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\label{fig:s3power-pcb-3d-1}
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\end{subfigure}
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\end{subfigure}
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% ---
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\begin{subfigure}{0.5\textwidth}
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\begin{subfigure}{0.5\textwidth}
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\centering
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\centering n
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\includegraphics[width=\textwidth]{images_informe_adec/s3power_pcb_3d_2}
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\includegraphics[width=\textwidth]{images_informe_adec/s3power_pcb_3d_2}
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\caption{Perspectiva 2.}
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\caption{Perspectiva 2.}
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\label{fig:s3power-pcb-3d-2}
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\label{fig:s3power-pcb-3d-2}
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\end{subfigure}
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\end{subfigure}
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\caption{Modelo en 3D de la placa \emph{S3Power}.}
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\caption{Modelo en 3D de la placa \emph{S3Power}.}
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\end{figure}
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\end{figure}
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\subsubsection{Modificaciones}
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\subsubsection{Modificaciones}
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\label{sec:phrboard-modif}
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\label{sec:phrboard-modif}
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\paragraph{Recableado de puertos}
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En la FPGA XC3S200A se dispone de varios pines de entradas y salidas. Muchos de estos puertos no son bidireccionales. En la primera versión de la \emph{PHRBoard} se tuvo errores en la asignación de algunos puertos de solo-entrada a periféricos de salida. Se ha solucionado el inconveniente ``\emph{recableando}'' estos puertos y asignando a otros bidireccionales.
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\vspace{.5cm}
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\begin{tabular}[h]{|l|c|c|}
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\hline
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\textbf{Periférico (etiqueta)} & \textbf{PIN FPGA PCB} & \textbf{PIN FPGA corregido} \\
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\hline
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IOports\_display\_seg\_e & 68 & 28 \\
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\hline
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IOports\_led\_8 & 7 & 27 \\
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\hline
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\end{tabular}
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\vspace{.5cm}
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Se podría asignar a todos los puertos \emph{solo-entradas} de la FPGA a los periféricos de entrada.
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\paragraph{Indicadores}
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\paragraph{Indicadores}
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Se debería agregar texto que describa las funcionalidades de cada \textsl{jumpers}, conectores, o secciones de la placa PHR. A continuación se describen algunas que se encontraron:
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Se debería agregar texto que describa las funcionalidades de cada \textsl{jumpers}, conectores, o secciones de la placa PHR. A continuación se describen algunas que se encontraron:
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\begin{itemize}
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\begin{itemize}
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\item \textsl{Jumper} que configura la FPGA (JTAG - PROM)
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\item \textsl{Jumper} que configura la FPGA (JTAG - PROM)
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\item Nombre de cada pin del conector JTAG
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\item Nombre de cada pin del conector JTAG
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\item Señalar el sentido de \textsl{ON/OFF} de las llaves
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\item Señalar el sentido de \textsl{ON/OFF} de las llaves (revisar esquemático y el texto sobre el componente que dice ON)
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\item Señalar los niveles de tensión de los pines del conector para la S3Power
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\item Números de los pines de los conectores para entradas y salidas de propósito general (especialmente el \emph{PIN 1}).
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\item Indicación de las frecuencias seleccionadas con el selector de \textsl{clocks}.
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\item Señalar GND y +5V en la entrada de alimentación.
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\end{itemize}
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\end{itemize}
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\paragraph{Conector JTAG}
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Se podría seguir utilizando el conector de \emph{6 PINES} pero cambiando el \textsl{footprint} de 90 grados, por uno común. También se podría pensar para la nueva versión utilizar un conector estándar de Xilinx por ejemplo el \emph{XILINX PARALLEL CABLE III AND IV 9-PIN}.
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\paragraph{Resistores \textsl{pullups}}
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En la versión actual se tiene varios resistores \textsl{pullups} que se pusieron provisoriamente. Se debería chequear cuales quedarían definitivamente y cuales no.
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\paragraph{Conector E/S}
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Se debe reemplazar los dos conectores de propósitos generales por un solo conector. Preferentemente se utilizará un conector hembra. Se podría tomar como referencia los conectores estándares de Arduino.
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\newpage{}
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\clearpage{}
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\begin{thebibliography}{}
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\begin{thebibliography}{}
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