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Line 35... |
add32blko : in std_logic_vector ((04*width)-1 downto 0); --! Salidas de los 4 sumadores.
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add32blko : in std_logic_vector ((04*width)-1 downto 0); --! Salidas de los 4 sumadores.
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sqr32blko,inv32blko : in std_logic_vector (width-1 downto 0); --! Salidas de la raiz cuadradas y el inversor.
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sqr32blko,inv32blko : in std_logic_vector (width-1 downto 0); --! Salidas de la raiz cuadradas y el inversor.
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fifo32x23_q : in std_logic_vector (03*width-1 downto 0); --! Salida de la cola intermedia.
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fifo32x23_q : in std_logic_vector (03*width-1 downto 0); --! Salida de la cola intermedia.
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fifo32x09_q : in std_logic_vector (02*width-1 downto 0); --! Salida de las colas de producto punto.
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fifo32x09_q : in std_logic_vector (02*width-1 downto 0); --! Salida de las colas de producto punto.
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unary,crossprod,addsub : in std_logic; --! Bit con el identificador del bloque AB vs CD e identificador del sub bloque (A/B) o (C/D).
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unary,crossprod,addsub : in std_logic; --! Bit con el identificador del bloque AB vs CD e identificador del sub bloque (A/B) o (C/D).
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sync_chain_d : in std_logic; --! Señal de dato valido que se va por toda la cadena de sincronizacion.
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sync_chain_0 : in std_logic; --! Señal de dato valido que se va por toda la cadena de sincronizacion.
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sqr32blki,inv32blki : out std_logic_vector (width-1 downto 0); --! Salidas de las 2 raices cuadradas y los 2 inversores.
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sqr32blki,inv32blki : out std_logic_vector (width-1 downto 0); --! Salidas de las 2 raices cuadradas y los 2 inversores.
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fifo32x26_d : out std_logic_vector (03*width-1 downto 0); --! Entrada a la cola intermedia para la normalización.
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fifo32x26_d : out std_logic_vector (03*width-1 downto 0); --! Entrada a la cola intermedia para la normalización.
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fifo32x09_d : out std_logic_vector (02*width-1 downto 0); --! Entrada a las colas intermedias del producto punto.
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fifo32x09_d : out std_logic_vector (02*width-1 downto 0); --! Entrada a las colas intermedias del producto punto.
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prd32blki : out std_logic_vector ((12*width)-1 downto 0); --! Entrada de los 12 factores en el bloque de multiplicación respectivamente.
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prd32blki : out std_logic_vector ((12*width)-1 downto 0); --! Entrada de los 12 factores en el bloque de multiplicación respectivamente.
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add32blki : out std_logic_vector ((08*width)-1 downto 0); --! Entrada de los 8 sumandos del bloque de 4 sumadores.
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add32blki : out std_logic_vector ((08*width)-1 downto 0); --! Entrada de los 8 sumandos del bloque de 4 sumadores.
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Line 93... |
constant rstMasterValue : std_logic := '0';
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constant rstMasterValue : std_logic := '0';
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begin
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begin
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--! Cadena de sincronización: 29 posiciones.
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--! Cadena de sincronización: 29 posiciones.
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ssync_chain_d <= sync_chain_d;
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ssync_chain(0) <= sync_chain_0;
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sync_chain_proc:
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sync_chain_proc:
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process(clk,rst)
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process(clk,rst)
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begin
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begin
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if rst=rstMasterValue then
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if rst=rstMasterValue then
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ssync_chain <= (others => '0');
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ssync_chain(28 downto 1) <= (others => '0');
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elsif clk'event and clk='1' then
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elsif clk'event and clk='1' then
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ssync_chain(0) <= ssync_chain_d;
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for i in 28 downto 1 loop
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for i in 28 downto 1 loop
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ssync_chain(i) <= ssync_chain(i-1);
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ssync_chain(i) <= ssync_chain(i-1);
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end loop;
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end loop;
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end if;
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end if;
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end process sync_chain_proc;
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end process sync_chain_proc;
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