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--! Entidad opcoder: opcoder decodifica la operaci—n que se va a realizar. Para tal fin coloca en la entrada de uf (unidad funcional), cuales van a ser los operandos de los multiplicadores con los que uf cuenta y adem‡s escribe en el selector de operaci—n de uf, el tipo de operaci—n a realizar.
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--! Entidad opcoder: opcoder decodifica la operaci—n que se va a realizar. Para tal fin coloca en la entrada de uf (unidad funcional), cuales van a ser los operandos de los multiplicadores con los que uf cuenta y adem‡s escribe en el selector de operaci—n de uf, el tipo de operaci—n a realizar.
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component opcoder
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component opcoder
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generic (
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generic (
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width : integer := 18;
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width : integer := 18;
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structuralDescription : string:= "NO"
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structuralDescription : string:= "NO"
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)
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);
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port (
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port (
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Ax,Bx,Cx,Dx,Ay,By,Cy,Dy,Az,Bz,Cz,Dz : in std_logic_vector (17 downto 0);
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Ax,Bx,Cx,Dx,Ay,By,Cy,Dy,Az,Bz,Cz,Dz : in std_logic_vector (17 downto 0);
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m0f0,m0f1,m1f0,m1f1,m2f0,m2f1,m3f0,m3f1,m4f0,m4f1,m5f0,m5f1 : out std_logic_vector (17 downto 0);
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m0f0,m0f1,m1f0,m1f1,m2f0,m2f1,m3f0,m3f1,m4f0,m4f1,m5f0,m5f1 : out std_logic_vector (17 downto 0);
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opcode,addcode : in std_logic
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opcode,addcode : in std_logic
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);
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);
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end component;
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end component;
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--! Multiplexor estructural.
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--! Multiplexor estructural.
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entity fastmux is
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component fastmux is
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generic (
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generic (
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width : integer := 18
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width : integer := 18
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)
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);
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port (
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port (
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a,b:in std_logic_vector(w-1 downto 0);
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a,b:in std_logic_vector(width-1 downto 0);
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s:in std_logic;
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s:in std_logic;
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c: out std_logic_vector(w-1 downto 0)
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c: out std_logic_vector(width-1 downto 0)
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)
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);
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end entity;
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end component;
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--! Esta entidad corresponde al multiplicador que se instanciar’a dentro de la unidad funcional. El multiplicador registra los operandos a la entrada y el respectivo producto de la multiplicaci—n a la salida.
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--! Esta entidad corresponde al multiplicador que se instanciar’a dentro de la unidad funcional. El multiplicador registra los operandos a la entrada y el respectivo producto de la multiplicaci—n a la salida.
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component r_a18_b18_smul_c32_r
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component r_a18_b18_smul_c32_r
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port (
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port (
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aclr,clock:in std_logic;
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aclr,clock:in std_logic;
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dataa,datab:in std_logic_vector (17 downto 0);
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dataa,datab:in std_logic_vector (17 downto 0);
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