| Line 224... |
Line 224... |
end component;
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end component;
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--! Procedimiento para escribir std_logic_vectors en formato hexadecimal.
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--! Procedimiento para escribir std_logic_vectors en formato hexadecimal.
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procedure hexwrite_0(l:inout line; h: in std_logic_vector);
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procedure hexwrite_0(l:inout line; h: in std_logic_vector);
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--! SqrtDiv Unit::shifter, esta unidad transforma el número entero A, en terminos de 2^N * m = A. El literal m corresponde al valor de la mantissa. En terminos de representaci'on binaria, la mantissa es el valor de la direcci'on de memoria que contiene el valor f(mantissa). El literal N corresponde al valor entero mayor m'as cercano del logaritmo en base 2 del n'umero entero A.
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component shifter is
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component shifter
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generic (
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generic (
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address_width : integer := 9;
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address_width : integer := 9;
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width : integer := 32;
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width : integer := 32;
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even_shifter : string := "YES"
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even_shifter : string := "YES"
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);
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);
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| Line 239... |
Line 239... |
address : out std_logic_vector (address_width-1 downto 0);
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address : out std_logic_vector (address_width-1 downto 0);
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zero : out std_logic
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zero : out std_logic
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);
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);
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end component;
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end component;
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--! SqrtDiv Unit::func, func, es una memoria que almacena alguna funci'on en el rango de [1,2). Los valores de la funci'on evaluada en este rango se encuentran almacenados en una memoria ROM que seleccione el desarrollador.
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component func
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generic (
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memoryfilepath : string :="X:/Tesis/Workspace/hw/rt_lib/arith/src/trunk/sqrtdiv/memsqrt.mif"
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);
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port (
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ad0,ad1 : in std_logic_vector (8 downto 0);
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clk : in std_logic;
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q0,q1 ; : out std_logic_vector(17 downto 0)
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);
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end component;
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--! SqrtDiv Unit::shifter2xstage, esta unidad funciona tal cual la unidad shifter, pero al doble de la velocidad. El problema es que la entidad entrega dos valores de N: exp es un std_logic_vector la primera mitad entregar'a exp0 y la mitad mas significativa ser'a exp1.
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--! De estos dos valores no signados, el valor que representa a N es el mayor de los 2. As'i mismo ocurre con las mantissas. Si el exp0 es mayor que exp1 se escoge add0 en vez de add1 y viceversa.
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component shifter2xstage is
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generic (
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address_width : integer := 9;
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width : integer := 32
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);
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port (
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data : in std_logic_vector (width-1 downto 0);
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exp : out std_logic_vector (2*integer(ceil(log(real(width),2.0)))-1 downto 0);
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add : out std_logic_vector (2*address_width-1 downto 0);
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zero : out std_logic
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);
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end shifter2xstage;
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end package;
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end package;
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--! Funciones utilitarias, relacionadas sobre todo con el testbench
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--! Funciones utilitarias, relacionadas sobre todo con el testbench
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package body arithpack is
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package body arithpack is
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Line 288... |
index_high := i*4+3;
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index_high := i*4+3;
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end if;
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end if;
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write(l,hexchars(1+ieee.std_logic_unsigned.conv_integer(h(index_high+h'low downto index_low+h'low))));
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write(l,hexchars(1+ieee.std_logic_unsigned.conv_integer(h(index_high+h'low downto index_low+h'low))));
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end loop;
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end loop;
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end procedure;
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end procedure;
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end package body arithpack;
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end package body arithpack;
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No newline at end of file
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No newline at end of file
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