| Line 42... |
Line 42... |
//////////////////////////////////////////////////////////////////////
|
//////////////////////////////////////////////////////////////////////
|
//
|
//
|
// CVS Revision History
|
// CVS Revision History
|
//
|
//
|
// $Log: not supported by cvs2svn $
|
// $Log: not supported by cvs2svn $
|
|
// Revision 1.1 2004/09/23 09:43:06 jcastillo
|
|
// Verilog first import
|
|
//
|
|
|
`timescale 10ns/1ns
|
`timescale 10ns/1ns
|
|
|
module rng(clk,reset,loadseed_i,seed_i,number_o);
|
module rng(clk,reset,loadseed_i,seed_i,number_o);
|
input clk;
|
input clk;
|
| Line 104... |
Line 107... |
CASR_outCASR [33]=CASR_varCASR [32]^CASR_varCASR [34];
|
CASR_outCASR [33]=CASR_varCASR [32]^CASR_varCASR [34];
|
CASR_outCASR [32]=CASR_varCASR [31]^CASR_varCASR [33];
|
CASR_outCASR [32]=CASR_varCASR [31]^CASR_varCASR [33];
|
CASR_outCASR [31]=CASR_varCASR [30]^CASR_varCASR [32];
|
CASR_outCASR [31]=CASR_varCASR [30]^CASR_varCASR [32];
|
CASR_outCASR [30]=CASR_varCASR [29]^CASR_varCASR [31];
|
CASR_outCASR [30]=CASR_varCASR [29]^CASR_varCASR [31];
|
CASR_outCASR [29]=CASR_varCASR [28]^CASR_varCASR [30];
|
CASR_outCASR [29]=CASR_varCASR [28]^CASR_varCASR [30];
|
CASR_outCASR [28]=CASR_varCASR [27]^CASR_varCASR [29];
|
CASR_outCASR [28]=CASR_varCASR [27]^CASR_varCASR [28]^CASR_varCASR [29];
|
CASR_outCASR [27]=CASR_varCASR [26]^CASR_varCASR [28];
|
CASR_outCASR [27]=CASR_varCASR [26]^CASR_varCASR [28];
|
CASR_outCASR [26]=CASR_varCASR [25]^CASR_varCASR [27];
|
CASR_outCASR [26]=CASR_varCASR [25]^CASR_varCASR [27];
|
CASR_outCASR [25]=CASR_varCASR [24]^CASR_varCASR [26];
|
CASR_outCASR [25]=CASR_varCASR [24]^CASR_varCASR [26];
|
CASR_outCASR [24]=CASR_varCASR [23]^CASR_varCASR [25];
|
CASR_outCASR [24]=CASR_varCASR [23]^CASR_varCASR [25];
|
CASR_outCASR [23]=CASR_varCASR [22]^CASR_varCASR [24];
|
CASR_outCASR [23]=CASR_varCASR [22]^CASR_varCASR [24];
|
