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TimeQuest Timing Analyzer report for FPz8_Cyclone_IV
Fri Nov 11 10:25:14 2016
Quartus II Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web Edition


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; Table of Contents ;
---------------------
  1. Legal Notice
  2. TimeQuest Timing Analyzer Summary
  3. Parallel Compilation
  4. SDC File List
  5. Clocks
  6. Slow 1200mV 85C Model Fmax Summary
  7. Slow 1200mV 85C Model Setup Summary
  8. Slow 1200mV 85C Model Hold Summary
  9. Slow 1200mV 85C Model Recovery Summary
 10. Slow 1200mV 85C Model Removal Summary
 11. Slow 1200mV 85C Model Minimum Pulse Width Summary
 12. Slow 1200mV 85C Model Setup: 'CLOCK'
 13. Slow 1200mV 85C Model Hold: 'CLOCK'
 14. Slow 1200mV 85C Model Minimum Pulse Width: 'CLOCK'
 15. Setup Times
 16. Hold Times
 17. Clock to Output Times
 18. Minimum Clock to Output Times
 19. Slow 1200mV 85C Model Metastability Report
 20. Slow 1200mV 0C Model Fmax Summary
 21. Slow 1200mV 0C Model Setup Summary
 22. Slow 1200mV 0C Model Hold Summary
 23. Slow 1200mV 0C Model Recovery Summary
 24. Slow 1200mV 0C Model Removal Summary
 25. Slow 1200mV 0C Model Minimum Pulse Width Summary
 26. Slow 1200mV 0C Model Setup: 'CLOCK'
 27. Slow 1200mV 0C Model Hold: 'CLOCK'
 28. Slow 1200mV 0C Model Minimum Pulse Width: 'CLOCK'
 29. Setup Times
 30. Hold Times
 31. Clock to Output Times
 32. Minimum Clock to Output Times
 33. Slow 1200mV 0C Model Metastability Report
 34. Fast 1200mV 0C Model Setup Summary
 35. Fast 1200mV 0C Model Hold Summary
 36. Fast 1200mV 0C Model Recovery Summary
 37. Fast 1200mV 0C Model Removal Summary
 38. Fast 1200mV 0C Model Minimum Pulse Width Summary
 39. Fast 1200mV 0C Model Setup: 'CLOCK'
 40. Fast 1200mV 0C Model Hold: 'CLOCK'
 41. Fast 1200mV 0C Model Minimum Pulse Width: 'CLOCK'
 42. Setup Times
 43. Hold Times
 44. Clock to Output Times
 45. Minimum Clock to Output Times
 46. Fast 1200mV 0C Model Metastability Report
 47. Multicorner Timing Analysis Summary
 48. Setup Times
 49. Hold Times
 50. Clock to Output Times
 51. Minimum Clock to Output Times
 52. Board Trace Model Assignments
 53. Input Transition Times
 54. Slow Corner Signal Integrity Metrics
 55. Fast Corner Signal Integrity Metrics
 56. Setup Transfers
 57. Hold Transfers
 58. Report TCCS
 59. Report RSKM
 60. Unconstrained Paths
 61. TimeQuest Timing Analyzer Messages



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; Legal Notice ;
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Copyright (C) 1991-2010 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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without limitation, that your use is for the sole purpose of 
programming logic devices manufactured by Altera and sold by 
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+-------------------------------------------------------------------------------------+
; TimeQuest Timing Analyzer Summary                                                   ;
+--------------------+----------------------------------------------------------------+
; Quartus II Version ; Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web Edition ;
; Revision Name      ; FPz8_Cyclone_IV                                                ;
; Device Family      ; Cyclone IV E                                                   ;
; Device Name        ; EP4CE6E22C8                                                    ;
; Timing Models      ; Preliminary                                                    ;
; Delay Model        ; Combined                                                       ;
; Rise/Fall Delays   ; Enabled                                                        ;
+--------------------+----------------------------------------------------------------+


Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4      ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


+-------------------------------------------------------------+
; SDC File List                                               ;
+-------------------------+--------+--------------------------+
; SDC File Path           ; Status ; Read at                  ;
+-------------------------+--------+--------------------------+
; FPz8_Cyclone_IV.out.sdc ; OK     ; Fri Nov 11 10:25:03 2016 ;
+-------------------------+--------+--------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clocks                                                                                                                                                                            ;
+------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+-----------+
; Clock Name ; Type ; Period ; Frequency  ; Rise  ; Fall  ; Duty Cycle ; Divide by ; Multiply by ; Phase ; Offset ; Edge List ; Edge Shift ; Inverted ; Master ; Source ; Targets   ;
+------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+-----------+
; CLOCK      ; Base ; 1.000  ; 1000.0 MHz ; 0.000 ; 0.500 ;            ;           ;             ;       ;        ;           ;            ;          ;        ;        ; { CLOCK } ;
+------------+------+--------+------------+-------+-------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+-----------+


+-------------------------------------------------+
; Slow 1200mV 85C Model Fmax Summary              ;
+-----------+-----------------+------------+------+
; Fmax      ; Restricted Fmax ; Clock Name ; Note ;
+-----------+-----------------+------------+------+
; 21.13 MHz ; 21.13 MHz       ; CLOCK      ;      ;
+-----------+-----------------+------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods.  FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock.  Paths of different clocks, including generated clocks, are ignored.  For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.


+-------------------------------------+
; Slow 1200mV 85C Model Setup Summary ;
+-------+---------+-------------------+
; Clock ; Slack   ; End Point TNS     ;
+-------+---------+-------------------+
; CLOCK ; -26.441 ; -8505.086         ;
+-------+---------+-------------------+


+------------------------------------+
; Slow 1200mV 85C Model Hold Summary ;
+-------+-------+--------------------+
; Clock ; Slack ; End Point TNS      ;
+-------+-------+--------------------+
; CLOCK ; 0.432 ; 0.000              ;
+-------+-------+--------------------+


------------------------------------------
; Slow 1200mV 85C Model Recovery Summary ;
------------------------------------------
No paths to report.


-----------------------------------------
; Slow 1200mV 85C Model Removal Summary ;
-----------------------------------------
No paths to report.


+---------------------------------------------------+
; Slow 1200mV 85C Model Minimum Pulse Width Summary ;
+-------+--------+----------------------------------+
; Clock ; Slack  ; End Point TNS                    ;
+-------+--------+----------------------------------+
; CLOCK ; -3.201 ; -910.432                         ;
+-------+--------+----------------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'CLOCK'                                                                                                                                  ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+
; Slack   ; From Node                                    ; To Node                                ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+
; -26.441 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.081     ; 27.361     ;
; -26.305 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.081     ; 27.225     ;
; -25.869 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.788     ;
; -25.822 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.741     ;
; -25.770 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[1] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.081     ; 26.690     ;
; -25.758 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.106     ; 26.653     ;
; -25.705 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[2] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.624     ;
; -25.668 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[5] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.081     ; 26.588     ;
; -25.631 ; fpz8_cpu_v1:inst|IRQ0ENH[1]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.092     ; 26.540     ;
; -25.622 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.106     ; 26.517     ;
; -25.569 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.074     ; 26.496     ;
; -25.545 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[4] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.081     ; 26.465     ;
; -25.511 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[7] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.430     ;
; -25.493 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.104     ; 26.390     ;
; -25.489 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.092     ; 26.398     ;
; -25.434 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[3]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.106     ; 26.329     ;
; -25.433 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.074     ; 26.360     ;
; -25.401 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[6] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.320     ;
; -25.396 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[11]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.315     ;
; -25.393 ; fpz8_cpu_v1:inst|IRQ0ENH[5]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.091     ; 26.303     ;
; -25.378 ; fpz8_cpu_v1:inst|IRQ0[4]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.091     ; 26.288     ;
; -25.366 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[14]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.104     ; 26.263     ;
; -25.357 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.104     ; 26.254     ;
; -25.355 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[0]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.085     ; 26.271     ;
; -25.352 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[13]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.088     ; 26.265     ;
; -25.343 ; fpz8_cpu_v1:inst|IRQ0[1]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.093     ; 26.251     ;
; -25.328 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[10]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.083     ; 26.246     ;
; -25.299 ; fpz8_cpu_v1:inst|IRQ0ENL[0]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.092     ; 26.208     ;
; -25.298 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[3]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.106     ; 26.193     ;
; -25.260 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[11]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 26.179     ;
; -25.236 ; fpz8_cpu_v1:inst|IRQ0[0]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.093     ; 26.144     ;
; -25.232 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[7]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.075     ; 26.158     ;
; -25.230 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[14]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.104     ; 26.127     ;
; -25.219 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[0]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.085     ; 26.135     ;
; -25.216 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[13]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.088     ; 26.129     ;
; -25.212 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[12]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.104     ; 26.109     ;
; -25.200 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.083     ; 26.118     ;
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+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'CLOCK'                                                                                                                                                     ;
+-------+-----------------------------------------------------+-----------------------------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node                                           ; To Node                                             ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------------------------------------------+-----------------------------------------------------+--------------+-------------+--------------+------------+------------+
; 0.432 ; fpz8_cpu_v1:inst|IRQ0[7]                            ; fpz8_cpu_v1:inst|IRQ0[7]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|IRQ0[4]                            ; fpz8_cpu_v1:inst|IRQ0[4]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|IRQ0[5]                            ; fpz8_cpu_v1:inst|IRQ0[5]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|IRQ0[6]                            ; fpz8_cpu_v1:inst|IRQ0[6]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|IRQ0[1]                            ; fpz8_cpu_v1:inst|IRQ0[1]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
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; 0.432 ; fpz8_cpu_v1:inst|CPU_FLAGS.V                        ; fpz8_cpu_v1:inst|CPU_FLAGS.V                        ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
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; 0.432 ; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[4]        ; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[4]        ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[5]        ; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[5]        ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|\main:DBG_UART.TXCNT[1]            ; fpz8_cpu_v1:inst|\main:DBG_UART.TXCNT[1]            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
; 0.432 ; fpz8_cpu_v1:inst|\main:DBG_UART.TXCNT[2]            ; fpz8_cpu_v1:inst|\main:DBG_UART.TXCNT[2]            ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
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; 0.432 ; fpz8_cpu_v1:inst|\main:ATM_COUNTER[1]               ; fpz8_cpu_v1:inst|\main:ATM_COUNTER[1]               ; CLOCK        ; CLOCK       ; 0.000        ; 0.082      ; 0.746      ;
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; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_address_reg0  ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_datain_reg0   ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_we_reg        ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_address_reg0  ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_datain_reg0   ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_we_reg        ;
; -3.000 ; 1.000        ; 4.000          ; Port Rate  ; CLOCK ; Rise       ; CLOCK                                                                                                                      ;
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; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.C                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.H                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.S                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.V                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.Z                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.C                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.D                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.F1                                                                                              ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.F2                                                                                              ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.H                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.S                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.V                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.Z                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|DBG_TX                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[0]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[1]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[2]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[7]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[0]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[10]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[11]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[12]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[13]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[1]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[2]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[3]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[4]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[5]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[6]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[7]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[8]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[9]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[0]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[1]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[2]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[3]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[4]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[5]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[6]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[7]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[0]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[1]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[2]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[3]                                                                                                ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+


+-----------------------------------------------------------------------+
; Setup Times                                                           ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.279 ; 0.485 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; 7.699 ; 8.228 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-------------------------------------------------------------------------+
; Hold Times                                                              ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise   ; Fall   ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.206  ; -0.008 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; -1.507 ; -1.769 ; Rise       ; CLOCK           ;
+-----------+------------+--------+--------+------------+-----------------+


+-----------------------------------------------------------------------+
; Clock to Output Times                                                 ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 7.165 ; 7.071 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 9.070 ; 9.000 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 7.699 ; 7.560 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 7.832 ; 7.656 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 7.578 ; 7.452 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 7.472 ; 7.354 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 9.070 ; 9.000 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 7.332 ; 7.221 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 7.464 ; 7.309 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 7.445 ; 7.306 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-----------------------------------------------------------------------+
; Minimum Clock to Output Times                                         ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 6.915 ; 6.825 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 7.073 ; 6.965 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 7.429 ; 7.295 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 7.556 ; 7.387 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 7.313 ; 7.191 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 7.211 ; 7.098 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 8.799 ; 8.735 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 7.073 ; 6.965 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 7.200 ; 7.050 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 7.181 ; 7.047 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


----------------------------------------------
; Slow 1200mV 85C Model Metastability Report ;
----------------------------------------------
No synchronizer chains to report.


+-------------------------------------------------+
; Slow 1200mV 0C Model Fmax Summary               ;
+-----------+-----------------+------------+------+
; Fmax      ; Restricted Fmax ; Clock Name ; Note ;
+-----------+-----------------+------------+------+
; 22.45 MHz ; 22.45 MHz       ; CLOCK      ;      ;
+-----------+-----------------+------------+------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods.  FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock.  Paths of different clocks, including generated clocks, are ignored.  For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.


+------------------------------------+
; Slow 1200mV 0C Model Setup Summary ;
+-------+---------+------------------+
; Clock ; Slack   ; End Point TNS    ;
+-------+---------+------------------+
; CLOCK ; -24.794 ; -7986.414        ;
+-------+---------+------------------+


+-----------------------------------+
; Slow 1200mV 0C Model Hold Summary ;
+-------+-------+-------------------+
; Clock ; Slack ; End Point TNS     ;
+-------+-------+-------------------+
; CLOCK ; 0.380 ; 0.000             ;
+-------+-------+-------------------+


-----------------------------------------
; Slow 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.


----------------------------------------
; Slow 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.


+--------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width Summary ;
+-------+--------+---------------------------------+
; Clock ; Slack  ; End Point TNS                   ;
+-------+--------+---------------------------------+
; CLOCK ; -3.201 ; -910.432                        ;
+-------+--------+---------------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'CLOCK'                                                                                                                                   ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+
; Slack   ; From Node                                    ; To Node                                ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+
; -24.794 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.073     ; 25.723     ;
; -24.709 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.073     ; 25.638     ;
; -24.428 ; fpz8_cpu_v1:inst|IRQ0ENH[1]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.083     ; 25.347     ;
; -24.309 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.074     ; 25.237     ;
; -24.216 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.083     ; 25.135     ;
; -24.187 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[1] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.073     ; 25.116     ;
; -24.187 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.074     ; 25.115     ;
; -24.107 ; fpz8_cpu_v1:inst|IRQ0[1]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.085     ; 25.024     ;
; -24.104 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.097     ; 25.009     ;
; -24.094 ; fpz8_cpu_v1:inst|IRQ0ENH[5]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 25.014     ;
; -24.083 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[2] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.074     ; 25.011     ;
; -24.077 ; fpz8_cpu_v1:inst|IRQ0[4]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 24.997     ;
; -24.048 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[5] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.073     ; 24.977     ;
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; -23.384 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.068     ; 24.318     ;
; -23.381 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[12] ; CLOCK        ; CLOCK       ; 1.000        ; -0.092     ; 24.291     ;
; -23.376 ; fpz8_cpu_v1:inst|IRQ0[1]                     ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.109     ; 24.269     ;
; -23.372 ; fpz8_cpu_v1:inst|IRQ0ENH[7]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.083     ; 24.291     ;
; -23.366 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[7]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 24.286     ;
; -23.365 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[8]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.082     ; 24.285     ;
; -23.363 ; fpz8_cpu_v1:inst|IRQ0ENH[5]                  ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.106     ; 24.259     ;
; -23.363 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[9] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.074     ; 24.291     ;
; -23.362 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[9]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.079     ; 24.285     ;
; -23.358 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[5] ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.097     ; 24.263     ;
; -23.353 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[12]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.095     ; 24.260     ;
; -23.346 ; fpz8_cpu_v1:inst|IRQ0[4]                     ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.106     ; 24.242     ;
; -23.341 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[10]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.092     ; 24.251     ;
; -23.340 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[11]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.076     ; 24.266     ;
; -23.339 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.077     ; 24.264     ;
; -23.327 ; fpz8_cpu_v1:inst|IRQ0[5]                     ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.079     ; 24.250     ;
; -23.325 ; fpz8_cpu_v1:inst|IRQ0ENH[1]                  ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.115     ; 24.212     ;
; -23.322 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[5]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.078     ; 24.246     ;
; -23.316 ; fpz8_cpu_v1:inst|IRQ0ENL[7]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.083     ; 24.235     ;
; -23.312 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[14] ; CLOCK        ; CLOCK       ; 1.000        ; -0.077     ; 24.237     ;
; -23.298 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.096     ; 24.204     ;
; -23.293 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[1]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.072     ; 24.223     ;
; -23.292 ; fpz8_cpu_v1:inst|\main:IQUEUE.WRPOS[0]       ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.061     ; 24.233     ;
; -23.283 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[3]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.098     ; 24.187     ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'CLOCK'                                                                                                                                                      ;
+-------+-----------------------------------------------------+-----------------------------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node                                           ; To Node                                             ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------------------------------------------+-----------------------------------------------------+--------------+-------------+--------------+------------+------------+
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[7]                            ; fpz8_cpu_v1:inst|IRQ0[7]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[4]                            ; fpz8_cpu_v1:inst|IRQ0[4]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[5]                            ; fpz8_cpu_v1:inst|IRQ0[5]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[6]                            ; fpz8_cpu_v1:inst|IRQ0[6]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[1]                            ; fpz8_cpu_v1:inst|IRQ0[1]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[3]                            ; fpz8_cpu_v1:inst|IRQ0[3]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[2]                            ; fpz8_cpu_v1:inst|IRQ0[2]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|IRQ0[0]                            ; fpz8_cpu_v1:inst|IRQ0[0]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|CPU_FLAGS.V                        ; fpz8_cpu_v1:inst|CPU_FLAGS.V                        ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|CPU_FLAGS.S                        ; fpz8_cpu_v1:inst|CPU_FLAGS.S                        ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|CPU_FLAGS.Z                        ; fpz8_cpu_v1:inst|CPU_FLAGS.Z                        ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|FCTL[2]                            ; fpz8_cpu_v1:inst|FCTL[2]                            ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.380 ; fpz8_cpu_v1:inst|ALU_FLAGS.H                        ; fpz8_cpu_v1:inst|ALU_FLAGS.H                        ; CLOCK        ; CLOCK       ; 0.000        ; 0.074      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[0]            ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[0]            ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[2]            ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[2]            ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[1]            ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[1]            ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[3]            ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[3]            ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:DBG_CMD.DBG_EXEC2            ; fpz8_cpu_v1:inst|\main:DBG_CMD.DBG_EXEC2            ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:CPU_STATE.CPU_LDW2           ; fpz8_cpu_v1:inst|\main:CPU_STATE.CPU_LDW2           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][3]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][3]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][3]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][3]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[5][5]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[5][5]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[0][3]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[0][3]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][2]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][2]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[0][2]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[0][2]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][2]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][2]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][7]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][7]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][6]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][6]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][1]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][1]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][5]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][5]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
; 0.381 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][0]           ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[4][0]           ; CLOCK        ; CLOCK       ; 0.000        ; 0.073      ; 0.669      ;
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+-------+-----------------------------------------------------+-----------------------------------------------------+--------------+-------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width: 'CLOCK'                                                                                                                                                     ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type       ; Clock ; Clock Edge ; Target                                                                                                                     ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a0~porta_address_reg0  ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a0~porta_datain_reg0   ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a0~porta_we_reg        ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a4~porta_address_reg0  ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a4~porta_datain_reg0   ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a4~porta_we_reg        ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a0~porta_address_reg0  ;
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; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a10~porta_address_reg0 ;
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; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a11~porta_address_reg0 ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a11~porta_datain_reg0  ;
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; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a7~porta_address_reg0  ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a7~porta_datain_reg0   ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a7~porta_we_reg        ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_address_reg0  ;
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; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_we_reg        ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_address_reg0  ;
; -3.201 ; 1.000        ; 4.201          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_datain_reg0   ;
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; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.H                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.S                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.V                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.Z                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.C                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.D                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.F1                                                                                              ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.F2                                                                                              ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.H                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.S                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.V                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.Z                                                                                               ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|DBG_TX                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[0]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[1]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[2]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[7]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[0]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[10]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[11]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[12]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[13]                                                                                                   ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[1]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[2]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[3]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[4]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[5]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[6]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[7]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[8]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[9]                                                                                                    ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[0]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[1]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[2]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[3]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[4]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[5]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[6]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[7]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[0]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[1]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[2]                                                                                                ;
; -1.487 ; 1.000        ; 2.487          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[3]                                                                                                ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+


+-----------------------------------------------------------------------+
; Setup Times                                                           ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.243 ; 0.565 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; 6.928 ; 7.992 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-------------------------------------------------------------------------+
; Hold Times                                                              ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise   ; Fall   ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.189  ; -0.129 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; -1.364 ; -1.806 ; Rise       ; CLOCK           ;
+-----------+------------+--------+--------+------------+-----------------+


+-----------------------------------------------------------------------+
; Clock to Output Times                                                 ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 6.868 ; 6.718 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 8.797 ; 8.602 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 7.426 ; 7.133 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 7.563 ; 7.230 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 7.268 ; 7.037 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 7.183 ; 6.968 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 8.797 ; 8.602 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 7.042 ; 6.832 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 7.172 ; 6.916 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 7.146 ; 6.915 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-----------------------------------------------------------------------+
; Minimum Clock to Output Times                                         ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 6.623 ; 6.479 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 6.788 ; 6.585 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 7.159 ; 6.878 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 7.291 ; 6.971 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 7.008 ; 6.786 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 6.926 ; 6.720 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 8.530 ; 8.346 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 6.788 ; 6.585 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 6.912 ; 6.666 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 6.886 ; 6.663 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


---------------------------------------------
; Slow 1200mV 0C Model Metastability Report ;
---------------------------------------------
No synchronizer chains to report.


+------------------------------------+
; Fast 1200mV 0C Model Setup Summary ;
+-------+---------+------------------+
; Clock ; Slack   ; End Point TNS    ;
+-------+---------+------------------+
; CLOCK ; -10.913 ; -3387.206        ;
+-------+---------+------------------+


+-----------------------------------+
; Fast 1200mV 0C Model Hold Summary ;
+-------+-------+-------------------+
; Clock ; Slack ; End Point TNS     ;
+-------+-------+-------------------+
; CLOCK ; 0.166 ; 0.000             ;
+-------+-------+-------------------+


-----------------------------------------
; Fast 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.


----------------------------------------
; Fast 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.


+--------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width Summary ;
+-------+--------+---------------------------------+
; Clock ; Slack  ; End Point TNS                   ;
+-------+--------+---------------------------------+
; CLOCK ; -3.000 ; -587.993                        ;
+-------+--------+---------------------------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'CLOCK'                                                                                                                                   ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+
; Slack   ; From Node                                    ; To Node                                ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+
; -10.913 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.045     ; 11.855     ;
; -10.860 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.045     ; 11.802     ;
; -10.674 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.615     ;
; -10.672 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.049     ; 11.610     ;
; -10.652 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.593     ;
; -10.627 ; fpz8_cpu_v1:inst|IRQ0[4]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.049     ; 11.565     ;
; -10.627 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[1] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.045     ; 11.569     ;
; -10.607 ; fpz8_cpu_v1:inst|IRQ0ENH[1]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.050     ; 11.544     ;
; -10.594 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[2] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.535     ;
; -10.583 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[5] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.045     ; 11.525     ;
; -10.577 ; fpz8_cpu_v1:inst|IRQ0ENH[5]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.049     ; 11.515     ;
; -10.538 ; fpz8_cpu_v1:inst|IRQ0[5]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.474     ;
; -10.519 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[4] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.045     ; 11.461     ;
; -10.511 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[7] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.452     ;
; -10.498 ; fpz8_cpu_v1:inst|IRQ0[7]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.434     ;
; -10.461 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.397     ;
; -10.458 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[6] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.399     ;
; -10.429 ; fpz8_cpu_v1:inst|IRQ0[1]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.365     ;
; -10.428 ; fpz8_cpu_v1:inst|IRQ0ENL[4]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.364     ;
; -10.417 ; fpz8_cpu_v1:inst|IRQ0ENL[0]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.050     ; 11.354     ;
; -10.417 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[0]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.042     ; 11.362     ;
; -10.409 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.036     ; 11.360     ;
; -10.408 ; fpz8_cpu_v1:inst|IRQ0[0]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.344     ;
; -10.408 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.344     ;
; -10.398 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.041     ; 11.344     ;
; -10.394 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[14]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.330     ;
; -10.385 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[13]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.044     ; 11.328     ;
; -10.364 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[0]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.042     ; 11.309     ;
; -10.360 ; fpz8_cpu_v1:inst|IRQ0ENH[6]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.049     ; 11.298     ;
; -10.356 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.036     ; 11.307     ;
; -10.348 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[10]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.039     ; 11.296     ;
; -10.347 ; fpz8_cpu_v1:inst|\main:IQUEUE.FULL           ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.044     ; 11.290     ;
; -10.346 ; fpz8_cpu_v1:inst|IRQ0ENL[1]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.282     ;
; -10.345 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.041     ; 11.291     ;
; -10.341 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[14]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.277     ;
; -10.332 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[13]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.044     ; 11.275     ;
; -10.321 ; fpz8_cpu_v1:inst|IRQ0[3]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.257     ;
; -10.320 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[12]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.256     ;
; -10.314 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[4]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.035     ; 11.266     ;
; -10.314 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[11]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.039     ; 11.262     ;
; -10.298 ; fpz8_cpu_v1:inst|\main:CAN_FETCH             ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.030     ; 11.255     ;
; -10.298 ; fpz8_cpu_v1:inst|IRQ0[2]                     ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.049     ; 11.236     ;
; -10.295 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[10]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.039     ; 11.243     ;
; -10.290 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[3]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.056     ; 11.221     ;
; -10.289 ; fpz8_cpu_v1:inst|IRQ0ENH[0]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.049     ; 11.227     ;
; -10.285 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[6]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.036     ; 11.236     ;
; -10.280 ; fpz8_cpu_v1:inst|IRQ0ENH[7]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.050     ; 11.217     ;
; -10.279 ; fpz8_cpu_v1:inst|IRQ0ENL[5]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.050     ; 11.216     ;
; -10.267 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[12]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.203     ;
; -10.264 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[10]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.200     ;
; -10.261 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[8]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.044     ; 11.204     ;
; -10.261 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[4]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.035     ; 11.213     ;
; -10.261 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[11]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.039     ; 11.209     ;
; -10.240 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.040     ; 11.187     ;
; -10.237 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[3]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.056     ; 11.168     ;
; -10.232 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[6]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.036     ; 11.183     ;
; -10.231 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[9]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.043     ; 11.175     ;
; -10.229 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.055     ; 11.161     ;
; -10.228 ; fpz8_cpu_v1:inst|\main:IQUEUE.WRPOS[0]       ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.038     ; 11.177     ;
; -10.224 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[8] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.165     ;
; -10.223 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[5]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.035     ; 11.175     ;
; -10.222 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.052     ; 11.157     ;
; -10.218 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[7]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.037     ; 11.168     ;
; -10.215 ; fpz8_cpu_v1:inst|IRQ0ENL[7]                  ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.050     ; 11.152     ;
; -10.211 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[10]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.147     ;
; -10.208 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[8]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.044     ; 11.151     ;
; -10.205 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:PC[5]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.041     ; 11.151     ;
; -10.200 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.053     ; 11.134     ;
; -10.200 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.052     ; 11.135     ;
; -10.195 ; fpz8_cpu_v1:inst|IRQ0[4]                     ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.040     ; 11.142     ;
; -10.188 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[9] ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.046     ; 11.129     ;
; -10.178 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[9]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.043     ; 11.122     ;
; -10.178 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[0]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.043     ; 11.122     ;
; -10.176 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[6]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.055     ; 11.108     ;
; -10.175 ; fpz8_cpu_v1:inst|IRQ0ENH[1]                  ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.041     ; 11.121     ;
; -10.175 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[1] ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.051     ; 11.111     ;
; -10.170 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|MAB[8]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.039     ; 11.118     ;
; -10.170 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.037     ; 11.120     ;
; -10.170 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[5]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.035     ; 11.122     ;
; -10.168 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[7]  ; CLOCK        ; CLOCK       ; 1.000        ; -0.044     ; 11.111     ;
; -10.165 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|MAB[7]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.037     ; 11.115     ;
; -10.161 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|MAB[10]               ; CLOCK        ; CLOCK       ; 1.000        ; -0.043     ; 11.105     ;
; -10.161 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[12] ; CLOCK        ; CLOCK       ; 1.000        ; -0.050     ; 11.098     ;
; -10.159 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.042     ; 11.104     ;
; -10.156 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.063     ; 11.080     ;
; -10.156 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|MAB[0]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.043     ; 11.100     ;
; -10.155 ; fpz8_cpu_v1:inst|IRQ0[4]                     ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.053     ; 11.089     ;
; -10.155 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|\main:PC[14]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.052     ; 11.090     ;
; -10.152 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[0]   ; fpz8_cpu_v1:inst|\main:PC[5]           ; CLOCK        ; CLOCK       ; 1.000        ; -0.041     ; 11.098     ;
; -10.151 ; fpz8_cpu_v1:inst|\main:IQUEUE.RDPOS[1]       ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.034     ; 11.104     ;
; -10.150 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[14] ; CLOCK        ; CLOCK       ; 1.000        ; -0.041     ; 11.096     ;
; -10.149 ; fpz8_cpu_v1:inst|IRQ0ENH[4]                  ; fpz8_cpu_v1:inst|\main:PC[14]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.063     ; 11.073     ;
; -10.149 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDPRE[1]   ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[11] ; CLOCK        ; CLOCK       ; 1.000        ; -0.042     ; 11.094     ;
; -10.148 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.037     ; 11.098     ;
; -10.146 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[0] ; fpz8_cpu_v1:inst|\main:PC[13]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.045     ; 11.088     ;
; -10.145 ; fpz8_cpu_v1:inst|IRQ0ENH[5]                  ; fpz8_cpu_v1:inst|MAB[9]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.040     ; 11.092     ;
; -10.142 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[2] ; fpz8_cpu_v1:inst|\main:PC[15]          ; CLOCK        ; CLOCK       ; 1.000        ; -0.052     ; 11.077     ;
; -10.137 ; fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[3] ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.042     ; 11.082     ;
; -10.135 ; fpz8_cpu_v1:inst|\main:IQUEUE.WRPOS[1]       ; fpz8_cpu_v1:inst|MAB[2]                ; CLOCK        ; CLOCK       ; 1.000        ; -0.038     ; 11.084     ;
; -10.135 ; fpz8_cpu_v1:inst|IRQ0ENH[1]                  ; fpz8_cpu_v1:inst|\main:DEST_ADDR16[15] ; CLOCK        ; CLOCK       ; 1.000        ; -0.054     ; 11.068     ;
+---------+----------------------------------------------+----------------------------------------+--------------+-------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'CLOCK'                                                                                                                                          ;
+-------+-----------------------------------------------+-----------------------------------------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node                                     ; To Node                                       ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------------------------------------+-----------------------------------------------+--------------+-------------+--------------+------------+------------+
; 0.166 ; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[3]  ; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[3]  ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[7]                      ; fpz8_cpu_v1:inst|IRQ0[7]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|\main:DBG_UART.RX_DATA[4]    ; fpz8_cpu_v1:inst|\main:DBG_UART.RX_DATA[4]    ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[4]                      ; fpz8_cpu_v1:inst|IRQ0[4]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[5]                      ; fpz8_cpu_v1:inst|IRQ0[5]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[6]                      ; fpz8_cpu_v1:inst|IRQ0[6]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[1]                      ; fpz8_cpu_v1:inst|IRQ0[1]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[3]                      ; fpz8_cpu_v1:inst|IRQ0[3]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[2]                      ; fpz8_cpu_v1:inst|IRQ0[2]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|IRQ0[0]                      ; fpz8_cpu_v1:inst|IRQ0[0]                      ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|\main:DBG_UART.RX_DATA[3]    ; fpz8_cpu_v1:inst|\main:DBG_UART.RX_DATA[3]    ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|\main:CPU_STATE.CPU_LDW2     ; fpz8_cpu_v1:inst|\main:CPU_STATE.CPU_LDW2     ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|CPU_FLAGS.V                  ; fpz8_cpu_v1:inst|CPU_FLAGS.V                  ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
; 0.166 ; fpz8_cpu_v1:inst|CPU_FLAGS.S                  ; fpz8_cpu_v1:inst|CPU_FLAGS.S                  ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
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; 0.166 ; fpz8_cpu_v1:inst|\main:CPU_STATE.CPU_LDPTOIM2 ; fpz8_cpu_v1:inst|\main:CPU_STATE.CPU_LDPTOIM2 ; CLOCK        ; CLOCK       ; 0.000        ; 0.037      ; 0.307      ;
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; 0.167 ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[1]      ; fpz8_cpu_v1:inst|\main:DBG_UART.RXCNT[1]      ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
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; 0.167 ; fpz8_cpu_v1:inst|\main:OCDCR.RST              ; fpz8_cpu_v1:inst|\main:OCDCR.RST              ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
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; 0.167 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][3]     ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][3]     ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
; 0.167 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][5]     ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][5]     ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
; 0.167 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[5][5]     ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[5][5]     ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
; 0.167 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][3]     ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[3][3]     ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
; 0.167 ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][2]     ; fpz8_cpu_v1:inst|\main:IQUEUE.QUEUE[7][2]     ; CLOCK        ; CLOCK       ; 0.000        ; 0.036      ; 0.307      ;
+-------+-----------------------------------------------+-----------------------------------------------+--------------+-------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width: 'CLOCK'                                                                                                                                                     ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+
; Slack  ; Actual Width ; Required Width ; Type       ; Clock ; Clock Edge ; Target                                                                                                                     ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+
; -3.000 ; 1.000        ; 4.000          ; Port Rate  ; CLOCK ; Rise       ; CLOCK                                                                                                                      ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a0~porta_address_reg0  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a0~porta_datain_reg0   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a0~porta_we_reg        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a4~porta_address_reg0  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram1:File_Registers|altsyncram:altsyncram_component|altsyncram_t2b1:auto_generated|ram_block1a4~porta_datain_reg0   ;
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; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a0~porta_datain_reg0   ;
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; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_datain_reg0   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a8~porta_we_reg        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_address_reg0  ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_datain_reg0   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Fall       ; altsyncram2:Program_Memory|altsyncram:altsyncram_component|altsyncram_7le1:auto_generated|ram_block1a9~porta_we_reg        ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.C                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.H                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.S                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.V                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|ALU_FLAGS.Z                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.C                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.D                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.F1                                                                                              ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.F2                                                                                              ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.H                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.S                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.V                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|CPU_FLAGS.Z                                                                                               ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|DBG_TX                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[0]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[1]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[2]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|FCTL[7]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[0]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[10]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[11]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[12]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[13]                                                                                                   ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[1]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[2]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[3]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[4]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[5]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[6]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[7]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[8]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IAB[9]                                                                                                    ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[0]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[1]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[2]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[3]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[4]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[5]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[6]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENH[7]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[0]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[1]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[2]                                                                                                ;
; -1.000 ; 1.000        ; 2.000          ; Min Period ; CLOCK ; Rise       ; fpz8_cpu_v1:inst|IRQ0ENL[3]                                                                                                ;
+--------+--------------+----------------+------------+-------+------------+----------------------------------------------------------------------------------------------------------------------------+


+-----------------------------------------------------------------------+
; Setup Times                                                           ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.157 ; 0.449 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; 3.725 ; 3.615 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-------------------------------------------------------------------------+
; Hold Times                                                              ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise   ; Fall   ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.057  ; -0.247 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; -0.714 ; -0.959 ; Rise       ; CLOCK           ;
+-----------+------------+--------+--------+------------+-----------------+


+-----------------------------------------------------------------------+
; Clock to Output Times                                                 ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 3.352 ; 3.451 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 4.455 ; 4.617 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 3.563 ; 3.689 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 3.637 ; 3.749 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 3.520 ; 3.637 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 3.481 ; 3.595 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 4.455 ; 4.617 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 3.422 ; 3.498 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 3.446 ; 3.545 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 3.463 ; 3.555 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-----------------------------------------------------------------------+
; Minimum Clock to Output Times                                         ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 3.247 ; 3.343 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 3.312 ; 3.386 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 3.450 ; 3.572 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 3.521 ; 3.630 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 3.408 ; 3.522 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 3.372 ; 3.482 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 4.341 ; 4.500 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 3.312 ; 3.386 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 3.336 ; 3.431 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 3.352 ; 3.441 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


---------------------------------------------
; Fast 1200mV 0C Model Metastability Report ;
---------------------------------------------
No synchronizer chains to report.


+---------------------------------------------------------------------------------+
; Multicorner Timing Analysis Summary                                             ;
+------------------+-----------+-------+----------+---------+---------------------+
; Clock            ; Setup     ; Hold  ; Recovery ; Removal ; Minimum Pulse Width ;
+------------------+-----------+-------+----------+---------+---------------------+
; Worst-case Slack ; -26.441   ; 0.166 ; N/A      ; N/A     ; -3.201              ;
;  CLOCK           ; -26.441   ; 0.166 ; N/A      ; N/A     ; -3.201              ;
; Design-wide TNS  ; -8505.086 ; 0.0   ; 0.0      ; 0.0     ; -910.432            ;
;  CLOCK           ; -8505.086 ; 0.000 ; N/A      ; N/A     ; -910.432            ;
+------------------+-----------+-------+----------+---------+---------------------+


+-----------------------------------------------------------------------+
; Setup Times                                                           ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.279 ; 0.565 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; 7.699 ; 8.228 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-------------------------------------------------------------------------+
; Hold Times                                                              ;
+-----------+------------+--------+--------+------------+-----------------+
; Data Port ; Clock Port ; Rise   ; Fall   ; Clock Edge ; Clock Reference ;
+-----------+------------+--------+--------+------------+-----------------+
; DBG_RX    ; CLOCK      ; 0.206  ; -0.008 ; Rise       ; CLOCK           ;
; RESET     ; CLOCK      ; -0.714 ; -0.959 ; Rise       ; CLOCK           ;
+-----------+------------+--------+--------+------------+-----------------+


+-----------------------------------------------------------------------+
; Clock to Output Times                                                 ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 7.165 ; 7.071 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 9.070 ; 9.000 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 7.699 ; 7.560 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 7.832 ; 7.656 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 7.578 ; 7.452 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 7.472 ; 7.354 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 9.070 ; 9.000 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 7.332 ; 7.221 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 7.464 ; 7.309 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 7.445 ; 7.306 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+-----------------------------------------------------------------------+
; Minimum Clock to Output Times                                         ;
+-----------+------------+-------+-------+------------+-----------------+
; Data Port ; Clock Port ; Rise  ; Fall  ; Clock Edge ; Clock Reference ;
+-----------+------------+-------+-------+------------+-----------------+
; DBG_TX    ; CLOCK      ; 3.247 ; 3.343 ; Rise       ; CLOCK           ;
; PAOUT[*]  ; CLOCK      ; 3.312 ; 3.386 ; Rise       ; CLOCK           ;
;  PAOUT[0] ; CLOCK      ; 3.450 ; 3.572 ; Rise       ; CLOCK           ;
;  PAOUT[1] ; CLOCK      ; 3.521 ; 3.630 ; Rise       ; CLOCK           ;
;  PAOUT[2] ; CLOCK      ; 3.408 ; 3.522 ; Rise       ; CLOCK           ;
;  PAOUT[3] ; CLOCK      ; 3.372 ; 3.482 ; Rise       ; CLOCK           ;
;  PAOUT[4] ; CLOCK      ; 4.341 ; 4.500 ; Rise       ; CLOCK           ;
;  PAOUT[5] ; CLOCK      ; 3.312 ; 3.386 ; Rise       ; CLOCK           ;
;  PAOUT[6] ; CLOCK      ; 3.336 ; 3.431 ; Rise       ; CLOCK           ;
;  PAOUT[7] ; CLOCK      ; 3.352 ; 3.441 ; Rise       ; CLOCK           ;
+-----------+------------+-------+-------+------------+-----------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Board Trace Model Assignments                                                                                                                                                                                                                                                                                                                                    ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+
; Pin           ; I/O Standard ; Near Tline Length ; Near Tline L per Length ; Near Tline C per Length ; Near Series R ; Near Differential R ; Near Pull-up R ; Near Pull-down R ; Near C ; Far Tline Length ; Far Tline L per Length ; Far Tline C per Length ; Far Series R ; Far Pull-up R ; Far Pull-down R ; Far C ; Termination Voltage ; Far Differential R ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+
; DBG_TX        ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[7]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[6]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[5]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[4]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[3]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[2]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[1]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; PAOUT[0]      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; ~ALTERA_DCLK~ ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
; ~ALTERA_nCEO~ ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ;
+---------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+


+----------------------------------------------------------------------------+
; Input Transition Times                                                     ;
+-------------------------+--------------+-----------------+-----------------+
; Pin                     ; I/O Standard ; 10-90 Rise Time ; 90-10 Fall Time ;
+-------------------------+--------------+-----------------+-----------------+
; CLOCK                   ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; RESET                   ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; DBG_RX                  ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; ~ALTERA_ASDO_DATA1~     ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; ~ALTERA_FLASH_nCE_nCSO~ ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; ~ALTERA_DATA0~          ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
+-------------------------+--------------+-----------------+-----------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow Corner Signal Integrity Metrics                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin           ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; DBG_TX        ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.34 V              ; -0.00803 V          ; 0.14 V                               ; 0.045 V                              ; 6.89e-010 s                 ; 6.56e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.34 V             ; -0.00803 V         ; 0.14 V                              ; 0.045 V                             ; 6.89e-010 s                ; 6.56e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[7]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.35 V              ; -0.00735 V          ; 0.126 V                              ; 0.011 V                              ; 4.7e-010 s                  ; 4.63e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.35 V             ; -0.00735 V         ; 0.126 V                             ; 0.011 V                             ; 4.7e-010 s                 ; 4.63e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[6]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.35 V              ; -0.00735 V          ; 0.126 V                              ; 0.011 V                              ; 4.7e-010 s                  ; 4.63e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.35 V             ; -0.00735 V         ; 0.126 V                             ; 0.011 V                             ; 4.7e-010 s                 ; 4.63e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[5]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.35 V              ; -0.00735 V          ; 0.126 V                              ; 0.011 V                              ; 4.7e-010 s                  ; 4.63e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.35 V             ; -0.00735 V         ; 0.126 V                             ; 0.011 V                             ; 4.7e-010 s                 ; 4.63e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[4]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.33 V              ; -0.00219 V          ; 0.108 V                              ; 0.043 V                              ; 3.76e-009 s                 ; 3.48e-009 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.33 V             ; -0.00219 V         ; 0.108 V                             ; 0.043 V                             ; 3.76e-009 s                ; 3.48e-009 s                ; Yes                       ; Yes                       ;
; PAOUT[3]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.34 V              ; -0.00803 V          ; 0.14 V                               ; 0.045 V                              ; 6.89e-010 s                 ; 6.56e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.34 V             ; -0.00803 V         ; 0.14 V                              ; 0.045 V                             ; 6.89e-010 s                ; 6.56e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[2]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.34 V              ; -0.00803 V          ; 0.14 V                               ; 0.045 V                              ; 6.89e-010 s                 ; 6.56e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.34 V             ; -0.00803 V         ; 0.14 V                              ; 0.045 V                             ; 6.89e-010 s                ; 6.56e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[1]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.34 V              ; -0.00803 V          ; 0.14 V                               ; 0.045 V                              ; 6.89e-010 s                 ; 6.56e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.34 V             ; -0.00803 V         ; 0.14 V                              ; 0.045 V                             ; 6.89e-010 s                ; 6.56e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[0]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.91e-007 V                  ; 2.34 V              ; -0.00803 V          ; 0.14 V                               ; 0.045 V                              ; 6.89e-010 s                 ; 6.56e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.91e-007 V                 ; 2.34 V             ; -0.00803 V         ; 0.14 V                              ; 0.045 V                             ; 6.89e-010 s                ; 6.56e-010 s                ; Yes                       ; Yes                       ;
; ~ALTERA_DCLK~ ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.53e-007 V                  ; 2.35 V              ; -0.00333 V          ; 0.096 V                              ; 0.006 V                              ; 4.5e-010 s                  ; 3.85e-010 s                 ; Yes                        ; Yes                        ; 2.32 V                      ; 1.53e-007 V                 ; 2.35 V             ; -0.00333 V         ; 0.096 V                             ; 0.006 V                             ; 4.5e-010 s                 ; 3.85e-010 s                ; Yes                       ; Yes                       ;
; ~ALTERA_nCEO~ ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 2.51e-007 V                  ; 2.34 V              ; -0.00726 V          ; 0.108 V                              ; 0.026 V                              ; 6.58e-010 s                 ; 8.2e-010 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 2.51e-007 V                 ; 2.34 V             ; -0.00726 V         ; 0.108 V                             ; 0.026 V                             ; 6.58e-010 s                ; 8.2e-010 s                 ; Yes                       ; Yes                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast Corner Signal Integrity Metrics                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin           ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; DBG_TX        ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.71 V              ; -0.0352 V           ; 0.147 V                              ; 0.066 V                              ; 4.51e-010 s                 ; 4.15e-010 s                 ; No                         ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.71 V             ; -0.0352 V          ; 0.147 V                             ; 0.066 V                             ; 4.51e-010 s                ; 4.15e-010 s                ; No                        ; Yes                       ;
; PAOUT[7]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.72 V              ; -0.0401 V           ; 0.163 V                              ; 0.091 V                              ; 2.71e-010 s                 ; 2.61e-010 s                 ; Yes                        ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.72 V             ; -0.0401 V          ; 0.163 V                             ; 0.091 V                             ; 2.71e-010 s                ; 2.61e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[6]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.72 V              ; -0.0401 V           ; 0.163 V                              ; 0.091 V                              ; 2.71e-010 s                 ; 2.61e-010 s                 ; Yes                        ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.72 V             ; -0.0401 V          ; 0.163 V                             ; 0.091 V                             ; 2.71e-010 s                ; 2.61e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[5]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.72 V              ; -0.0401 V           ; 0.163 V                              ; 0.091 V                              ; 2.71e-010 s                 ; 2.61e-010 s                 ; Yes                        ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.72 V             ; -0.0401 V          ; 0.163 V                             ; 0.091 V                             ; 2.71e-010 s                ; 2.61e-010 s                ; Yes                       ; Yes                       ;
; PAOUT[4]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.64 V              ; -0.0118 V           ; 0.201 V                              ; 0.173 V                              ; 2.38e-009 s                 ; 2.19e-009 s                 ; No                         ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.64 V             ; -0.0118 V          ; 0.201 V                             ; 0.173 V                             ; 2.38e-009 s                ; 2.19e-009 s                ; No                        ; Yes                       ;
; PAOUT[3]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.71 V              ; -0.0352 V           ; 0.147 V                              ; 0.066 V                              ; 4.51e-010 s                 ; 4.15e-010 s                 ; No                         ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.71 V             ; -0.0352 V          ; 0.147 V                             ; 0.066 V                             ; 4.51e-010 s                ; 4.15e-010 s                ; No                        ; Yes                       ;
; PAOUT[2]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.71 V              ; -0.0352 V           ; 0.147 V                              ; 0.066 V                              ; 4.51e-010 s                 ; 4.15e-010 s                 ; No                         ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.71 V             ; -0.0352 V          ; 0.147 V                             ; 0.066 V                             ; 4.51e-010 s                ; 4.15e-010 s                ; No                        ; Yes                       ;
; PAOUT[1]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.71 V              ; -0.0352 V           ; 0.147 V                              ; 0.066 V                              ; 4.51e-010 s                 ; 4.15e-010 s                 ; No                         ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.71 V             ; -0.0352 V          ; 0.147 V                             ; 0.066 V                             ; 4.51e-010 s                ; 4.15e-010 s                ; No                        ; Yes                       ;
; PAOUT[0]      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.7e-008 V                   ; 2.71 V              ; -0.0352 V           ; 0.147 V                              ; 0.066 V                              ; 4.51e-010 s                 ; 4.15e-010 s                 ; No                         ; Yes                        ; 2.62 V                      ; 2.7e-008 V                  ; 2.71 V             ; -0.0352 V          ; 0.147 V                             ; 0.066 V                             ; 4.51e-010 s                ; 4.15e-010 s                ; No                        ; Yes                       ;
; ~ALTERA_DCLK~ ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.2e-008 V                   ; 2.74 V              ; -0.061 V            ; 0.159 V                              ; 0.078 V                              ; 2.7e-010 s                  ; 2.2e-010 s                  ; No                         ; Yes                        ; 2.62 V                      ; 2.2e-008 V                  ; 2.74 V             ; -0.061 V           ; 0.159 V                             ; 0.078 V                             ; 2.7e-010 s                 ; 2.2e-010 s                 ; No                        ; Yes                       ;
; ~ALTERA_nCEO~ ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 3.52e-008 V                  ; 2.7 V               ; -0.012 V            ; 0.274 V                              ; 0.034 V                              ; 3.18e-010 s                 ; 4.96e-010 s                 ; No                         ; Yes                        ; 2.62 V                      ; 3.52e-008 V                 ; 2.7 V              ; -0.012 V           ; 0.274 V                             ; 0.034 V                             ; 3.18e-010 s                ; 4.96e-010 s                ; No                        ; Yes                       ;
+---------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+-----------------------------------------------------------------------+
; Setup Transfers                                                       ;
+------------+----------+--------------+----------+----------+----------+
; From Clock ; To Clock ; RR Paths     ; FR Paths ; RF Paths ; FF Paths ;
+------------+----------+--------------+----------+----------+----------+
; CLOCK      ; CLOCK    ; > 2147483647 ; 15094538 ; 339      ; 0        ;
+------------+----------+--------------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.


+-----------------------------------------------------------------------+
; Hold Transfers                                                        ;
+------------+----------+--------------+----------+----------+----------+
; From Clock ; To Clock ; RR Paths     ; FR Paths ; RF Paths ; FF Paths ;
+------------+----------+--------------+----------+----------+----------+
; CLOCK      ; CLOCK    ; > 2147483647 ; 15094538 ; 339      ; 0        ;
+------------+----------+--------------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.


---------------
; Report TCCS ;
---------------
No dedicated SERDES Transmitter circuitry present in device or used in design


---------------
; Report RSKM ;
---------------
No dedicated SERDES Receiver circuitry present in device or used in design


+------------------------------------------------+
; Unconstrained Paths                            ;
+---------------------------------+-------+------+
; Property                        ; Setup ; Hold ;
+---------------------------------+-------+------+
; Illegal Clocks                  ; 0     ; 0    ;
; Unconstrained Clocks            ; 0     ; 0    ;
; Unconstrained Input Ports       ; 2     ; 2    ;
; Unconstrained Input Port Paths  ; 494   ; 494  ;
; Unconstrained Output Ports      ; 9     ; 9    ;
; Unconstrained Output Port Paths ; 9     ; 9    ;
+---------------------------------+-------+------+


+------------------------------------+
; TimeQuest Timing Analyzer Messages ;
+------------------------------------+
Info: *******************************************************************
Info: Running Quartus II TimeQuest Timing Analyzer
    Info: Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web Edition
    Info: Processing started: Fri Nov 11 10:25:00 2016
Info: Command: quartus_sta FPz8 -c FPz8_Cyclone_IV
Info: qsta_default_script.tcl version: #1
Info: Core supply voltage is 1.2V
Info: Low junction temperature is 0 degrees C
Info: High junction temperature is 85 degrees C
Info: Reading SDC File: 'FPz8_Cyclone_IV.out.sdc'
Info: Deriving Clocks
    Info: create_clock -period 1.000 -name CLOCK CLOCK
Info: Clock uncertainty calculation is delayed until the next update_timing_netlist call
Info: Deriving Clock Uncertainty
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -hold 0.020
Info: Analyzing Slow 1200mV 85C Model
Critical Warning: Timing requirements not met
Info: Worst-case setup slack is -26.441
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:   -26.441     -8505.086 CLOCK 
Info: Worst-case hold slack is 0.432
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:     0.432         0.000 CLOCK 
Info: No Recovery paths to report
Info: No Removal paths to report
Info: Worst-case minimum pulse width slack is -3.201
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -3.201      -910.432 CLOCK 
Info: Analyzing Slow 1200mV 0C Model
Info: Started post-fitting delay annotation
Warning: Timing characteristics of device EP4CE6E22C8 are preliminary
Info: Delay annotation completed successfully
Info: Deriving Clock Uncertainty
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -hold 0.020
Critical Warning: Timing requirements not met
Info: Worst-case setup slack is -24.794
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:   -24.794     -7986.414 CLOCK 
Info: Worst-case hold slack is 0.380
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:     0.380         0.000 CLOCK 
Info: No Recovery paths to report
Info: No Removal paths to report
Info: Worst-case minimum pulse width slack is -3.201
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -3.201      -910.432 CLOCK 
Info: Analyzing Fast 1200mV 0C Model
Info: Started post-fitting delay annotation
Warning: Timing characteristics of device EP4CE6E22C8 are preliminary
Info: Delay annotation completed successfully
Info: Deriving Clock Uncertainty
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -setup 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -rise_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -rise_to [get_clocks {CLOCK}] -hold 0.020
    Info: set_clock_uncertainty -fall_from [get_clocks {CLOCK}] -fall_to [get_clocks {CLOCK}] -hold 0.020
Critical Warning: Timing requirements not met
Info: Worst-case setup slack is -10.913
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:   -10.913     -3387.206 CLOCK 
Info: Worst-case hold slack is 0.166
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:     0.166         0.000 CLOCK 
Info: No Recovery paths to report
Info: No Removal paths to report
Info: Worst-case minimum pulse width slack is -3.000
    Info:     Slack End Point TNS Clock 
    Info: ========= ============= =====================
    Info:    -3.000      -587.993 CLOCK 
Info: Design is not fully constrained for setup requirements
Info: Design is not fully constrained for hold requirements
Info: Quartus II TimeQuest Timing Analyzer was successful. 0 errors, 5 warnings
    Info: Peak virtual memory: 258 megabytes
    Info: Processing ended: Fri Nov 11 10:25:14 2016
    Info: Elapsed time: 00:00:14
    Info: Total CPU time (on all processors): 00:00:11


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