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Analysis & Synthesis report for FPz8Thu Nov 10 23:29:21 2016Quartus II Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web Edition---------------------; Table of Contents ;---------------------1. Legal Notice2. Analysis & Synthesis Summary3. Analysis & Synthesis Settings4. Parallel Compilation5. Analysis & Synthesis Source Files Read6. Analysis & Synthesis Resource Usage Summary7. Analysis & Synthesis Resource Utilization by Entity8. Analysis & Synthesis RAM Summary9. Analysis & Synthesis DSP Block Usage Summary10. State Machine - |CPU|fpz8_cpu_v1:inst|\main:DBG_CMD11. State Machine - |CPU|fpz8_cpu_v1:inst|\main:CPU_STATE12. State Machine - |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.TX_STATE13. State Machine - |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.RX_STATE14. Registers Protected by Synthesis15. Registers Removed During Synthesis16. General Register Statistics17. Inverted Register Statistics18. Multiplexer Restructuring Statistics (Restructuring Performed)19. Source assignments for fpz8_cpu_v1:inst20. Source assignments for altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated21. Source assignments for altsyncram1:inst7|altsyncram:altsyncram_component|altsyncram_bua1:auto_generated22. Parameter Settings for User Entity Instance: altsyncram2:inst1|altsyncram:altsyncram_component23. Parameter Settings for User Entity Instance: altsyncram1:inst7|altsyncram:altsyncram_component24. Parameter Settings for Inferred Entity Instance: fpz8_cpu_v1:inst|lpm_mult:Mult025. altsyncram Parameter Settings by Entity Instance26. lpm_mult Parameter Settings by Entity Instance27. Analysis & Synthesis Messages----------------; Legal Notice ;----------------Copyright (C) 1991-2010 Altera CorporationYour use of Altera Corporation's design tools, logic functionsand other software and tools, and its AMPP partner logicfunctions, and any output files from any of the foregoing(including device programming or simulation files), and anyassociated documentation or information are expressly subjectto the terms and conditions of the Altera Program LicenseSubscription Agreement, Altera MegaCore Function LicenseAgreement, or other applicable license agreement, including,without limitation, that your use is for the sole purpose ofprogramming logic devices manufactured by Altera and sold byAltera or its authorized distributors. Please refer to theapplicable agreement for further details.+-----------------------------------------------------------------------------------+; Analysis & Synthesis Summary ;+------------------------------------+----------------------------------------------+; Analysis & Synthesis Status ; Successful - Thu Nov 10 23:29:21 2016 ;; Quartus II Version ; 9.1 Build 350 03/24/2010 SP 2 SJ Web Edition ;; Revision Name ; FPz8 ;; Top-level Entity Name ; CPU ;; Family ; Cyclone II ;; Total logic elements ; 4,905 ;; Total combinational functions ; 4,872 ;; Dedicated logic registers ; 495 ;; Total registers ; 495 ;; Total pins ; 12 ;; Total virtual pins ; 0 ;; Total memory bits ; 147,456 ;; Embedded Multiplier 9-bit elements ; 1 ;; Total PLLs ; 0 ;+------------------------------------+----------------------------------------------++----------------------------------------------------------------------------------------------------------------------+; Analysis & Synthesis Settings ;+----------------------------------------------------------------------------+--------------------+--------------------+; Option ; Setting ; Default Value ;+----------------------------------------------------------------------------+--------------------+--------------------+; Top-level entity name ; CPU ; FPz8 ;; Family name ; Cyclone II ; Stratix ;; Use smart compilation ; On ; Off ;; Use Generated Physical Constraints File ; Off ; ;; Allow Any RAM Size For Recognition ; On ; Off ;; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On ; On ;; Enable compact report table ; Off ; Off ;; Restructure Multiplexers ; Auto ; Auto ;; Create Debugging Nodes for IP Cores ; Off ; Off ;; Preserve fewer node names ; On ; On ;; Disable OpenCore Plus hardware evaluation ; Off ; Off ;; Verilog Version ; Verilog_2001 ; Verilog_2001 ;; VHDL Version ; VHDL_1993 ; VHDL_1993 ;; State Machine Processing ; Auto ; Auto ;; Safe State Machine ; Off ; Off ;; Extract Verilog State Machines ; On ; On ;; Extract VHDL State Machines ; On ; On ;; Ignore Verilog initial constructs ; Off ; Off ;; Iteration limit for constant Verilog loops ; 5000 ; 5000 ;; Iteration limit for non-constant Verilog loops ; 250 ; 250 ;; Add Pass-Through Logic to Inferred RAMs ; On ; On ;; Parallel Synthesis ; Off ; Off ;; DSP Block Balancing ; Auto ; Auto ;; NOT Gate Push-Back ; On ; On ;; Power-Up Don't Care ; On ; On ;; Remove Redundant Logic Cells ; Off ; Off ;; Remove Duplicate Registers ; On ; On ;; Ignore CARRY Buffers ; Off ; Off ;; Ignore CASCADE Buffers ; Off ; Off ;; Ignore GLOBAL Buffers ; Off ; Off ;; Ignore ROW GLOBAL Buffers ; Off ; Off ;; Ignore LCELL Buffers ; Off ; Off ;; Ignore SOFT Buffers ; On ; On ;; Limit AHDL Integers to 32 Bits ; Off ; Off ;; Optimization Technique ; Balanced ; Balanced ;; Carry Chain Length ; 70 ; 70 ;; Auto Carry Chains ; On ; On ;; Auto Open-Drain Pins ; On ; On ;; Perform WYSIWYG Primitive Resynthesis ; Off ; Off ;; Auto ROM Replacement ; On ; On ;; Auto RAM Replacement ; On ; On ;; Auto Shift Register Replacement ; Auto ; Auto ;; Auto Clock Enable Replacement ; On ; On ;; Strict RAM Replacement ; Off ; Off ;; Allow Synchronous Control Signals ; On ; On ;; Force Use of Synchronous Clear Signals ; Off ; Off ;; Auto RAM to Logic Cell Conversion ; Off ; Off ;; Auto Resource Sharing ; Off ; Off ;; Allow Any ROM Size For Recognition ; Off ; Off ;; Allow Any Shift Register Size For Recognition ; Off ; Off ;; Use LogicLock Constraints during Resource Balancing ; On ; On ;; Ignore translate_off and synthesis_off directives ; Off ; Off ;; Timing-Driven Synthesis ; Off ; Off ;; Show Parameter Settings Tables in Synthesis Report ; On ; On ;; Ignore Maximum Fan-Out Assignments ; Off ; Off ;; Synchronization Register Chain Length ; 2 ; 2 ;; PowerPlay Power Optimization ; Normal compilation ; Normal compilation ;; HDL message level ; Level2 ; Level2 ;; Suppress Register Optimization Related Messages ; Off ; Off ;; Number of Removed Registers Reported in Synthesis Report ; 5000 ; 5000 ;; Number of Inverted Registers Reported in Synthesis Report ; 100 ; 100 ;; Clock MUX Protection ; On ; On ;; Auto Gated Clock Conversion ; Off ; Off ;; Block Design Naming ; Auto ; Auto ;; SDC constraint protection ; Off ; Off ;; Synthesis Effort ; Auto ; Auto ;; Shift Register Replacement - Allow Asynchronous Clear Signal ; On ; On ;; Analysis & Synthesis Message Level ; Medium ; Medium ;; Disable Register Merging Across Hierarchies ; Auto ; Auto ;; Resource Aware Inference For Block RAM ; On ; On ;+----------------------------------------------------------------------------+--------------------+--------------------+Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.+-------------------------------------+; Parallel Compilation ;+----------------------------+--------+; Processors ; Number ;+----------------------------+--------+; Number detected on machine ; 4 ;; Maximum allowed ; 1 ;+----------------------------+--------++----------------------------------------------------------------------------------------------------------------------------------------------------------+; Analysis & Synthesis Source Files Read ;+----------------------------------+-----------------+------------------------------------+----------------------------------------------------------------+; File Name with User-Entered Path ; Used in Netlist ; File Type ; File Name with Absolute Path ;+----------------------------------+-----------------+------------------------------------+----------------------------------------------------------------+; CPU.bdf ; yes ; User Block Diagram/Schematic File ; E:/VHDL/FPZ8/CPU.bdf ;; fpz8_cpu_v1.vhd ; yes ; User VHDL File ; E:/VHDL/FPZ8/fpz8_cpu_v1.vhd ;; FPZ8_test.mif ; yes ; User Memory Initialization File ; E:/VHDL/FPZ8/FPZ8_test.mif ;; altsyncram1.vhd ; yes ; User Wizard-Generated File ; E:/VHDL/FPZ8/altsyncram1.vhd ;; altsyncram2.vhd ; yes ; User Wizard-Generated File ; E:/VHDL/FPZ8/altsyncram2.vhd ;; altsyncram.tdf ; yes ; Megafunction ; c:/altera/91sp2/quartus/libraries/megafunctions/altsyncram.tdf ;; db/altsyncram_lge1.tdf ; yes ; Auto-Generated Megafunction ; E:/VHDL/FPZ8/db/altsyncram_lge1.tdf ;; db/decode_4oa.tdf ; yes ; Auto-Generated Megafunction ; E:/VHDL/FPZ8/db/decode_4oa.tdf ;; db/mux_kib.tdf ; yes ; Auto-Generated Megafunction ; E:/VHDL/FPZ8/db/mux_kib.tdf ;; db/altsyncram_bua1.tdf ; yes ; Auto-Generated Megafunction ; E:/VHDL/FPZ8/db/altsyncram_bua1.tdf ;; lpm_mult.tdf ; yes ; Megafunction ; c:/altera/91sp2/quartus/libraries/megafunctions/lpm_mult.tdf ;; db/mult_o5t.tdf ; yes ; Auto-Generated Megafunction ; E:/VHDL/FPZ8/db/mult_o5t.tdf ;+----------------------------------+-----------------+------------------------------------+----------------------------------------------------------------++------------------------------------------------------+; Analysis & Synthesis Resource Usage Summary ;+---------------------------------------------+--------+; Resource ; Usage ;+---------------------------------------------+--------+; Estimated Total logic elements ; 4,905 ;; ; ;; Total combinational functions ; 4872 ;; Logic element usage by number of LUT inputs ; ;; -- 4 input functions ; 3102 ;; -- 3 input functions ; 1176 ;; -- <=2 input functions ; 594 ;; ; ;; Logic elements by mode ; ;; -- normal mode ; 4438 ;; -- arithmetic mode ; 434 ;; ; ;; Total registers ; 495 ;; -- Dedicated logic registers ; 495 ;; -- I/O registers ; 0 ;; ; ;; I/O pins ; 12 ;; Total memory bits ; 147456 ;; Embedded Multiplier 9-bit elements ; 1 ;; Maximum fan-out node ; CLOCK ;; Maximum fan-out ; 535 ;; Total fan-out ; 19587 ;; Average fan-out ; 3.61 ;+---------------------------------------------+--------++---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+; Analysis & Synthesis Resource Utilization by Entity ;+-------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------+--------------+; Compilation Hierarchy Node ; LC Combinationals ; LC Registers ; Memory Bits ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; Full Hierarchy Name ; Library Name ;+-------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------+--------------+; |CPU ; 4872 (2) ; 495 (0) ; 147456 ; 1 ; 1 ; 0 ; 12 ; 0 ; |CPU ; work ;; |altsyncram1:inst7| ; 0 (0) ; 0 (0) ; 16384 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram1:inst7 ; work ;; |altsyncram:altsyncram_component| ; 0 (0) ; 0 (0) ; 16384 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram1:inst7|altsyncram:altsyncram_component ; work ;; |altsyncram_bua1:auto_generated| ; 0 (0) ; 0 (0) ; 16384 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram1:inst7|altsyncram:altsyncram_component|altsyncram_bua1:auto_generated ; work ;; |altsyncram2:inst1| ; 24 (0) ; 2 (0) ; 131072 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram2:inst1 ; work ;; |altsyncram:altsyncram_component| ; 24 (0) ; 2 (0) ; 131072 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram2:inst1|altsyncram:altsyncram_component ; work ;; |altsyncram_lge1:auto_generated| ; 24 (0) ; 2 (2) ; 131072 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated ; work ;; |decode_4oa:decode3| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated|decode_4oa:decode3 ; work ;; |mux_kib:mux2| ; 16 (16) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |CPU|altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated|mux_kib:mux2 ; work ;; |fpz8_cpu_v1:inst| ; 4846 (4846) ; 493 (493) ; 0 ; 1 ; 1 ; 0 ; 0 ; 0 ; |CPU|fpz8_cpu_v1:inst ; work ;; |lpm_mult:Mult0| ; 0 (0) ; 0 (0) ; 0 ; 1 ; 1 ; 0 ; 0 ; 0 ; |CPU|fpz8_cpu_v1:inst|lpm_mult:Mult0 ; work ;; |mult_o5t:auto_generated| ; 0 (0) ; 0 (0) ; 0 ; 1 ; 1 ; 0 ; 0 ; 0 ; |CPU|fpz8_cpu_v1:inst|lpm_mult:Mult0|mult_o5t:auto_generated ; work ;+-------------------------------------------+-------------------+--------------+-------------+--------------+---------+-----------+------+--------------+----------------------------------------------------------------------------------------------------------+--------------+Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+; Analysis & Synthesis RAM Summary ;+---------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+--------+-------------------------------+; Name ; Type ; Mode ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size ; MIF ;+---------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+--------+-------------------------------+; altsyncram1:inst7|altsyncram:altsyncram_component|altsyncram_bua1:auto_generated|ALTSYNCRAM ; AUTO ; Single Port ; 2048 ; 8 ; -- ; -- ; 16384 ; None ;; altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated|ALTSYNCRAM ; AUTO ; Single Port ; 16384 ; 8 ; -- ; -- ; 131072 ; ../../vhdl/fpz8/FPZ8_test.mif ;+---------------------------------------------------------------------------------------------+------+-------------+--------------+--------------+--------------+--------------+--------+-------------------------------++-----------------------------------------------------+; Analysis & Synthesis DSP Block Usage Summary ;+---------------------------------------+-------------+; Statistic ; Number Used ;+---------------------------------------+-------------+; Simple Multipliers (9-bit) ; 1 ;; Simple Multipliers (18-bit) ; 0 ;; Embedded Multiplier Blocks ; -- ;; Embedded Multiplier 9-bit elements ; 1 ;; Signed Embedded Multipliers ; 0 ;; Unsigned Embedded Multipliers ; 1 ;; Mixed Sign Embedded Multipliers ; 0 ;; Variable Sign Embedded Multipliers ; 0 ;; Dedicated Input Shift Register Chains ; 0 ;+---------------------------------------+-------------+Note: number of Embedded Multiplier Blocks used is only available after a successful fit.Encoding Type: One-Hot+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+; State Machine - |CPU|fpz8_cpu_v1:inst|\main:DBG_CMD ;+---------------------------------+-------------------------+-------------------------+------------------------+-------------------------+------------------------+----------------------------+----------------------------+----------------------------+----------------------------+----------------------------+---------------------------+--------------------------------+---------------------------------+------------------------+------------------------+------------------------+------------------------+-----------------------+----------------------------+-----------------------------+----------------------------+---------------------------+-----------------------------+----------------------------+-----------------------------+------------------------------+-------------------------------+-----------------------------+----------------------------+----------------------------+; Name ; \main:DBG_CMD.DBG_EXEC3 ; \main:DBG_CMD.DBG_EXEC2 ; \main:DBG_CMD.DBG_EXEC ; \main:DBG_CMD.DBG_STUFF ; \main:DBG_CMD.DBG_STEP ; \main:DBG_CMD.DBG_PROGMEM6 ; \main:DBG_CMD.DBG_PROGMEM5 ; \main:DBG_CMD.DBG_PROGMEM4 ; \main:DBG_CMD.DBG_PROGMEM3 ; \main:DBG_CMD.DBG_PROGMEM2 ; \main:DBG_CMD.DBG_PROGMEM ; \main:DBG_CMD.DBG_READ_PROGMEM ; \main:DBG_CMD.DBG_WRITE_PROGMEM ; \main:DBG_CMD.DBG_REG5 ; \main:DBG_CMD.DBG_REG4 ; \main:DBG_CMD.DBG_REG3 ; \main:DBG_CMD.DBG_REG2 ; \main:DBG_CMD.DBG_REG ; \main:DBG_CMD.DBG_READ_REG ; \main:DBG_CMD.DBG_WRITE_REG ; \main:DBG_CMD.DBG_SEND_PC2 ; \main:DBG_CMD.DBG_SEND_PC ; \main:DBG_CMD.DBG_WRITE_PC2 ; \main:DBG_CMD.DBG_WRITE_PC ; \main:DBG_CMD.DBG_SEND_CTRL ; \main:DBG_CMD.DBG_WRITE_CTRL ; \main:DBG_CMD.DBG_SEND_STATUS ; \main:DBG_CMD.DBG_SEND_REV2 ; \main:DBG_CMD.DBG_SEND_REV ; \main:DBG_CMD.DBG_WAIT_CMD ;+---------------------------------+-------------------------+-------------------------+------------------------+-------------------------+------------------------+----------------------------+----------------------------+----------------------------+----------------------------+----------------------------+---------------------------+--------------------------------+---------------------------------+------------------------+------------------------+------------------------+------------------------+-----------------------+----------------------------+-----------------------------+----------------------------+---------------------------+-----------------------------+----------------------------+-----------------------------+------------------------------+-------------------------------+-----------------------------+----------------------------+----------------------------+; \main:DBG_CMD.DBG_WAIT_CMD ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;; \main:DBG_CMD.DBG_SEND_REV ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;; \main:DBG_CMD.DBG_SEND_REV2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;; \main:DBG_CMD.DBG_SEND_STATUS ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_WRITE_CTRL ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_SEND_CTRL ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_WRITE_PC ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_WRITE_PC2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_SEND_PC ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_SEND_PC2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_WRITE_REG ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_READ_REG ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_REG ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_REG2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_REG3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_REG4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_REG5 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_WRITE_PROGMEM ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_READ_PROGMEM ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_PROGMEM ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_PROGMEM2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_PROGMEM3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_PROGMEM4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_PROGMEM5 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_PROGMEM6 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_STEP ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_STUFF ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_EXEC ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_EXEC2 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_CMD.DBG_EXEC3 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;+---------------------------------+-------------------------+-------------------------+------------------------+-------------------------+------------------------+----------------------------+----------------------------+----------------------------+----------------------------+----------------------------+---------------------------+--------------------------------+---------------------------------+------------------------+------------------------+------------------------+------------------------+-----------------------+----------------------------+-----------------------------+----------------------------+---------------------------+-----------------------------+----------------------------+-----------------------------+------------------------------+-------------------------------+-----------------------------+----------------------------+----------------------------+Encoding Type: One-Hot+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+; 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\main:CPU_STATE.CPU_ISMD1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_TMA ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_OMA ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_OMA2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1; 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\main:CPU_STATE.CPU_STACK ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_STACK1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_STACK2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_STACK3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 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0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_DECOD ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_VECTOR2 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_HALTED ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_RESET ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:CPU_STATE.CPU_ILLEGAL ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;+-------------------------------+-----------------------------+---------------------------+----------------------------+-----------------------------+---------------------------+---------------------------+------------------------------+------------------------------+-----------------------------+----------------------------+----------------------------+----------------------------+---------------------------+-------------------------------+------------------------------+---------------------------+--------------------------+------------------------------+-----------------------------+--------------------------+-------------------------+--------------------------+-------------------------+-----------------------------+----------------------------+-----------------------------+-----------------------------+-----------------------------+----------------------------+------------------------------+-----------------------------+--------------------------+-------------------------+--------------------------+--------------------------+-------------------------+-------------------------+---------------------------+--------------------------+--------------------------+---------------------------+---------------------------+--------------------------+---------------------------+---------------------------+--------------------------+---------------------------+--------------------------+----------------------------+-----------------------------+------------------------------+------------------------------+------------------------------+-----------------------------+---------------------------+-----------------------------+----------------------------+----------------------------+--------------------------+--------------------------+-------------------------+---------------------------+----------------------------+Encoding Type: One-Hot+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+; State Machine - |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.TX_STATE ;+-------------------------------------------+--------------------------------------+-------------------------------------+-------------------------------------------+-------------------------------------+------------------------------------+------------------------------------+; Name ; \main:DBG_UART.TX_STATE.DBGTX_BREAK2 ; \main:DBG_UART.TX_STATE.DBGTX_BREAK ; \main:DBG_UART.TX_STATE.DBGTX_TRASMITTING ; \main:DBG_UART.TX_STATE.DBGTX_START ; \main:DBG_UART.TX_STATE.DBGTX_IDLE ; \main:DBG_UART.TX_STATE.DBGTX_INIT ;+-------------------------------------------+--------------------------------------+-------------------------------------+-------------------------------------------+-------------------------------------+------------------------------------+------------------------------------+; \main:DBG_UART.TX_STATE.DBGTX_INIT ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;; \main:DBG_UART.TX_STATE.DBGTX_IDLE ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;; \main:DBG_UART.TX_STATE.DBGTX_START ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;; \main:DBG_UART.TX_STATE.DBGTX_TRASMITTING ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;; \main:DBG_UART.TX_STATE.DBGTX_BREAK ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_UART.TX_STATE.DBGTX_BREAK2 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;+-------------------------------------------+--------------------------------------+-------------------------------------+-------------------------------------------+-------------------------------------+------------------------------------+------------------------------------+Encoding Type: One-Hot+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+; State Machine - |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.RX_STATE ;+-----------------------------------------+-------------------------------------+-----------------------------------------+-------------------------------------+------------------------------------+-----------------------------------------+-----------------------------------------+--------------------------------------+; Name ; \main:DBG_UART.RX_STATE.DBGST_ERROR ; \main:DBG_UART.RX_STATE.DBGST_RECEIVING ; \main:DBG_UART.RX_STATE.DBGST_START ; \main:DBG_UART.RX_STATE.DBGST_IDLE ; \main:DBG_UART.RX_STATE.DBGST_MEASURING ; \main:DBG_UART.RX_STATE.DBGST_WAITSTART ; \main:DBG_UART.RX_STATE.DBGST_NOSYNC ;+-----------------------------------------+-------------------------------------+-----------------------------------------+-------------------------------------+------------------------------------+-----------------------------------------+-----------------------------------------+--------------------------------------+; \main:DBG_UART.RX_STATE.DBGST_NOSYNC ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;; \main:DBG_UART.RX_STATE.DBGST_WAITSTART ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ; 1 ;; \main:DBG_UART.RX_STATE.DBGST_MEASURING ; 0 ; 0 ; 0 ; 0 ; 1 ; 0 ; 1 ;; \main:DBG_UART.RX_STATE.DBGST_IDLE ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 1 ;; \main:DBG_UART.RX_STATE.DBGST_START ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_UART.RX_STATE.DBGST_RECEIVING ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 1 ;; \main:DBG_UART.RX_STATE.DBGST_ERROR ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 1 ;+-----------------------------------------+-------------------------------------+-----------------------------------------+-------------------------------------+------------------------------------+-----------------------------------------+-----------------------------------------+--------------------------------------++------------------------------------------------------------------------------------------------------------------------------------------+; Registers Protected by Synthesis ;+--------------------------+------------------------------------------------------------------+--------------------------------------------+; Register Name ; Protected by Synthesis Attribute or Preserve Register Assignment ; Not to be Touched by Netlist Optimizations ;+--------------------------+------------------------------------------------------------------+--------------------------------------------+; fpz8_cpu_v1:inst|RXSYNC1 ; yes ; yes ;; fpz8_cpu_v1:inst|RXSYNC2 ; yes ; yes ;+--------------------------+------------------------------------------------------------------+--------------------------------------------++-----------------------------------------------------------------------------------------------+; Registers Removed During Synthesis ;+------------------------------------------------------+----------------------------------------+; Register name ; Reason for Removal ;+------------------------------------------------------+----------------------------------------+; fpz8_cpu_v1:inst|\main:OLD_IRQ0[0..6] ; Lost fanout ;; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMERX[8..11] ; Stuck at GND due to stuck port data_in ;; fpz8_cpu_v1:inst|\main:DBG_UART.BITTIMETX[9..11] ; Stuck at GND due to stuck port data_in ;; fpz8_cpu_v1:inst|FCTL[3..6] ; Merged with fpz8_cpu_v1:inst|FCTL[7] ;; fpz8_cpu_v1:inst|\main:DBG_UART.TXSHIFTREG[8] ; Stuck at VCC due to stuck port data_in ;; fpz8_cpu_v1:inst|\main:DBG_UART.TX_STATE.DBGTX_BREAK ; Stuck at GND due to stuck port data_in ;; fpz8_cpu_v1:inst|\main:FETCH_ADDR[14..15] ; Lost fanout ;; fpz8_cpu_v1:inst|IAB[14..15] ; Lost fanout ;; Total Number of Removed Registers = 24 ; ;+------------------------------------------------------+----------------------------------------++------------------------------------------------------+; General Register Statistics ;+----------------------------------------------+-------+; Statistic ; Value ;+----------------------------------------------+-------+; Total registers ; 495 ;; Number of registers using Synchronous Clear ; 3 ;; Number of registers using Synchronous Load ; 104 ;; Number of registers using Asynchronous Clear ; 185 ;; Number of registers using Asynchronous Load ; 0 ;; Number of registers using Clock Enable ; 490 ;; Number of registers using Preset ; 0 ;+----------------------------------------------+-------++----------------------------------------------------+; Inverted Register Statistics ;+------------------------------------------+---------+; Inverted Register ; Fan out ;+------------------------------------------+---------+; fpz8_cpu_v1:inst|RXSYNC1 ; 18 ;; fpz8_cpu_v1:inst|\main:CAN_FETCH ; 25 ;; fpz8_cpu_v1:inst|\main:DBG_UART.LAST_SMP ; 4 ;; fpz8_cpu_v1:inst|RXSYNC2 ; 1 ;; fpz8_cpu_v1:inst|IAB[1] ; 3 ;; Total number of inverted registers = 5 ; ;+------------------------------------------+---------++------------------------------------------------------------------------------------------------------------------------------------------------------------------+; Multiplexer Restructuring Statistics (Restructuring Performed) ;+--------------------+-----------+---------------+----------------------+------------------------+------------+----------------------------------------------------+; Multiplexer Inputs ; Bus Width ; Baseline Area ; Area if Restructured ; Saving if Restructured ; Registered ; Example Multiplexer Output ;+--------------------+-----------+---------------+----------------------+------------------------+------------+----------------------------------------------------+; 3:1 ; 3 bits ; 6 LEs ; 3 LEs ; 3 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:IQUEUE.WRPOS[1] ;; 4:1 ; 4 bits ; 8 LEs ; 8 LEs ; 0 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|ALU_FLAGS.S ;; 5:1 ; 4 bits ; 12 LEs ; 4 LEs ; 8 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.TXCNT[0] ;; 5:1 ; 8 bits ; 24 LEs ; 8 LEs ; 16 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.TXSHIFTREG[6] ;; 6:1 ; 8 bits ; 32 LEs ; 8 LEs ; 24 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.SIZE[6] ;; 6:1 ; 12 bits ; 48 LEs ; 12 LEs ; 36 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTTX[7] ;; 8:1 ; 12 bits ; 60 LEs ; 12 LEs ; 48 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.BAUDCNTRX[9] ;; 8:1 ; 8 bits ; 40 LEs ; 16 LEs ; 24 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.SIZE[8] ;; 12:1 ; 8 bits ; 64 LEs ; 32 LEs ; 32 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:PC[15] ;; 12:1 ; 8 bits ; 64 LEs ; 32 LEs ; 32 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:PC[2] ;; 11:1 ; 8 bits ; 56 LEs ; 40 LEs ; 16 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|IAB[12] ;; 11:1 ; 4 bits ; 28 LEs ; 20 LEs ; 8 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|IAB[7] ;; 11:1 ; 3 bits ; 21 LEs ; 15 LEs ; 6 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|IAB[2] ;; 18:1 ; 4 bits ; 48 LEs ; 16 LEs ; 32 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:RESULT[7] ;; 15:1 ; 8 bits ; 80 LEs ; 40 LEs ; 40 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DEST_ADDR16[10] ;; 16:1 ; 8 bits ; 80 LEs ; 48 LEs ; 32 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DEST_ADDR16[7] ;; 15:1 ; 3 bits ; 30 LEs ; 12 LEs ; 18 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.TX_DATA[3] ;; 17:1 ; 2 bits ; 22 LEs ; 14 LEs ; 8 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DBG_UART.TX_DATA[4] ;; 20:1 ; 4 bits ; 52 LEs ; 24 LEs ; 28 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:RESULT[0] ;; 40:1 ; 8 bits ; 208 LEs ; 88 LEs ; 120 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|MODB[2] ;; 29:1 ; 8 bits ; 152 LEs ; 32 LEs ; 120 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:TEMP_DATA[1] ;; 54:1 ; 2 bits ; 72 LEs ; 20 LEs ; 52 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|CPU_FLAGS.F1 ;; 53:1 ; 2 bits ; 70 LEs ; 22 LEs ; 48 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|CPU_FLAGS.D ;; 35:1 ; 4 bits ; 92 LEs ; 16 LEs ; 76 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DEST_ADDR[11] ;; 40:1 ; 4 bits ; 104 LEs ; 24 LEs ; 80 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DEST_ADDR[0] ;; 68:1 ; 8 bits ; 360 LEs ; 96 LEs ; 264 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|RP[7] ;; 41:1 ; 4 bits ; 108 LEs ; 28 LEs ; 80 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|\main:DEST_ADDR[5] ;; 89:1 ; 4 bits ; 236 LEs ; 56 LEs ; 180 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|SP[11] ;; 104:1 ; 8 bits ; 552 LEs ; 112 LEs ; 440 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|SP[1] ;; 89:1 ; 3 bits ; 177 LEs ; 48 LEs ; 129 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|MAB[9] ;; 103:1 ; 3 bits ; 204 LEs ; 60 LEs ; 144 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|MAB[1] ;; 136:1 ; 2 bits ; 180 LEs ; 44 LEs ; 136 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|FCTL[0] ;; 107:1 ; 4 bits ; 284 LEs ; 80 LEs ; 204 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|MAB[6] ;; 153:1 ; 8 bits ; 816 LEs ; 96 LEs ; 720 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|IRQ0ENH[7] ;; 169:1 ; 8 bits ; 896 LEs ; 96 LEs ; 800 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|IRQ0ENL[0] ;; 200:1 ; 8 bits ; 1064 LEs ; 88 LEs ; 976 LEs ; Yes ; |CPU|fpz8_cpu_v1:inst|PAOUT[5] ;; 3:1 ; 4 bits ; 8 LEs ; 4 LEs ; 4 LEs ; No ; |CPU|fpz8_cpu_v1:inst|OCDCR ;; 3:1 ; 8 bits ; 16 LEs ; 8 LEs ; 8 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PC ;; 3:1 ; 8 bits ; 16 LEs ; 8 LEs ; 8 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PC ;; 3:1 ; 16 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PC ;; 4:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux801 ;; 4:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux41 ;; 4:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux245 ;; 4:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux892 ;; 3:1 ; 4 bits ; 8 LEs ; 4 LEs ; 4 LEs ; No ; |CPU|fpz8_cpu_v1:inst|ADDRESSER12 ;; 3:1 ; 4 bits ; 8 LEs ; 4 LEs ; 4 LEs ; No ; |CPU|fpz8_cpu_v1:inst|ADDRESSER12 ;; 4:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux795 ;; 3:1 ; 16 bits ; 32 LEs ; 32 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PC ;; 3:1 ; 4 bits ; 8 LEs ; 4 LEs ; 4 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux423 ;; 3:1 ; 3 bits ; 6 LEs ; 3 LEs ; 3 LEs ; No ; |CPU|fpz8_cpu_v1:inst|IQUEUE ;; 3:1 ; 6 bits ; 12 LEs ; 12 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|IQUEUE ;; 4:1 ; 9 bits ; 18 LEs ; 9 LEs ; 9 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DBG_UART ;; 4:1 ; 8 bits ; 16 LEs ; 8 LEs ; 8 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PWDB ;; 4:1 ; 8 bits ; 16 LEs ; 16 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux253 ;; 4:1 ; 16 bits ; 32 LEs ; 32 LEs ; 0 LEs ; No ; |CPU|fpz8_cpu_v1:inst|FETCH_ADDR ;; 4:1 ; 61 bits ; 122 LEs ; 61 LEs ; 61 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 4:1 ; 12 bits ; 24 LEs ; 12 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|SP ;; 5:1 ; 8 bits ; 24 LEs ; 8 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DBG_UART ;; 5:1 ; 8 bits ; 24 LEs ; 8 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|TEMP_DATA ;; 5:1 ; 2 bits ; 6 LEs ; 2 LEs ; 4 LEs ; No ; |CPU|fpz8_cpu_v1:inst|IQUEUE ;; 5:1 ; 15 bits ; 45 LEs ; 30 LEs ; 15 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PC ;; 5:1 ; 16 bits ; 48 LEs ; 32 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|PC ;; 16:1 ; 7 bits ; 70 LEs ; 42 LEs ; 28 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux906 ;; 5:1 ; 2 bits ; 6 LEs ; 2 LEs ; 4 LEs ; No ; |CPU|fpz8_cpu_v1:inst|ATM_COUNTER ;; 6:1 ; 2 bits ; 8 LEs ; 2 LEs ; 6 LEs ; No ; |CPU|fpz8_cpu_v1:inst|IQUEUE ;; 7:1 ; 12 bits ; 48 LEs ; 24 LEs ; 24 LEs ; No ; |CPU|fpz8_cpu_v1:inst|SP ;; 7:1 ; 12 bits ; 48 LEs ; 24 LEs ; 24 LEs ; No ; |CPU|fpz8_cpu_v1:inst|SP ;; 17:1 ; 48 bits ; 528 LEs ; 144 LEs ; 384 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 17:1 ; 2 bits ; 22 LEs ; 8 LEs ; 14 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 8:1 ; 6 bits ; 30 LEs ; 6 LEs ; 24 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector8 ;; 8:1 ; 63 bits ; 315 LEs ; 126 LEs ; 189 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector150 ;; 9:1 ; 3 bits ; 18 LEs ; 6 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector185 ;; 14:1 ; 8 bits ; 72 LEs ; 8 LEs ; 64 LEs ; No ; |CPU|fpz8_cpu_v1:inst|RP ;; 33:1 ; 2 bits ; 44 LEs ; 12 LEs ; 32 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 33:1 ; 2 bits ; 44 LEs ; 14 LEs ; 30 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 11:1 ; 4 bits ; 28 LEs ; 16 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DBG_UART ;; 12:1 ; 18 bits ; 144 LEs ; 126 LEs ; 18 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector249 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector241 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector234 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector221 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector213 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector211 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector200 ;; 7:1 ; 8 bits ; 32 LEs ; 16 LEs ; 16 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Selector189 ;; 12:1 ; 2 bits ; 16 LEs ; 8 LEs ; 8 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DBG_UART ;; 13:1 ; 3 bits ; 24 LEs ; 18 LEs ; 6 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DATAREAD ;; 13:1 ; 4 bits ; 32 LEs ; 24 LEs ; 8 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DATAREAD ;; 15:1 ; 3 bits ; 30 LEs ; 18 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|Mux916 ;; 26:1 ; 4 bits ; 68 LEs ; 8 LEs ; 60 LEs ; No ; |CPU|fpz8_cpu_v1:inst|SP ;; 14:1 ; 2 bits ; 18 LEs ; 6 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DBG_UART ;; 27:1 ; 8 bits ; 144 LEs ; 16 LEs ; 128 LEs ; No ; |CPU|fpz8_cpu_v1:inst|SP ;; 16:1 ; 2 bits ; 20 LEs ; 8 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|DBG_UART ;; 16:1 ; 2 bits ; 20 LEs ; 8 LEs ; 12 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 23:1 ; 2 bits ; 30 LEs ; 28 LEs ; 2 LEs ; No ; |CPU|fpz8_cpu_v1:inst|INTVECT ;; 269:1 ; 12 bits ; 2148 LEs ; 132 LEs ; 2016 LEs ; No ; |CPU|fpz8_cpu_v1:inst|\main:DBG_CMD.DBG_SEND_PC ;; 40:1 ; 46 bits ; 1196 LEs ; 644 LEs ; 552 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 40:1 ; 2 bits ; 52 LEs ; 4 LEs ; 48 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;; 61:1 ; 2 bits ; 80 LEs ; 18 LEs ; 62 LEs ; No ; |CPU|fpz8_cpu_v1:inst|NUM_BYTES ;; 61:1 ; 3 bits ; 120 LEs ; 30 LEs ; 90 LEs ; No ; |CPU|fpz8_cpu_v1:inst|CPU_STATE ;+--------------------+-----------+---------------+----------------------+------------------------+------------+----------------------------------------------------++--------------------------------------------+; Source assignments for fpz8_cpu_v1:inst ;+-------------------+-------+------+---------+; Assignment ; Value ; From ; To ;+-------------------+-------+------+---------+; PRESERVE_REGISTER ; on ; - ; RXSYNC1 ;; PRESERVE_REGISTER ; on ; - ; RXSYNC2 ;+-------------------+-------+------+---------++---------------------------------------------------------------------------------------------------------+; Source assignments for altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated ;+---------------------------------+--------------------+------+-------------------------------------------+; Assignment ; Value ; From ; To ;+---------------------------------+--------------------+------+-------------------------------------------+; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; - ; - ;+---------------------------------+--------------------+------+-------------------------------------------++---------------------------------------------------------------------------------------------------------+; Source assignments for altsyncram1:inst7|altsyncram:altsyncram_component|altsyncram_bua1:auto_generated ;+---------------------------------+--------------------+------+-------------------------------------------+; Assignment ; Value ; From ; To ;+---------------------------------+--------------------+------+-------------------------------------------+; OPTIMIZE_POWER_DURING_SYNTHESIS ; NORMAL_COMPILATION ; - ; - ;+---------------------------------+--------------------+------+-------------------------------------------++------------------------------------------------------------------------------------------------+; Parameter Settings for User Entity Instance: altsyncram2:inst1|altsyncram:altsyncram_component ;+------------------------------------+-------------------------------+---------------------------+; Parameter Name ; Value ; Type ;+------------------------------------+-------------------------------+---------------------------+; BYTE_SIZE_BLOCK ; 8 ; Untyped ;; AUTO_CARRY_CHAINS ; ON ; AUTO_CARRY ;; IGNORE_CARRY_BUFFERS ; OFF ; IGNORE_CARRY ;; AUTO_CASCADE_CHAINS ; ON ; AUTO_CASCADE ;; IGNORE_CASCADE_BUFFERS ; OFF ; IGNORE_CASCADE ;; WIDTH_BYTEENA ; 1 ; Untyped ;; OPERATION_MODE ; SINGLE_PORT ; Untyped ;; WIDTH_A ; 8 ; Signed Integer ;; WIDTHAD_A ; 14 ; Signed Integer ;; NUMWORDS_A ; 16384 ; Signed Integer ;; OUTDATA_REG_A ; UNREGISTERED ; Untyped ;; ADDRESS_ACLR_A ; NONE ; Untyped ;; OUTDATA_ACLR_A ; NONE ; Untyped ;; WRCONTROL_ACLR_A ; NONE ; Untyped ;; INDATA_ACLR_A ; NONE ; Untyped ;; BYTEENA_ACLR_A ; NONE ; Untyped ;; WIDTH_B ; 1 ; Untyped ;; WIDTHAD_B ; 1 ; Untyped ;; NUMWORDS_B ; 1 ; Untyped ;; INDATA_REG_B ; CLOCK1 ; Untyped ;; WRCONTROL_WRADDRESS_REG_B ; CLOCK1 ; Untyped ;; RDCONTROL_REG_B ; CLOCK1 ; Untyped ;; ADDRESS_REG_B ; CLOCK1 ; Untyped ;; OUTDATA_REG_B ; UNREGISTERED ; Untyped ;; BYTEENA_REG_B ; CLOCK1 ; Untyped ;; INDATA_ACLR_B ; NONE ; Untyped ;; WRCONTROL_ACLR_B ; NONE ; Untyped ;; ADDRESS_ACLR_B ; NONE ; Untyped ;; OUTDATA_ACLR_B ; NONE ; Untyped ;; RDCONTROL_ACLR_B ; NONE ; Untyped ;; BYTEENA_ACLR_B ; NONE ; Untyped ;; WIDTH_BYTEENA_A ; 1 ; Signed Integer ;; WIDTH_BYTEENA_B ; 1 ; Untyped ;; RAM_BLOCK_TYPE ; AUTO ; Untyped ;; BYTE_SIZE ; 8 ; Untyped ;; READ_DURING_WRITE_MODE_MIXED_PORTS ; DONT_CARE ; Untyped ;; READ_DURING_WRITE_MODE_PORT_A ; NEW_DATA_NO_NBE_READ ; Untyped ;; READ_DURING_WRITE_MODE_PORT_B ; NEW_DATA_NO_NBE_READ ; Untyped ;; INIT_FILE ; ../../vhdl/fpz8/FPZ8_test.mif ; Untyped ;; INIT_FILE_LAYOUT ; PORT_A ; Untyped ;; MAXIMUM_DEPTH ; 0 ; Untyped ;; CLOCK_ENABLE_INPUT_A ; BYPASS ; Untyped ;; CLOCK_ENABLE_INPUT_B ; NORMAL ; Untyped ;; CLOCK_ENABLE_OUTPUT_A ; BYPASS ; Untyped ;; CLOCK_ENABLE_OUTPUT_B ; NORMAL ; Untyped ;; CLOCK_ENABLE_CORE_A ; USE_INPUT_CLKEN ; Untyped ;; CLOCK_ENABLE_CORE_B ; USE_INPUT_CLKEN ; Untyped ;; ENABLE_ECC ; FALSE ; Untyped ;; DEVICE_FAMILY ; Cyclone II ; Untyped ;; CBXI_PARAMETER ; altsyncram_lge1 ; Untyped ;+------------------------------------+-------------------------------+---------------------------+Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".+------------------------------------------------------------------------------------------------+; Parameter Settings for User Entity Instance: altsyncram1:inst7|altsyncram:altsyncram_component ;+------------------------------------+----------------------+------------------------------------+; Parameter Name ; Value ; Type ;+------------------------------------+----------------------+------------------------------------+; BYTE_SIZE_BLOCK ; 8 ; Untyped ;; AUTO_CARRY_CHAINS ; ON ; AUTO_CARRY ;; IGNORE_CARRY_BUFFERS ; OFF ; IGNORE_CARRY ;; AUTO_CASCADE_CHAINS ; ON ; AUTO_CASCADE ;; IGNORE_CASCADE_BUFFERS ; OFF ; IGNORE_CASCADE ;; WIDTH_BYTEENA ; 1 ; Untyped ;; OPERATION_MODE ; SINGLE_PORT ; Untyped ;; WIDTH_A ; 8 ; Signed Integer ;; WIDTHAD_A ; 11 ; Signed Integer ;; NUMWORDS_A ; 2048 ; Signed Integer ;; OUTDATA_REG_A ; UNREGISTERED ; Untyped ;; ADDRESS_ACLR_A ; NONE ; Untyped ;; OUTDATA_ACLR_A ; NONE ; Untyped ;; WRCONTROL_ACLR_A ; NONE ; Untyped ;; INDATA_ACLR_A ; NONE ; Untyped ;; BYTEENA_ACLR_A ; NONE ; Untyped ;; WIDTH_B ; 1 ; Untyped ;; WIDTHAD_B ; 1 ; Untyped ;; NUMWORDS_B ; 1 ; Untyped ;; INDATA_REG_B ; CLOCK1 ; Untyped ;; WRCONTROL_WRADDRESS_REG_B ; CLOCK1 ; Untyped ;; RDCONTROL_REG_B ; CLOCK1 ; Untyped ;; ADDRESS_REG_B ; CLOCK1 ; Untyped ;; OUTDATA_REG_B ; UNREGISTERED ; Untyped ;; BYTEENA_REG_B ; CLOCK1 ; Untyped ;; INDATA_ACLR_B ; NONE ; Untyped ;; WRCONTROL_ACLR_B ; NONE ; Untyped ;; ADDRESS_ACLR_B ; NONE ; Untyped ;; OUTDATA_ACLR_B ; NONE ; Untyped ;; RDCONTROL_ACLR_B ; NONE ; Untyped ;; BYTEENA_ACLR_B ; NONE ; Untyped ;; WIDTH_BYTEENA_A ; 1 ; Signed Integer ;; WIDTH_BYTEENA_B ; 1 ; Untyped ;; RAM_BLOCK_TYPE ; AUTO ; Untyped ;; BYTE_SIZE ; 8 ; Untyped ;; READ_DURING_WRITE_MODE_MIXED_PORTS ; DONT_CARE ; Untyped ;; READ_DURING_WRITE_MODE_PORT_A ; NEW_DATA_NO_NBE_READ ; Untyped ;; READ_DURING_WRITE_MODE_PORT_B ; NEW_DATA_NO_NBE_READ ; Untyped ;; INIT_FILE ; UNUSED ; Untyped ;; INIT_FILE_LAYOUT ; PORT_A ; Untyped ;; MAXIMUM_DEPTH ; 0 ; Untyped ;; CLOCK_ENABLE_INPUT_A ; BYPASS ; Untyped ;; CLOCK_ENABLE_INPUT_B ; NORMAL ; Untyped ;; CLOCK_ENABLE_OUTPUT_A ; BYPASS ; Untyped ;; CLOCK_ENABLE_OUTPUT_B ; NORMAL ; Untyped ;; CLOCK_ENABLE_CORE_A ; USE_INPUT_CLKEN ; Untyped ;; CLOCK_ENABLE_CORE_B ; USE_INPUT_CLKEN ; Untyped ;; ENABLE_ECC ; FALSE ; Untyped ;; DEVICE_FAMILY ; Cyclone II ; Untyped ;; CBXI_PARAMETER ; altsyncram_bua1 ; Untyped ;+------------------------------------+----------------------+------------------------------------+Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".+-----------------------------------------------------------------------------------+; Parameter Settings for Inferred Entity Instance: fpz8_cpu_v1:inst|lpm_mult:Mult0 ;+------------------------------------------------+------------+---------------------+; Parameter Name ; Value ; Type ;+------------------------------------------------+------------+---------------------+; AUTO_CARRY_CHAINS ; ON ; AUTO_CARRY ;; IGNORE_CARRY_BUFFERS ; OFF ; IGNORE_CARRY ;; AUTO_CASCADE_CHAINS ; ON ; AUTO_CASCADE ;; IGNORE_CASCADE_BUFFERS ; OFF ; IGNORE_CASCADE ;; LPM_WIDTHA ; 8 ; Untyped ;; LPM_WIDTHB ; 8 ; Untyped ;; LPM_WIDTHP ; 16 ; Untyped ;; LPM_WIDTHR ; 16 ; Untyped ;; LPM_WIDTHS ; 1 ; Untyped ;; LPM_REPRESENTATION ; UNSIGNED ; Untyped ;; LPM_PIPELINE ; 0 ; Untyped ;; LATENCY ; 0 ; Untyped ;; INPUT_A_IS_CONSTANT ; NO ; Untyped ;; INPUT_B_IS_CONSTANT ; NO ; Untyped ;; USE_EAB ; OFF ; Untyped ;; MAXIMIZE_SPEED ; 5 ; Untyped ;; DEVICE_FAMILY ; Cyclone II ; Untyped ;; CARRY_CHAIN ; MANUAL ; Untyped ;; APEX20K_TECHNOLOGY_MAPPER ; LUT ; TECH_MAPPER_APEX20K ;; DEDICATED_MULTIPLIER_CIRCUITRY ; AUTO ; Untyped ;; DEDICATED_MULTIPLIER_MIN_INPUT_WIDTH_FOR_AUTO ; 0 ; Untyped ;; DEDICATED_MULTIPLIER_MIN_OUTPUT_WIDTH_FOR_AUTO ; 0 ; Untyped ;; CBXI_PARAMETER ; mult_o5t ; Untyped ;; INPUT_A_FIXED_VALUE ; Bx ; Untyped ;; INPUT_B_FIXED_VALUE ; Bx ; Untyped ;; USE_AHDL_IMPLEMENTATION ; OFF ; Untyped ;+------------------------------------------------+------------+---------------------+Note: In order to hide this table in the UI and the text report file, please set the "Show Parameter Settings Tables in Synthesis Report" option in "Analysis and Synthesis Settings -> More Settings" to "Off".+-----------------------------------------------------------------------------------------------+; altsyncram Parameter Settings by Entity Instance ;+-------------------------------------------+---------------------------------------------------+; Name ; Value ;+-------------------------------------------+---------------------------------------------------+; Number of entity instances ; 2 ;; Entity Instance ; altsyncram2:inst1|altsyncram:altsyncram_component ;; -- OPERATION_MODE ; SINGLE_PORT ;; -- WIDTH_A ; 8 ;; -- NUMWORDS_A ; 16384 ;; -- OUTDATA_REG_A ; UNREGISTERED ;; -- WIDTH_B ; 1 ;; -- NUMWORDS_B ; 1 ;; -- ADDRESS_REG_B ; CLOCK1 ;; -- OUTDATA_REG_B ; UNREGISTERED ;; -- RAM_BLOCK_TYPE ; AUTO ;; -- READ_DURING_WRITE_MODE_MIXED_PORTS ; DONT_CARE ;; Entity Instance ; altsyncram1:inst7|altsyncram:altsyncram_component ;; -- OPERATION_MODE ; SINGLE_PORT ;; -- WIDTH_A ; 8 ;; -- NUMWORDS_A ; 2048 ;; -- OUTDATA_REG_A ; UNREGISTERED ;; -- WIDTH_B ; 1 ;; -- NUMWORDS_B ; 1 ;; -- ADDRESS_REG_B ; CLOCK1 ;; -- OUTDATA_REG_B ; UNREGISTERED ;; -- RAM_BLOCK_TYPE ; AUTO ;; -- READ_DURING_WRITE_MODE_MIXED_PORTS ; DONT_CARE ;+-------------------------------------------+---------------------------------------------------++-------------------------------------------------------------------------+; lpm_mult Parameter Settings by Entity Instance ;+---------------------------------------+---------------------------------+; Name ; Value ;+---------------------------------------+---------------------------------+; Number of entity instances ; 1 ;; Entity Instance ; fpz8_cpu_v1:inst|lpm_mult:Mult0 ;; -- LPM_WIDTHA ; 8 ;; -- LPM_WIDTHB ; 8 ;; -- LPM_WIDTHP ; 16 ;; -- LPM_REPRESENTATION ; UNSIGNED ;; -- INPUT_A_IS_CONSTANT ; NO ;; -- INPUT_B_IS_CONSTANT ; NO ;; -- USE_EAB ; OFF ;; -- DEDICATED_MULTIPLIER_CIRCUITRY ; AUTO ;; -- INPUT_A_FIXED_VALUE ; Bx ;; -- INPUT_B_FIXED_VALUE ; Bx ;+---------------------------------------+---------------------------------++-------------------------------+; Analysis & Synthesis Messages ;+-------------------------------+Info: *******************************************************************Info: Running Quartus II Analysis & SynthesisInfo: Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web EditionInfo: Processing started: Thu Nov 10 23:26:59 2016Info: Command: quartus_map --read_settings_files=on --write_settings_files=off FPz8 -c FPz8Info: Found 1 design units, including 1 entities, in source file cpu.bdfInfo: Found entity 1: CPUInfo: Found 2 design units, including 1 entities, in source file fpz8_cpu_v1.vhdInfo: Found design unit 1: fpz8_cpu_v1-cpuInfo: Found entity 1: fpz8_cpu_v1Info: Found 2 design units, including 1 entities, in source file altsyncram0.vhdInfo: Found design unit 1: altsyncram0-SYNInfo: Found entity 1: altsyncram0Info: Found 2 design units, including 1 entities, in source file altsyncram1.vhdInfo: Found design unit 1: altsyncram1-SYNInfo: Found entity 1: altsyncram1Info: Found 2 design units, including 1 entities, in source file altsyncram2.vhdInfo: Found design unit 1: altsyncram2-SYNInfo: Found entity 1: altsyncram2Info: Elaborating entity "CPU" for the top level hierarchyInfo: Elaborating entity "fpz8_cpu_v1" for hierarchy "fpz8_cpu_v1:inst"Warning (10543): VHDL Variable Declaration warning at fpz8_cpu_v1.vhd(55): used default initial value for variable "INT7" because variable was never assigned a value or an initial value expression. Use of default initial value may introduce unintended design optimizations.Warning (10543): VHDL Variable Declaration warning at fpz8_cpu_v1.vhd(57): used default initial value for variable "HALT" because variable was never assigned a value or an initial value expression. Use of default initial value may introduce unintended design optimizations.Info: Elaborating entity "altsyncram2" for hierarchy "altsyncram2:inst1"Info: Elaborating entity "altsyncram" for hierarchy "altsyncram2:inst1|altsyncram:altsyncram_component"Info: Elaborated megafunction instantiation "altsyncram2:inst1|altsyncram:altsyncram_component"Info: Instantiated megafunction "altsyncram2:inst1|altsyncram:altsyncram_component" with the following parameter:Info: Parameter "clock_enable_input_a" = "BYPASS"Info: Parameter "clock_enable_output_a" = "BYPASS"Info: Parameter "init_file" = "../../vhdl/fpz8/FPZ8_test.mif"Info: Parameter "intended_device_family" = "Cyclone II"Info: Parameter "lpm_hint" = "ENABLE_RUNTIME_MOD=NO"Info: Parameter "lpm_type" = "altsyncram"Info: Parameter "numwords_a" = "16384"Info: Parameter "operation_mode" = "SINGLE_PORT"Info: Parameter "outdata_aclr_a" = "NONE"Info: Parameter "outdata_reg_a" = "UNREGISTERED"Info: Parameter "power_up_uninitialized" = "FALSE"Info: Parameter "widthad_a" = "14"Info: Parameter "width_a" = "8"Info: Parameter "width_byteena_a" = "1"Info: Found 1 design units, including 1 entities, in source file db/altsyncram_lge1.tdfInfo: Found entity 1: altsyncram_lge1Info: Elaborating entity "altsyncram_lge1" for hierarchy "altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated"Info: Found 1 design units, including 1 entities, in source file db/decode_4oa.tdfInfo: Found entity 1: decode_4oaInfo: Elaborating entity "decode_4oa" for hierarchy "altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated|decode_4oa:decode3"Info: Elaborating entity "decode_4oa" for hierarchy "altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated|decode_4oa:deep_decode"Info: Found 1 design units, including 1 entities, in source file db/mux_kib.tdfInfo: Found entity 1: mux_kibInfo: Elaborating entity "mux_kib" for hierarchy "altsyncram2:inst1|altsyncram:altsyncram_component|altsyncram_lge1:auto_generated|mux_kib:mux2"Info: Elaborating entity "altsyncram1" for hierarchy "altsyncram1:inst7"Info: Elaborating entity "altsyncram" for hierarchy "altsyncram1:inst7|altsyncram:altsyncram_component"Info: Elaborated megafunction instantiation "altsyncram1:inst7|altsyncram:altsyncram_component"Info: Instantiated megafunction "altsyncram1:inst7|altsyncram:altsyncram_component" with the following parameter:Info: Parameter "clock_enable_input_a" = "BYPASS"Info: Parameter "clock_enable_output_a" = "BYPASS"Info: Parameter "intended_device_family" = "Cyclone II"Info: Parameter "lpm_hint" = "ENABLE_RUNTIME_MOD=NO"Info: Parameter "lpm_type" = "altsyncram"Info: Parameter "numwords_a" = "2048"Info: Parameter "operation_mode" = "SINGLE_PORT"Info: Parameter "outdata_aclr_a" = "NONE"Info: Parameter "outdata_reg_a" = "UNREGISTERED"Info: Parameter "power_up_uninitialized" = "FALSE"Info: Parameter "widthad_a" = "11"Info: Parameter "width_a" = "8"Info: Parameter "width_byteena_a" = "1"Info: Found 1 design units, including 1 entities, in source file db/altsyncram_bua1.tdfInfo: Found entity 1: altsyncram_bua1Info: Elaborating entity "altsyncram_bua1" for hierarchy "altsyncram1:inst7|altsyncram:altsyncram_component|altsyncram_bua1:auto_generated"Info: Inferred 1 megafunctions from design logicInfo: Inferred multiplier megafunction ("lpm_mult") from the following logic: "fpz8_cpu_v1:inst|Mult0"Info: Elaborated megafunction instantiation "fpz8_cpu_v1:inst|lpm_mult:Mult0"Info: Instantiated megafunction "fpz8_cpu_v1:inst|lpm_mult:Mult0" with the following parameter:Info: Parameter "LPM_WIDTHA" = "8"Info: Parameter "LPM_WIDTHB" = "8"Info: Parameter "LPM_WIDTHP" = "16"Info: Parameter "LPM_WIDTHR" = "16"Info: Parameter "LPM_WIDTHS" = "1"Info: Parameter "LPM_REPRESENTATION" = "UNSIGNED"Info: Parameter "INPUT_A_IS_CONSTANT" = "NO"Info: Parameter "INPUT_B_IS_CONSTANT" = "NO"Info: Parameter "MAXIMIZE_SPEED" = "5"Info: Found 1 design units, including 1 entities, in source file db/mult_o5t.tdfInfo: Found entity 1: mult_o5tInfo: Registers with preset signals will power-up highInfo: DEV_CLRn pin will set, and not reset, register with preset signal due to NOT Gate Push-BackInfo: 11 registers lost all their fanouts during netlist optimizations. The first 11 are displayed below.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[0]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[1]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[2]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[3]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[4]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[5]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:OLD_IRQ0[6]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:FETCH_ADDR[15]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|\main:FETCH_ADDR[14]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|IAB[15]" lost all its fanouts during netlist optimizations.Info: Register "fpz8_cpu_v1:inst|IAB[14]" lost all its fanouts during netlist optimizations.Info: Implemented 5005 device resources after synthesis - the final resource count might be differentInfo: Implemented 3 input pinsInfo: Implemented 9 output pinsInfo: Implemented 4952 logic cellsInfo: Implemented 40 RAM segmentsInfo: Implemented 1 DSP elementsInfo: Quartus II Analysis & Synthesis was successful. 0 errors, 2 warningsInfo: Peak virtual memory: 269 megabytesInfo: Processing ended: Thu Nov 10 23:29:21 2016Info: Elapsed time: 00:02:22Info: Total CPU time (on all processors): 00:02:19