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# Synplicity, Inc. constraint file# /shared/projects/pci/mihad/pci/apps/test/syn/synplify/pci_test_top.sdc# Written on Thu Apr 17 16:11:16 2003# by Amplify, Amplify 3.1 Scope Editor## Clocks#define_clock -name {pci_clk_pad_i} -period 30.000 -clockgroup pci_clkgrp## Inputs/Outputs#define_input_delay {pci_devsel_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_trdy_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_stop_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_idsel_pad_i} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_frame_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_irdy_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_gnt_pad_i} 20.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_par_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_perr_pad_io} 23.00 -route 2.00 -ref pci_clk_pad_i:rdefine_input_delay {pci_ad0_pad_io} 23.00 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