Subversion Repositories wdsp

all:    sim

SHELL = /bin/sh
MS=-s

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# DUT Sources
#
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DUT_SRC_DIR=../../../rtl/verilog
_TARGETS_=      $(DUT_SRC_DIR)/wb_conmax_top.v          \
                $(DUT_SRC_DIR)/wb_conmax_slave_if.v     \
                $(DUT_SRC_DIR)/wb_conmax_master_if.v    \
                $(DUT_SRC_DIR)/wb_conmax_msel.v         \
                $(DUT_SRC_DIR)/wb_conmax_arb.v          \
                $(DUT_SRC_DIR)/wb_conmax_pri_enc.v      \
                $(DUT_SRC_DIR)/wb_conmax_pri_dec.v      \
                $(DUT_SRC_DIR)/wb_conmax_rf.v


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#
# Test Bench Sources
#
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_TOP_=test
TB_SRC_DIR=../../../bench/verilog
_TB_=           $(TB_SRC_DIR)/test_bench_top.v          \
                $(TB_SRC_DIR)/wb_slv_model.v            \
                $(TB_SRC_DIR)/wb_mast_model.v

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#
# Misc Variables
#
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INCDIR=+incdir+./$(DUT_SRC_DIR)/ +incdir+./$(TB_SRC_DIR)/
LOGF=-l .nclog
UMC_LIB=/tools/dc_libraries/virtual_silicon/umc_lib.v
GATE_NETLIST = ../../../syn/out/wb_dma_top_ps.v

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#
# Make Targets
#
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ss:
        signalscan -do waves/waves.do -waves waves/waves.trn &

simxl:
        verilog +incdir+$(DUT_SRC_DIR) +incdir+$(TB_SRC_DIR)    \
        $(_TARGETS_) $(_TB_)

simw:
        @$(MAKE) -s sim ACCESS="+access+r " WAVES="+define+WAVES"


sim:
        ncverilog -q +define+RUDIS_TB $(_TARGETS_) $(_TB_)      \
                $(INCDIR) $(WAVES) $(ACCESS) $(LOGF) +ncstatus  \
                +ncuid+`hostname`

gatew:
        @$(MAKE) -s gate ACCESS="+access+r" WAVES="+define+WAVES"

gate:
        ncverilog -q +define+RUDIS_TB $(_TB_) $(UMC_LIB)        \
                $(GATE_NETLIST) $(INCDIR) $(WAVES) $(ACCESS)    \
                $(LOGF) +ncstatus +ncuid+`hostname`

hal:
        @echo ""
        @echo "----- Running HAL ... ----------"
        @hal    -NOP -NOS -nocheck STYVAL:USEPRT:NOBLKN:DLNBLK  \
                +incdir+$(DUT_SRC_DIR) $(_TARGETS_)
        @echo "----- DONE ... ----------"

clean:
        rm -rf  ./waves/*.dsn ./waves/*.trn             \
                ncwork/inc* ncwork/.inc*                \
                ./verilog.* .nclog hal.log

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