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https://opencores.org/ocsvn/z80soc/z80soc/trunk
Subversion Repositories z80soc
[/] [z80soc/] [trunk/] [V0.7.1a/] [DE1/] [z80soc.pin] - Rev 43
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-- Copyright (C) 1991-2010 Altera Corporation-- Your use of Altera Corporation's design tools, logic functions-- and other software and tools, and its AMPP partner logic-- functions, and any output files from any of the foregoing-- (including device programming or simulation files), and any-- associated documentation or information are expressly subject-- to the terms and conditions of the Altera Program License-- Subscription Agreement, Altera MegaCore Function License-- Agreement, or other applicable license agreement, including,-- without limitation, that your use is for the sole purpose of-- programming logic devices manufactured by Altera and sold by-- Altera or its authorized distributors. Please refer to the-- applicable agreement for further details.---- This is a Quartus II output file. It is for reporting purposes only, and is-- not intended for use as a Quartus II input file. This file cannot be used-- to make Quartus II pin assignments - for instructions on how to make pin-- assignments, please see Quartus II help.-------------------------------------------------------------------------------------------------------------------------------------------------------------------- NC : No Connect. This pin has no internal connection to the device.-- DNU : Do Not Use. This pin MUST NOT be connected.-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).-- VCCIO : Dedicated power pin, which MUST be connected to VCC-- of its bank.-- Bank 1: 3.3V-- Bank 2: 3.3V-- Bank 3: 3.3V-- Bank 4: 3.3V-- Bank 5: 3.3V-- Bank 6: 3.3V-- Bank 7: 3.3V-- Bank 8: 3.3V-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.-- It can also be used to report unused dedicated pins. The connection-- on the board for unused dedicated pins depends on whether this will-- be used in a future design. One example is device migration. When-- using device migration, refer to the device pin-tables. If it is a-- GND pin in the pin table or if it will not be used in a future design-- for another purpose the it MUST be connected to GND. If it is an unused-- dedicated pin, then it can be connected to a valid signal on the board-- (low, high, or toggling) if that signal is required for a different-- revision of the design.-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.-- This pin should be connected to GND. It may also be connected to a-- valid signal on the board (low, high, or toggling) if that signal-- is required for a different revision of the design.-- GND* : Unused I/O pin. For transceiver I/O banks, connect each pin marked GND*-- either individually through a 10k Ohm resistor to GND or tie all pins-- together and connect through a single 10k Ohm resistor to GND.-- For non-transceiver I/O banks, connect each pin marked GND* directly to GND-- or leave it unconnected.-- RESERVED : Unused I/O pin, which MUST be left unconnected.-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.-------------------------------------------------------------------------------------------------------------------------------------------------------------------- Pin directions (input, output or bidir) are based on device operating in user mode.---------------------------------------------------------------------------------Quartus II Version 9.1 Build 350 03/24/2010 Service Pack 2 SJ Web EditionCHIP "z80soc" ASSIGNED TO AN: EP2C20F484C7Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment-------------------------------------------------------------------------------------------------------------GND : A1 : gnd : : : :VCCIO3 : A2 : power : : 3.3V : 3 :I2C_SCLK : A3 : output : 3.3-V LVTTL : : 3 : YAUD_BCLK : A4 : bidir : 3.3-V LVTTL : : 3 : YAUD_DACLRCK : A5 : bidir : 3.3-V LVTTL : : 3 : YAUD_ADCLRCK : A6 : bidir : 3.3-V LVTTL : : 3 : YVGA_R[2] : A7 : output : 3.3-V LVTTL : : 3 : YVGA_G[3] : A8 : output : 3.3-V LVTTL : : 3 : YVGA_B[0] : A9 : output : 3.3-V LVTTL : : 3 : YVGA_B[2] : A10 : output : 3.3-V LVTTL : : 3 : YVGA_HS : A11 : output : 3.3-V LVTTL : : 3 : YGND+ : A12 : : : : 4 :GPIO_0[0] : A13 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[2] : A14 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[4] : A15 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[6] : A16 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[8] : A17 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[10] : A18 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[12] : A19 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[14] : A20 : bidir : 3.3-V LVTTL : : 4 : YVCCIO4 : A21 : power : : 3.3V : 4 :GND : A22 : gnd : : : :VCCIO1 : AA1 : power : : 3.3V : 1 :GND : AA2 : gnd : : : :SRAM_ADDR[0] : AA3 : output : 3.3-V LVTTL : : 8 : YSRAM_ADDR[2] : AA4 : output : 3.3-V LVTTL : : 8 : YSRAM_ADDR[4] : AA5 : output : 3.3-V LVTTL : : 8 : YSRAM_DQ[0] : AA6 : bidir : 3.3-V LVTTL : : 8 : YSRAM_DQ[2] : AA7 : bidir : 3.3-V LVTTL : : 8 : YSRAM_DQ[4] : AA8 : bidir : 3.3-V LVTTL : : 8 : YSRAM_DQ[6] : AA9 : bidir : 3.3-V LVTTL : : 8 : YSRAM_WE_N : AA10 : output : 3.3-V LVTTL : : 8 : YSRAM_ADDR[6] : AA11 : output : 3.3-V LVTTL : : 8 : YFL_ADDR[15] : AA12 : output : 3.3-V LVTTL : : 7 : YFL_ADDR[13] : AA13 : output : 3.3-V LVTTL : : 7 : YFL_ADDR[1] : AA14 : output : 3.3-V LVTTL : : 7 : YFL_OE_N : AA15 : output : 3.3-V LVTTL : : 7 : YFL_DQ[1] : AA16 : bidir : 3.3-V LVTTL : : 7 : YFL_DQ[3] : AA17 : bidir : 3.3-V LVTTL : : 7 : YFL_DQ[5] : AA18 : bidir : 3.3-V LVTTL : : 7 : YFL_DQ[7] : AA19 : bidir : 3.3-V LVTTL : : 7 : YFL_ADDR[17] : AA20 : output : 3.3-V LVTTL : : 7 : YGND : AA21 : gnd : : : :VCCIO6 : AA22 : power : : 3.3V : 6 :GND : AB1 : gnd : : : :VCCIO8 : AB2 : power : : 3.3V : 8 :SRAM_ADDR[1] : AB3 : output : 3.3-V LVTTL : : 8 : YSRAM_ADDR[3] : AB4 : output : 3.3-V LVTTL : : 8 : YSRAM_CE_N : AB5 : output : 3.3-V LVTTL : : 8 : YSRAM_DQ[1] : AB6 : bidir : 3.3-V LVTTL : : 8 : YSRAM_DQ[3] : AB7 : bidir : 3.3-V LVTTL : : 8 : YSRAM_DQ[5] : AB8 : bidir : 3.3-V LVTTL : : 8 : YSRAM_DQ[7] : AB9 : bidir : 3.3-V LVTTL : : 8 : YSRAM_ADDR[5] : AB10 : output : 3.3-V LVTTL : : 8 : YSRAM_ADDR[7] : AB11 : output : 3.3-V LVTTL : : 8 : YFL_ADDR[16] : AB12 : output : 3.3-V LVTTL : : 7 : YFL_ADDR[14] : AB13 : output : 3.3-V LVTTL : : 7 : YFL_ADDR[12] : AB14 : output : 3.3-V LVTTL : : 7 : YRESERVED_INPUT : AB15 : : : : 7 :FL_DQ[0] : AB16 : bidir : 3.3-V LVTTL : : 7 : YFL_DQ[2] : AB17 : bidir : 3.3-V LVTTL : : 7 : YFL_DQ[4] : AB18 : bidir : 3.3-V LVTTL : : 7 : YFL_DQ[6] : AB19 : bidir : 3.3-V LVTTL : : 7 : YFL_ADDR[0] : AB20 : output : 3.3-V LVTTL : : 7 : YVCCIO7 : AB21 : power : : 3.3V : 7 :GND : AB22 : gnd : : : :VCCIO2 : B1 : power : : 3.3V : 2 :GND : B2 : gnd : : : :I2C_SDAT : B3 : bidir : 3.3-V LVTTL : : 3 : YAUD_XCK : B4 : output : 3.3-V LVTTL : : 3 : YAUD_DACDAT : B5 : output : 3.3-V LVTTL : : 3 : YAUD_ADCDAT : B6 : input : 3.3-V LVTTL : : 3 : YVGA_R[3] : B7 : output : 3.3-V LVTTL : : 3 : YVGA_G[0] : B8 : output : 3.3-V LVTTL : : 3 : YVGA_G[2] : B9 : output : 3.3-V LVTTL : : 3 : YVGA_B[3] : B10 : output : 3.3-V LVTTL : : 3 : YVGA_VS : B11 : output : 3.3-V LVTTL : : 3 : YGND+ : B12 : : : : 4 :GPIO_0[1] : B13 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[3] : B14 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[5] : B15 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[7] : B16 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[9] : B17 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[11] : B18 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[13] : B19 : bidir : 3.3-V LVTTL : : 4 : YGPIO_0[15] : B20 : bidir : 3.3-V LVTTL : : 4 : YGND : B21 : gnd : : : :VCCIO5 : B22 : power : : 3.3V : 5 :HEX2[3] : C1 : output : 3.3-V LVTTL : : 2 : YHEX2[2] : C2 : output : 3.3-V LVTTL : : 2 : Y~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : C3 : input : 3.3-V LVTTL : : 2 : N~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : C4 : input : 3.3-V LVTTL : : 2 : NGND : C5 : gnd : : : :VCCIO3 : C6 : power : : 3.3V : 3 :TCK : C7 : input : 3.3-V LVTTL : : 3 : YGND : C8 : gnd : : : :VGA_R[1] : C9 : output : 3.3-V LVTTL : : 3 : YVGA_G[1] : C10 : output : 3.3-V LVTTL : : 3 : YVCCIO3 : C11 : power : : 3.3V : 3 :VCCIO4 : C12 : power : : 3.3V : 4 :RESERVED_INPUT : C13 : : : : 4 :GPIO_1[10] : C14 : bidir : 3.3-V LVTTL : : 4 : YGND : C15 : gnd : : : :RESERVED_INPUT : C16 : : : : 4 :GPIO_1[14] : C17 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[15] : C18 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[16] : C19 : bidir : 3.3-V LVTTL : : 5 : YGPIO_1[17] : C20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[16] : C21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[17] : C22 : bidir : 3.3-V LVTTL : : 5 : YHEX1[6] : D1 : output : 3.3-V LVTTL : : 2 : YHEX1[5] : D2 : output : 3.3-V LVTTL : : 2 : YHEX2[6] : D3 : output : 3.3-V LVTTL : : 2 : YHEX3[6] : D4 : output : 3.3-V LVTTL : : 2 : YHEX3[1] : D5 : output : 3.3-V LVTTL : : 2 : YHEX3[2] : D6 : output : 3.3-V LVTTL : : 2 : YTDO : D7 : output : 3.3-V LVTTL : : 3 : YTCS : D8 : input : 3.3-V LVTTL : : 3 : YVGA_R[0] : D9 : output : 3.3-V LVTTL : : 3 : YGND : D10 : gnd : : : :VGA_B[1] : D11 : output : 3.3-V LVTTL : : 3 : YGND+ : D12 : : : : 3 :GND : D13 : gnd : : : :GPIO_1[11] : D14 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[12] : D15 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[13] : D16 : bidir : 3.3-V LVTTL : : 4 : YVCCIO4 : D17 : power : : 3.3V : 4 :GND : D18 : gnd : : : :GPIO_1[18] : D19 : bidir : 3.3-V LVTTL : : 5 : YGPIO_1[19] : D20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[18] : D21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[19] : D22 : bidir : 3.3-V LVTTL : : 5 : YHEX1[0] : E1 : output : 3.3-V LVTTL : : 2 : YHEX0[6] : E2 : output : 3.3-V LVTTL : : 2 : YHEX2[4] : E3 : output : 3.3-V LVTTL : : 2 : YHEX2[5] : E4 : output : 3.3-V LVTTL : : 2 : YVCCD_PLL3 : E5 : power : : 1.2V : :VCCA_PLL3 : E6 : power : : 1.2V : :RESERVED_INPUT : E7 : : : : 3 :TDI : E8 : input : 3.3-V LVTTL : : 3 : YRESERVED_INPUT : E9 : : : : 3 :VCCIO3 : E10 : power : : 3.3V : 3 :RESERVED_INPUT : E11 : : : : 3 :GND+ : E12 : : : : 3 :VCCIO4 : E13 : power : : 3.3V : 4 :GPIO_1[4] : E14 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[5] : E15 : bidir : 3.3-V LVTTL : : 4 : YGNDA_PLL2 : E16 : gnd : : : :GND_PLL2 : E17 : gnd : : : :GPIO_1[23] : E18 : bidir : 3.3-V LVTTL : : 5 : YGPIO_1[22] : E19 : bidir : 3.3-V LVTTL : : 5 : YGPIO_1[20] : E20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[20] : E21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[21] : E22 : bidir : 3.3-V LVTTL : : 5 : YHEX0[5] : F1 : output : 3.3-V LVTTL : : 2 : YHEX0[4] : F2 : output : 3.3-V LVTTL : : 2 : YHEX3[5] : F3 : output : 3.3-V LVTTL : : 2 : YHEX3[0] : F4 : output : 3.3-V LVTTL : : 2 : YGND_PLL3 : F5 : gnd : : : :GND_PLL3 : F6 : gnd : : : :GNDA_PLL3 : F7 : gnd : : : :RESERVED_INPUT : F8 : : : : 3 :IRDA_RXD : F9 : input : 3.3-V LVTTL : : 3 : NRESERVED_INPUT : F10 : : : : 3 :RESERVED_INPUT : F11 : : : : 3 :GPIO_1[8] : F12 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[9] : F13 : bidir : 3.3-V LVTTL : : 4 : YUART_RXD : F14 : input : 3.3-V LVTTL : : 4 : YGPIO_1[6] : F15 : bidir : 3.3-V LVTTL : : 4 : YVCCA_PLL2 : F16 : power : : 1.2V : :VCCD_PLL2 : F17 : power : : 1.2V : :GND_PLL2 : F18 : gnd : : : :GND : F19 : gnd : : : :GPIO_1[21] : F20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[22] : F21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[23] : F22 : bidir : 3.3-V LVTTL : : 5 : YNC : G1 : : : : :NC : G2 : : : : :HEX1[4] : G3 : output : 3.3-V LVTTL : : 2 : YGND : G4 : gnd : : : :HEX2[0] : G5 : output : 3.3-V LVTTL : : 2 : YHEX2[1] : G6 : output : 3.3-V LVTTL : : 2 : YRESERVED_INPUT : G7 : : : : 3 :RESERVED_INPUT : G8 : : : : 3 :VCCIO3 : G9 : power : : 3.3V : 3 :GND : G10 : gnd : : : :RESERVED_INPUT : G11 : : : : 3 :UART_TXD : G12 : output : 3.3-V LVTTL : : 4 : YGND : G13 : gnd : : : :VCCIO4 : G14 : power : : 3.3V : 4 :GPIO_1[3] : G15 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[7] : G16 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[26] : G17 : bidir : 3.3-V LVTTL : : 5 : YGPIO_1[25] : G18 : bidir : 3.3-V LVTTL : : 5 : YVCCIO5 : G19 : power : : 3.3V : 5 :GPIO_1[24] : G20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[24] : G21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[25] : G22 : bidir : 3.3-V LVTTL : : 5 : YHEX0[3] : H1 : output : 3.3-V LVTTL : : 2 : YHEX0[2] : H2 : output : 3.3-V LVTTL : : 2 : YRESERVED_INPUT : H3 : : : : 2 :HEX1[3] : H4 : output : 3.3-V LVTTL : : 2 : YHEX1[2] : H5 : output : 3.3-V LVTTL : : 2 : YHEX1[1] : H6 : output : 3.3-V LVTTL : : 2 : YFL_CE_N : H7 : output : 3.3-V LVTTL : : 3 : NSD_CMD : H8 : output : 3.3-V LVTTL : : 3 : NRESERVED_INPUT : H9 : : : : 3 :RESERVED_INPUT : H10 : : : : 3 :RESERVED_INPUT : H11 : : : : 3 :GPIO_1[0] : H12 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[1] : H13 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[2] : H14 : bidir : 3.3-V LVTTL : : 4 : YPS2_CLK : H15 : bidir : 3.3-V LVTTL : : 4 : YRESERVED_INPUT : H16 : : : : 5 :GPIO_1[27] : H17 : bidir : 3.3-V LVTTL : : 5 : YGPIO_1[29] : H18 : bidir : 3.3-V LVTTL : : 5 : YRESERVED_INPUT : H19 : : : : 5 :GND : H20 : gnd : : : :NC : H21 : : : : :NC : H22 : : : : :HEX0[1] : J1 : output : 3.3-V LVTTL : : 2 : YHEX0[0] : J2 : output : 3.3-V LVTTL : : 2 : YNC : J3 : : : : :HEX3[3] : J4 : output : 3.3-V LVTTL : : 2 : YNC : J5 : : : : :NC : J6 : : : : :VCCIO2 : J7 : power : : 3.3V : 2 :NC : J8 : : : : :NC : J9 : : : : :VCCINT : J10 : power : : 1.2V : :VCCINT : J11 : power : : 1.2V : :VCCINT : J12 : power : : 1.2V : :VCCINT : J13 : power : : 1.2V : :PS2_DAT : J14 : bidir : 3.3-V LVTTL : : 4 : YGPIO_1[28] : J15 : bidir : 3.3-V LVTTL : : 5 : YVCCIO5 : J16 : power : : 3.3V : 5 :RESERVED_INPUT : J17 : : : : 5 :GPIO_0[32] : J18 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[30] : J19 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[31] : J20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[26] : J21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[27] : J22 : bidir : 3.3-V LVTTL : : 5 : YnCE : K1 : : : : 2 :TCK : K2 : input : : : 2 :GND : K3 : gnd : : : :DATA0 : K4 : input : : : 2 :TDI : K5 : input : : : 2 :TMS : K6 : input : : : 2 :GND : K7 : gnd : : : :NC : K8 : : : : :VCCINT : K9 : power : : 1.2V : :GND : K10 : gnd : : : :GND : K11 : gnd : : : :GND : K12 : gnd : : : :GND : K13 : gnd : : : :VCCINT : K14 : power : : 1.2V : :NC : K15 : : : : :GND : K16 : gnd : : : :NC : K17 : : : : :NC : K18 : : : : :GND : K19 : gnd : : : :GPIO_0[33] : K20 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[28] : K21 : bidir : 3.3-V LVTTL : : 5 : YGPIO_0[29] : K22 : bidir : 3.3-V LVTTL : : 5 : YCLOCK_50 : L1 : input : 3.3-V LVTTL : : 2 : YSW[9] : L2 : input : 3.3-V LVTTL : : 2 : YVCCIO2 : L3 : power : : 3.3V : 2 :nCONFIG : L4 : : : : 2 :TDO : L5 : output : : : 2 :DCLK : L6 : : : : 2 :NC : L7 : : : : :HEX3[4] : L8 : output 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